Pedro André Martins Bezerra: Universidade Federal de Santa Catarina Departamento de Engenharia Elétrica

UNIVERSIDADE FEDERAL DE SANTA CATARINA
DEPARTAMENTO DE ENGENHARIA ELÉTRICA
Pedro André Martins Bezerra
INVERSOR TRIFÁSICO PWM FONTE DE

TENSÃO COM INTEGRAÇÃO DE
INTERRUPTORES EM DELTA
Florianópolis
2013
Pedro André Martins Bezerra
INVERSOR TRIFÁSICO PWM FONTE DE

TENSÃO COM INTEGRAÇÃO DE
INTERRUPTORES EM DELTA
Dissertação submetida ao Programa de Pós-

Graduação em Engenharia Elétrica da
Universidade Federal de Santa Catarina para
obtenção do Grau de Mestre em Engenharia
Elétrica.
Orientador: Prof. Marcelo Lobo Heldwein,
Dr. sc. ETH
Florianópolis, Julho de 2013

Ficha de identificação da obra elaborada pelo autor,
através do Programa de Geração Automática da Biblioteca Universitária da UFSC.
Bezerra, Pedro André

Inversor Trifásico PWM Fonte de Tensão com Integração de
Interruptores em Delta / Pedro André Bezerra ; orientador,
Marcelo Lobo Heldwein - Florianópolis, SC, 2013.
253 p.
Dissertação (mestrado) - Universidade Federal de Santa

Catarina, Centro Tecnológico. Programa de Pós-Graduação em
Engenharia Elétrica.
Inclui referências
1. Engenharia Elétrica. 2. Inversor de Tensão PWM. 3.

Interruptores em Delta. 4. Modo Comum. 5. Alto Rendimento.
I. Lobo Heldwein, Marcelo . II. Universidade Federal de
Santa Catarina. Programa de Pós-Graduação em Engenharia
Elétrica. III. Título.
“Talvez não tenha conseguido fazer o melhor, mas lutei
para que o melhor fosse feito. Não sou o que deveria
ser, mas Graças a Deus, não sou o que era antes.”
Marthin Luther King

Aos meus pais.
AGRADECIMENTOS
Gostaria de expressar toda minha gratidão a todos que me apoia-

ram para que eu lograsse êxito em realizar meu mestrado. Vários foram
os momentos que precisei de ajuda e incentivo e, nesses momentos, tive
a felicidade de contar com algumas pessoas muito importantes.
Primeiramente, gostaria de agradecer ao meu orientador, Prof.
Marcelo Heldwein, por todo o conhecimento transmitido e pela orienta-
ção exemplar dedicada ao desenvolvimento deste trabalho. Sou muito
grato por toda sua confiança, ajuda e compreensão. Sua maneira de
trabalhar é contagiante e me serve hoje como inspiração.
Aos membros da banca: Prof. Romeu Hausmann, Prof. Telles
Lazzarin, Prof. Ivo Barbi e Prof. Samir Mussa por terem disponi-
bilizado seu tempo para participar da defesa e por terem corrigido o
documento escrito. Agradeço também ao Prof. Perin, pois mesmo
fazendo parte da banca como suplente, contribuiu de forma bastante
significativa na correção da dissertação. Gostaria de agradecer especi-
almente ao Prof. Ivo Barbi pelas melhores aulas que já tive até hoje.
É admirável sua habilidade de transmitir conteúdos complexos de uma
maneira bastante natural e agradável. Agradeço por todo o conheci-
mento transmitido.
Aos demais professores e ex-professores do Instituto de Eletrô-
nica de Potência (INEP): Denizar Martins e Enio Kassick pelo ensino
técnico de qualidade e pelos ensinamentos de vida passados durante as
aulas.
Aos meus grandes amigos, conterrâneos, companheiros de gradu-
ação e pós-graduação, e de moradia em Florianópolis: Décio Haramura,
Luis Fernando, Luis Paulo, Carlos Alberto, Gean Jacques, Levy Costa
e Lincoln Moura. Agradeço pelos dias de convivência, amizade e ajuda
nos momentos difíceis. A minha estadia em Florianópolis foi muito
agradável por causa de vocês. Em especial ao Levy Costa, Gean Jac-
ques e Carlos Alberto que me acompanharam até que eu concluísse o
mestrado.
Aos meu amigos da turma de mestrado Luís Fernando Machado,
Luís Fernando Fontenelle, Rodrigo Santos, Odair Custódio, Marcelo
Maccarini, Alan Callegaro, Levy Costa e Gean Jacques. Além de ser
uma turma com imenso potencial técnico, também é um grupo que
sempre procurou trabalhar em equipe para obter os melhores resulta-
dos. Agradeço a todos pela amizade, debates e pelos conhecimentos
compartilhados nesses anos de convivência.
Aos demais membros do INEP que tive o o prazer de convi-
ver durante o período do mestrado: Daniel Flores, Gierri Waltrich,
Adriano Ruseler, Eduardo de Souza, Walbermark dos Santos, Bruno
Dupczak, Hugo Larico, Antônio Bottion, Joselito Heerdt, Nilton da
Silva, Franciéli Lima, Moisés Villanueva, Ivar Ordoñez, Delvanei Ban-
deira, Marcos Jacoboski, Rafael Faust, Rodrigo Piontkewicz, Rômulo
Schweitzer, Jefferson Zanotti, André Andreta, Lenon Schmitz, Juarez
Camurça e Rafael Eckstein. Sou muito grato pela convivência, momen-
tos de descontração e de troca de experiencias. Gostaria de agradecer
especialmente ao Thiago Soeiro, Daniel Collier, Marcio Ortmann, An-
dré Fuerback, Jackson Lago, Joabel Moia, Roberto Coelho e Tiago
Jappe pela ajuda técnica nos projetos que tivemos a oportunidade de
trabalhar em parceria.
Aos técnicos do INEP: Antônio Pacheco, Luiz Coelho e Carina
Melatto pelo suporte técnico na parte de hardware e de informática.
Aos demais funcionários do INEP: Diogo Duarte, Leandro e Elisabete
pelo excelente trabalho em manter o laboratório sempre organizado.
Aos estudantes de iniciação cientifica: Pedro Pereira, Jaqueline
Clamer, Vitor e Wagner Hoffmann pela ajuda na construção dos pro-
tótipos.
Não poderia deixar de agradecer também aos amigos que fiz em
Fortaleza: Julio César, Evilásio Lucena, Ronny Glauber, Eduardo Fa-
çanha, Dalton Honório e Wellington Avelino. Sempre que retorno à
minha cidade natal tenho a felicidade de poder reencontrá-los e relem-
brar os velhos tempos.
À minha família que me recebeu de braços abertos sempre que
tive a oportunidade de retornar para casa. Gostaria de fazer um agra-
decimento especial à minha querida avó Margarida Martins que, infeliz-
mente, não conseguiu ver seu neto superando mais esta etapa da vida.
Devo muito do que sou hoje graças aos seus cuidados e ensinamentos.
Faço um agradecimento especial à minha namorada Nayara Co-
riolano que, mesmo tão distante, soube transmitir-me todo seu amor
e carinho. Peço perdão pelos dias que estivemos longe um do outro,
pois sei que não é uma situação confortável. Agradeço por toda sua
paciência e por acreditar em nosso relacionamento.
Por fim, aos meus pais Pedro Alberto e Ângela Martins que, além
de terem me dado a vida e cuidado de mim durante minha infância
e juventude, ainda hoje, são meus pilares de sustentação. Agradeço
também à minha querida irmã a quem tenho tanto carinho.
Peço desculpas caso tenha esquecido de alguém, pois realmente
devo a muitos esta minha conquista.
Obrigado a todos e a deus pela vida!

RESUMO
Este trabalho apresenta o estudo de uma nova topologia de um

conversor trifásico dois níveis bidirecional com integração de interrup-
tores conectados em delta adequado para aplicações em acionamentos
de máquinas elétricas e para a conexão de sistemas à rede elétrica. A
inserção da malha de interruptores em delta a um inversor de tensão
convencional adiciona estados redundantes na operação do conversor
que, se escolhidos de maneira adequada em uma estratégia de modula-
ção, podem otimizar o desempenho do conversor, de acordo com crité-
rios do projetista. Dependendo da estratégia de modulação utilizada,
o conversor pode ser otimizado para a redução das perdas por condu-
ção ou para a redução da geração das tensões de modo comum. Uma
metodologia para a geração de técnicas de modulação PWM contínuas,
descontínuas e híbridas aplicáveis ao conversor proposto e a outros con-
vencionais é apresentada e o desempenho de algumas estratégias é ana-
lisado. Estratégias também foram propostas para concentrar as perdas
de comutação em componentes específicos, diminuindo a taxa de de-
crescimento da eficiência do conversor com o aumento da frequência de
comutação. Um protótipo de 10 kW foi construído para validar a aná-
lise teórica e para realizar a interface de sistemas geradores com a rede
elétrica. São fornecidos detalhes da implementação prática bem como
a metodologia adotada para o projeto do filtro de EMI e dos controla-
dores. Resultados experimentais são mostrados validando algumas das
análises apresentadas.
Palavras-chave: Inversor de Tensão, Trifásico, VSI, Interrup-
tores em Delta , Modulação, PWM, Vetorial, Modo Comum, Alto Ren-
dimento.
ABSTRACT
This work analyzes a novel three-phase two-level delta-switch active

voltage source inverter for electrical drives and grid connected appli-
cations. The addition of delta connected switches to the phases of a
voltage source inverter make possible new redundant operational sta-
tes. The converter states, when combined in a modulation strategy,
can optimize the converter performance as defined by the designer.
Depending on modulation, the converter can be optimized for losses
reduction or for common mode voltage reduction. A methodology for
continuous, discontinuous and hybrid PWM modulation strategies ge-
neration is presented, suitable for the proposed converter and other
conventional ones, and the performance of some of them is analyzed.
Strategies are also proposed in order concentrate the switching losses
in some components, reducing the efficiency decreasing rate when the
switching frequency is increased. A 10 kW prototype was designed and
implemented in order to validate the performed analyses and to connect
generation systems to the grid. Some practical details and the metho-
dology for EMI filters and controllers design are given. Experimental
results are presented validating some of the performed analysis.
Keywords: Voltage Source Inverter, Three-Phase, Delta-
Switch, Modulation, PWM, Vetorial, Common Mode, High Efficiency.
LISTA DE SÍMBOLOS
Símb. Descrição Unid.

nH/
AL Fator de indutância
espira2
Produto entre as áreas da
Ae Aω seção transversal do núcleo com mm4
a área da janela
Densidade de fluxo de saturação
Bsat T
do núcleo
Cic (s) Controlador de Corrente -
Capacitância máxima do
Cf,max F
filtro LCL
Cf Capacitância de Filtro F
Cd Capacitância de Amortecimento F
δ Ângulo de fator de potência rad
Funções de razão cíclica dos interruptores
dSij em estrela do ∆-VSI, onde i ∈ {a, b, c} -
e j ∈ {p, n}
Funções de razão cíclica dos interruptores
dSijk em delta do ∆-VSI, onde i ∈ {a, b, c} -
e j ∈ {a, b, c} com i 6= j e k ∈ {1, 2}
Funções de razão cíclica dos
tempos de aplicação dos vetores,
di -
referenciados ao primeiro sextante
onde i ∈ {1, 2, null}
Funções de razão cíclica dos tempos em
dj que o vetor nulo é aplicado durante -
um período de comutação, onde j = 0, 7
diso Diâmetro do condutor com isolação m
Funções de razão cíclica de referência
d∗a , d∗b , d∗c -
em coordenadas abc
d∗α , d∗β -
em coordenadas αβ
Vetor contendo as funções de razão cíclica
d~s dos interruptores superiores em estrela -
do ∆-VSI
d~d dos interruptores em delta -
do ∆-VSI
d~t dos tempos de aplicação dos vetores -
do ∆-VSI
Vetor contendo as funções de razão
d~∗s cíclica de referência dos interruptores -
superiores em estrela do ∆-VSI
função de razão cíclica de eixo zero do
dz -
∆-VSI
d~∗abc -
de referência do ∆-VSI
db Diâmetro de cobre do condutor m
Ondulação máxima de corrente
∆imax A
em torno do valor médio
Elevação de temperatura indutor ◦
∆TLc C
do lado do conversor
Profundidade de penetração da
δω corrente no cobre na temperatura m
máxima de operação
eα , eβ erro de corrente em coordenadas αβ A
ηω Fator de porosidade -
η Rendimento -
Fr Fator de resistência -
fint Frequência de interesse Hz
ff Frequência fundamental Hz
fs Frequência de Comutação Hz
Frequência de ressonância do
fress,LCL Hz
filtro LCL
Sinais de Gatilho dos Interruptores
GSij do ∆-VSI, onde i ∈ {a, b, c} V
e j ∈ {a, b, c, p, n} com i 6= j
Função de transferência da planta
Gic (s) -
das correntes no lado do conversor
Hpk Intensidade de campo de pico A/m
Função de transferência do
Hic (s) -
condicionamento de sinal de corrente
Hint Intensidade de campo de interesse A/m
Vetor contendo as as correntes
~i∗
abc A
de referência do ∆-VSI
ia ,ib ,ic Correntes de fase em coordenadas abc A
Corrente de pico das correntes de
Iˆpk A
referência do lado CA
Valor médio da corrente no interruptor
iSap,med A
Sap
Valor eficaz da corrente no interruptor
iSap,rms A
Sap
Valor médio da corrente no interruptor
iSbc,med A
Sbc
Valor eficaz da corrente no interruptor
iSbc,rms A
Sbc
In,ef Valor eficaz da corrente harmônica n A
ID Diâmetro interno do núcleo m
Ku,max Fator de utilização máximo -
L Indutância do indutor boost H
Lc Indutância do lado do conversor H
Lr Indutância do lado da rede H
Somatório da indutância do conversor
Ltot H
com a indutância da do lado da rede
Indutância mínima do indutor do
Lc,min H
lado do conversor
lc Comprimento do caminho magnético m
Lob Indutância de projeto H
lω Comprimento total do condutor m
M Índice de modulação -
µ0 Permeabilidade absoluta do vácuo H/m
µi Permeabilidade inicial do material -
Permeabilidade normalizada em
µpu -
relação a permeabilidade inicial
Funções de razão modulação de
m∗a , m∗b , m∗c -
referência em coordenadas abc
Máximo índice de modulação para não
Mmax -
haver sobremodulação
mz Sinal de Modulação de Eixo Zero -
Funções de modulação dos interruptores
mSij em estrela do ∆-VSI, onde i ∈ {a, b, c} -
e j ∈ {p, n}
Funções de razão cíclica dos
interruptores em delta do ∆-VSI, onde
mSijk -
i ∈ {a, b, c} e j ∈ {a, b, c}
com i 6= j e k ∈ {1, 2}
Número máximo de espiras para
Nmax,B -
não haver saturação do núcleo
N Número de Espiras -
Número máximo de espiras para
Nmax,ω -
fisicamente possível de implementar
Ncam Número de camadas de condutores -
Espiras que podem ser acomodadas
n
Nmax,cam por camada, onde n é o número -
da camada
Np Quantidade de núcleos em paralelo -
Quantidade de camadas inteiras
nec necessárias para acomodar -
todas as espiras do indutor
vetores que são aplicados após o
Ondmax primeiro vetor nulo da janela A
de comutação
Po Potência de Saída W
Pin Potência de Entrada W
PMosfet,cond Perdas por Condução em um Mosfet W
PMosfet,cond Perdas por Condução em um Mosfet W
PMosfet,tot Perdas por condução totais W
PCom Perdas por comutação W
PCom,tot Perdas por comutação totais W
Ptot Perdas totais W
Potência total dissipada nos condutores
Pω W
do indutor
Potência total dissipada no núcleo
Pc W
do indutor
Potência dissipada no cobre
Pω,lf pela componente fundamental W
de corrente
Potência dissipada no cobre
Pω,hf pelas componentes harmônicas W
de corrente
Potência total dissipada no indutor
PLc W
do lado do conversor
p1 e p2 Derivadas de corrente A/s
Relação entre as indutâncias do
r -
filtro LCL
Resistividade do cobre na
ρT Ωm
temperatura máxima de operação
Rd Resistência de amortecimento Ω
Resistência série do capacitor
Rf Ω
de filtro
Resistência de condução do interruptor
RSij controlado Sij , onde i ∈ {a, b, c} e Ω
j ∈ {a, b, c, p, n} com i 6= j
Resistência de condução do
interruptor Dij não controlado,
RDij Ω
onde i ∈ {a, b, c} e j ∈ {a, b, c, p, n}
com i 6= j
Resistência do cobre para corrente
Rcc Ω
contínua
Resistência do cobre para corrente
Rca Ω
alternada
Interruptores do ∆-VSI, onde
Sij -
i ∈ {a, b, c} e j ∈ {a, b, c, p, n} com i 6= j
Função de comutação do interruptor
sij Sij , onde i ∈ {a, b, c} e -
j ∈ {a, b, c, p, n} com i 6= j
Sextantes do mapa de vetores do ∆-VSI,
Si -
onde i ∈ {0, 1...6}
Tamb Temperatura ambiente ◦
C
Tempo de aplicação dos vetores,
Ti referenciados ao primeiro sextante s
onde i ∈ {1, 2, null}
Ts Período de comutação s
Intervalos de tempo em que o vetor
Tj nulo é aplicado em um período de s
comutação, onde j = 0, 7
Toper Temperatura de operação ◦
C
Tj Temperatura na Junção ◦
C
tj Tempo de aplicação do vetor V
~j V
θ Ângulo das tensões de fase rad
0 Ângulo das tensões de fase referido
θ rad
ao primeiro sextante
Tensão média sobre capacitores do
Vdc V
barramento CC
va ,vb ,vc Tensões de fase em coordenadas abc V
vα ,vβ ,vγ Tensões de fase em coordenadas αβγ V
Vetores espaciais de tensão do ∆-VSI,
~i
V V
onde i ∈ {0, 1...6}
Vetores espaciais ativos de tensão do
∆-VSI utilizando apenas os
~i,VSI
V V
interruptores em estrela,
onde i ∈ {0, 1...6}
∆-VSI utilizando dois interruptores em
~i,SDj
V V
estrela e um interruptor em delta,
onde i ∈ {0, 1...6} e j ∈ {1, 2}
∆-VSI, utilizando três interruptores
~i,RCL
V V
em estrela e um interruptor em
delta, onde i ∈ {0, 1...6}
Vetor nulo de tensão do ∆-VSI
~0,VSIj
V utilizando apenas os interruptores V
em estrela, onde j ∈ {1, 2}
utilizando os interruptores
~0,RCLj
V V
em estrela e em delta simultaneamente,
onde j ∈ {1, 2}
~0,RCMV
V utilizando apenas os interruptores V
em delta, onde j ∈ {1, 2}
Tensão de polarização do interruptor
VSij controlado Sij , onde i ∈ {a, b, c} V
e j ∈ {a, b, c, p, n} com i 6= j
Tensão de polarização do interruptor
VDij VDij não controlado, onde V
i ∈ {a, b, c} e j ∈ {a, b, c, p, n} com i 6= j
~∗
V Vetor de referência em coordenadas αβ V
Valor de pico das tensões de fase
V̂pk V
de referência
Vdc Tensão Média do Barramento CC V
Tensão máxima de pico de fase
~max
V ∗
para que não haja sobremodulação na V
modulação senoidal
Portadora triangular dos moduladores
vtri V
do ∆-VSI
Valor Médio Quase Instantâneo
hvari -
das Variáveis do ∆-VSI
va∗ , vb∗ , vc∗ V
em coordenadas abc
Valor de pico da componente
V̂f 1 fundamental das tensões de V
referência
vcm Tensão de modo comum V
Vo,rms Tensão eficaz de linha no lado CA V
vetores que são aplicados após o
~y
V primeiro vetor nulo da janela V
de comutação
LISTA DE ABREVIATURAS E SIGLAS
Grampeamento Ativo no Ponto Central

ANPC
(Active Neutral Point Clamped )
AD Analógico Digital
ADC Conversor Analógico Digital
BT Baixa Tensão
CA Corrente Alternada
CC Corrente Contínua
PWM Baseada em Portadoras
CBPWM
(Carrier Based PWM)
PWM contínua
CPWM
(Continuous PWM)
SVM Contínua
CSVM
(Continuous SVM)
Inversor Trifásico de Tensão
Dois Níveis com Interruptores em Delta
∆-VSI
(Two-Level Three-Phase Delta-Switch Voltage
Source Inverter)
Retificador Trifásico de Tensão
Dois Níveis com Interruptores em Delta
∆-VSR
(Two-Level Three-Phase Delta-Switch
Voltage Source Rectifier)
Ponto Neutro Grampeado com
∆-NPC Interruptores em Delta
(Delta-Switch Neutral Point Clamped)
Tipo T com Interruptores em Delta
∆-Tipo T
(Delta-Switch T-Type)
Capacitor flutuante com
∆-FCap Interruptores em Delta
(Delta-Switch FCap)
DPWM PWM Descontínua
PWM Descontínua 1
DPWM1
com ângulo ϕ = 0◦
PWM Descontínua 0
DPWM0
com ângulo ϕ = −60
PWM Descontínua 2
DPWM2
com ângulo ϕ = 60
DPWM3 PWM Descontínua 3
DPWMMAX PWM Descontínua Máxima
DPWMMIN PWM Descontínua Mínima
PWM Descontínua que utiliza os
DPWM13 padrões de pulsos da DPWM1 e da DPWM3
(DPWM1 nos picos de m ~ ∗abc )
PWM Descontínua que utiliza os
DPWM31 padrões de pulsos da DPWM3 e da DPWM1
(DPWM3 nos picos de m ~ ∗abc )
Controlador Digital de Sinais
DSC
(Digital Signal Controller)
SVM Descontínua
DSVM
(Discontinuous SVM)
Interferência Eletromagnética
EMI
(Eletromagnetic Interference)
Arranjo de Portas Programável em Campo
FPGA
(Field Programmable Gate Array)
GD Geração Distribuída
GDPWM PWM Descontínua Generalizada
Modulação PWM Descontínua que utiliza os
GDSVPWM padrões de pulsos da GDPWM e da SVPWM
(GDPWM nos picos de m ~ ∗abc )
Conceito de Inversor Altamente
Eficiente e Confiável
HERIC
(Highly Efficient and Reliable
Inverter Concept)
Instituto de Engenheiros Eletricistas
e Eletrônicos
IEEE
Institute of Electrical and Electronics
Engineers
Transistor Bipolar com Gatilho Isolado
IGBT
(Isolated Gate Bipolar Transistor )
Equação de Steimetz Generalizada
e Melhorada
iGSE
(Improved Generalized Steimetz
Equation)
MCD Modo de Condução Descontínuo
Transistor de Efeito de
Campo Metal Oxido Semicondutor
MOSFET
(Metal Oxide Semiconductor
Field Effect Transistor)
Grampeamento no Ponto Central
NPC
(Neutral Point Clamped )
ONS Operador Nacional do Sistema
Modulação por Largura da Pulso
PWM
(Pulse Width Modulation)
PI Proporcional Integral
PR Proporcional Ressonante
Perdas por Condução Reduzidas
RCL
(Reduced Conduction Losses)
Reduzido Valor da Tensão de Modo Comum
RCMV
(Reduced Common Mode Voltage)
Perdas Reduzidas
RL
(Reduced Losses)
IGBT com Capacidade de Bloqueio Reverso
RB-IGBT
(Reversing Block IGBT)
SEP Sistema Elétrico de Potência
SPWM Modulação PWM Senoidal
SVM Modulação Vetorial (Space Vector Modulation)
Modulação PWM Descontínua que utiliza os
SVGDPWM padrões de pulsos da SVPWM e da GDPWM
(SVPWM nos picos de m ~ ∗abc )
SVPWM Modulação Vetorial PWM
TDH Taxa de Distorção Harmônica
2L-VSI Inversor Trifásico de Tensão Dois Níveis
VMQI Valor Médio Quase Instantâneo
Comutação sob Tensão Nula
ZVS
(Zero Voltage Switching)
SUMÁRIO
1 INTRODUÇÃO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1
1.1 Contextualização do Trabalho . . . . . . . . . . . . . . . 1
1.2 Principais Contribuições do Trabalho . . . . . . . . . . . 4
1.2.1 Artigos Publicados . . . . . . . . . . . . . . . . . 4
1.3 Estrutura da Dissertação . . . . . . . . . . . . . . . . . . 5
2 INVERSORES TRIFÁSICOS DE ALTO DESEMPENHO

PARA APLICAÇÕES EM BT . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7
2.1 Introdução . . . . . . . . . . . . . . . . . . . . . . . . . . 7
2.2 Inversor Trifásico de Tensão Dois Níveis Convencional
(2L-VSI) . . . . . . . . . . . . . . . . . . . . . . . . . . . 7
2.3 Inversores Dois Níveis com Comutação Suave . . . . . . 9
2.4 Inversores Dois Níveis Operando em Máquinas com Bo-
binas Acessíveis (Dual VSI) . . . . . . . . . . . . . . . . 10
2.5 Inversores Três Níveis . . . . . . . . . . . . . . . . . . . 11
2.6 Topologia Proposta . . . . . . . . . . . . . . . . . . . . . 13
2.6.1 Geração da Topologia . . . . . . . . . . . . . . . 14
2.7 Interruptores Conectados em Delta para Topologias
Multiníveis . . . . . . . . . . . . . . . . . . . . . . . . . 15
2.8 Conclusão . . . . . . . . . . . . . . . . . . . . . . . . . . 16
3 OPERAÇÃO E PRINCíPIOS DE MODULAÇÃO VETORIAL

DO ∆-VSI. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
3.1 Introdução . . . . . . . . . . . . . . . . . . . . . . . . . . 19
3.2 Restrições de Operação do ∆-VSI . . . . . . . . . . . . . 19
3.3 Análise Vetorial do ∆-VSI . . . . . . . . . . . . . . . . . 21
3.4 Estados Topológicos do ∆-VSI . . . . . . . . . . . . . . 25
3.5 Modulação Vetorial do ∆-VSI . . . . . . . . . . . . . . . 32
3.5.1 Cálculo dos Tempos de Aplicação dos Vetores . . 34
3.5.2 Restrições para o Vetor de Referência . . . . . . 36
3.5.3 Sequência de Vetores . . . . . . . . . . . . . . . . 38
3.6 Escolha dos Estados Redundantes e dos Semicondutores 40
3.6.1 Interruptores com Reduzidas Perdas por Condu-
ção Conectados em Delta . . . . . . . . . . . . . 41
3.6.2 Interruptores com Reduzidas Perdas por Condu-
ção Conectados em Estrela . . . . . . . . . . . . 43
3.6.3 Seleção dos Semicondutores . . . . . . . . . . . . 44
3.7 Conclusão . . . . . . . . . . . . . . . . . . . . . . . . . . 46
4 MODULAÇÃO PWM BASEADA EM PORTADORAS . . . . . . . 47

4.1 Introdução . . . . . . . . . . . . . . . . . . . . . . . . . . 47
4.2 Modelo Médio do ∆-VSI . . . . . . . . . . . . . . . . . . 48
4.3 Relação Entre a CBPWM e a SVM para os Interruptores
em Estrela . . . . . . . . . . . . . . . . . . . . . . . . . . 52
4.4 Relação Entre a CBSVM e a SVM para os Interruptores
em Delta . . . . . . . . . . . . . . . . . . . . . . . . . . 55
4.5 Geração dos Sinais Moduladores para os Interruptores
em Estrela . . . . . . . . . . . . . . . . . . . . . . . . . . 56
4.5.1 SVPWM . . . . . . . . . . . . . . . . . . . . . . 58
4.5.2 DPWM . . . . . . . . . . . . . . . . . . . . . . . 60
4.5.2.1 Tipos de DPWMs . . . . . . . . . . . . 64
4.5.3 Novas Estratégias de Modulação . . . . . . . . . 68
4.5.4 Alternância entre Estratégias de Modulação . . . 72
em Delta . . . . . . . . . . . . . . . . . . . . . . . . . . 74
4.7 Moduladores . . . . . . . . . . . . . . . . . . . . . . . . 76
4.8 Estratégia de Transição entre Vetores . . . . . . . . . . 78
4.9 Resultados do ∆-VSI Operando em Malha Aberta . . . 78
4.9.1 Resultado para as Modulações Tradicionais . . . 80
4.9.2 Resultados para as Modulações Híbridas . . . . . 80
4.9.3 Problema da Distorção na Entrada e na Saída da
Região de Descontinuidade . . . . . . . . . . . . 80
4.9.4 Detalhe da Transição Entre Vetores . . . . . . . 80
4.10 Conclusão . . . . . . . . . . . . . . . . . . . . . . . . . . 86
5 ANÁLISE DO DESEMPENHO DO ∆-VSI . . . . . . . . . . . . . . . . . . . 89

5.1 Descrição do Estudo de Caso . . . . . . . . . . . . . . . 89
5.2 Esforços de Corrente nos Interruptores . . . . . . . . . . 90
5.3 Perdas nos Semicondutores . . . . . . . . . . . . . . . . 102
5.3.1 Perdas por Condução . . . . . . . . . . . . . . . 104
5.3.2 Perdas por Comutação . . . . . . . . . . . . . . . 108
5.3.3 Perdas Totais nos Interruptores . . . . . . . . . . 110
5.4 Estudo da Ondulação das Correntes de Fase . . . . . . . 114
5.5 Espectro da Tensão de Modo Comum . . . . . . . . . . 121
5.6 Conclusão . . . . . . . . . . . . . . . . . . . . . . . . . . 122
6 APLICAÇÃO DO CONVERSOR ∆-VSI CONECTADO À
REDE ELÉTRICA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 125
6.1 Introdução . . . . . . . . . . . . . . . . . . . . . . . . . . 125
6.2 Especificações do Projeto . . . . . . . . . . . . . . . . . 125
6.3 Estudo do Filtro de Modo Diferencial . . . . . . . . . . 126
6.3.1 Escolha dos Parâmetros do Filtro LCL . . . . . . 128
6.4 Modelagem do Conversor Aplicado ao Controle . . . . . 132
6.5 Controle das Correntes do Lado CA . . . . . . . . . . . 138
6.6 Protótipo Implementado . . . . . . . . . . . . . . . . . . 146
6.6.1 Placa de Controle e Condicionamento de Sinais . 146
6.6.2 Fontes Auxiliares . . . . . . . . . . . . . . . . . . 147
6.6.3 Circuito de Gatilho dos Interruptores . . . . . . 147
6.6.4 Placa de Processamento de Energia e Protótipo
Final . . . . . . . . . . . . . . . . . . . . . . . . . 150
6.7 Placa do Filtro de EMI . . . . . . . . . . . . . . . . . . 151
6.8 Resultados Experimentais do Protótipo Implementado . 151
6.8.1 Validação das Estratégias de Modulação . . . . . 155
6.8.2 Curvas de Rendimento . . . . . . . . . . . . . . . 155
6.9 Conclusão . . . . . . . . . . . . . . . . . . . . . . . . . . 161
7 CONCLUSÃO GERAL . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 163

7.1 Trabalhos Futuros . . . . . . . . . . . . . . . . . . . . . 166
Apêndice A – Algorítmo para cálculo de Esforços do ∆-VSI . . . . . . 179

A.1 Introdução . . . . . . . . . . . . . . . . . . . . . . . . . . 179
A.2 Modelo Simplificado dos Interruptores . . . . . . . . . . 179
A.3 Determinação dos Parâmetros dos Circuitos Equivalentes 181
A.4 Definição das Envoltórias de Corrente . . . . . . . . . . 184
Referências Bibliográficas . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 179
Apêndice B – Projeto Físico dos Indutores do Filtro LCL. . . . . . . . . 193

B.1 Introdução . . . . . . . . . . . . . . . . . . . . . . . . . . 193
B.2 Procedimento de Projeto . . . . . . . . . . . . . . . . . . 193
B.2.1 Determinação do Número de Espiras e do Nú-
mero de Núcleos em Paralelo . . . . . . . . . . . 195
B.2.2 Escolha do Condutor . . . . . . . . . . . . . . . . 197
B.2.3 Perdas nos Condutores . . . . . . . . . . . . . . . 198
B.2.4 Perdas no Magnético . . . . . . . . . . . . . . . . 200
B.2.5 Elevação de Temperatura . . . . . . . . . . . . . 200
B.3 Resultados Obtidos . . . . . . . . . . . . . . . . . . . . . 200
Apêndice C – Diagramas Esquemáticos . . . . . . . . . . . . . . . . . . . . . . . . . . . 203

1
1 INTRODUÇÃO
1.1 Contextualização do Trabalho
O século XXI trouxe consigo diversas propostas de mudanças na

maneira como geramos, transmitimos e consumimos a energia elétrica.
É mostrado na Figura 1.1 que, no início do século, houve um aumento
significativo na taxa de crescimento do consumo de energia, principal-
mente para geração de energia elétrica. Analisando a previsão para
2030, verifica-se também que o consumo só tende a aumentar. Como a
maior parte da energia consumida provém de fontes não renováveis de
energia e que geram gases causadores do efeito estufa, conclui-se que
panorama para o futuro é insustentável.
Por Uso Primário Por Fonte Primária
Bilhão de *TEP Bilhão de *TEP
**Alternativa
Hidro
Nuclear
Geração de
Eenergia Carvão
Indústria Gás
Outras
Petróleo
Transporte
*Tonelada Equivalente de Petróleo

**Incluindo Biocombustíveis
Figura 1.1: Consumo global de energia separado por: (a) por uso primário;
(b) por fonte primária [1].
O aumento do consumo energético presenciado nos últimos anos,

aliado à volatilidade do petróleo, a ineficiência das usinas térmicas,
a segurança questionável das usinas nucleares, e questões ambientais
2 1 Introdução
envolvendo emissão de gases causadores do efeito estufa, radiação e

destruição de ecossistemas fizeram surgir propostas de restruturação, a
começar, pelo Sistema Elétrico de Potência (SEP).
Durante muito tempo, a geração de energia no sistema elétrico
de potência foi concentrada em locais isolados próximos às grandes
fontes de energia, ou seja, próximo às mineradoras, poços de petróleo,
grandes reservas hídricas. A energia gerada por essas fontes é então
transmitida por extensas redes de alta tensão em Corrente Alternada
(CA) e distribuída para os consumidores domésticos em uma rede de
Baixa Tensão (BT) em CA. Os consumidores dessa rede convencional
são passivos no que diz respeito à geração de energia, sendo o Operador
Nacional do Sistema (ONS) o responsável pelo despacho de toda a
geração do sistema. Hoje se propõe que a geração de energia ocorra em
forma de Geração Distribuída (GD), conforme mostrado na Figura 1.2.
Figura 1.2: Diagrama unifilar simplificado de uma rede inteligente.
Nesse novo sistema, os consumidores de energia passam também

a gerar, o que aproxima o ponto de consumo do ponto de produção. A
incorporação das unidades de GD trazem diversos benefícios ao SEP
como o aumento da confiabilidade e qualidade de energia, maior faci-
lidade de instalação de novas fontes de geração, e a incorporação das
fontes renováveis não convencionais de energia como a solar fotovoltaica
1.1 Contextualização do Trabalho 3
e a eólica.
Os veículos elétricos também passam a ser elementos importantes
nessa nova estrutura que, além de reduzir a quantidade de emissão de
carbono na atmosfera, por não utilizarem combustíveis fósseis, também
podem servir como elementos armazenadores de energia para o SEP no
contexto de redes inteligentes (Smart Grids). Na Figura 1.3 é mostrado
que a energia utilizada no carro elétrio provém de baterias. Dado que a
energia armazenada é derivada de fontes renováveis, a substituição do
carro a combustão pelo carro elétrico contribui para a redução de gases
causadores do efeito estufa.
Figura 1.3: Esquemático de blocos de um veículo elétrico.
Entretanto, para que seja feito o controle da energia gerada e

consumida nas redes ativas inteligentes, é necessário à criação de um
sistema robusto de comunicação entre as fontes geradoras e consumi-
doras e a incorporação da eletrônica de potência ao sistema elétrico. O
controle do fluxo de energia entre as fontes de geração e os consumi-
dores finais será feito por inversores, retificadores, conversores CC-CC
e CA-CA, elementos já bastante difundidos no setor industrial. Além
disso, os veículos elétricos também necessitam dos conversores de po-
tência para o acionamento dos motores elétricos e de seus periféricos,
ressaltando ainda mais a importância da energia eletronicamente pro-
cessada.
Os conversores mais utilizados no SEP, no acionamento de veícu-
los elétricos e na indústria são os Inversores Fonte de Tensão (VSI) para
aplicações em baixa tensão (<1000 V) e médias potências (<100 kW).
Devido aos apelos citados anteriormente, esses inversores devem pro-
cessar energia de forma eficiente e apresentar reduzidos peso e volume.
Tais conversores também são utilizados em estações de telecomunica-
4 1 Introdução
ções, em satélites e em aplicações aeroespaciais e navais. Outro aspecto

importante, principalmente para conversores conectados à rede elétrica
e em acionamento de máquinas, é a interferência eletromagnética (EMI)
proveniente da energia de comutação em alta frequência dos interrup-
tores de potência que é radiada ou transmitida via cabos para a rede
ou equipamentos nas proximidades.
Vários esforços têm sido feitos, ao longo dos anos, com o in-
tuito de melhorar o desempenho dos inversores de tensão e, é neste
sentido, que este trabalho busca contribuir. Uma busca recente, re-
alizada no banco de dados do Instituto de Engenheiros Eletricistas e
Eletrônicos (IEEE), por high efficiency inverter, resulta em mais de
2300 trabalhos, o que demostra grande empenho por parte dos pes-
quisadores para melhorar o rendimento das topologias já existentes ou
propor novas alternativas de topologias.
1.2 Principais Contribuições do Trabalho
O trabalho em questão contribuiu no estudo de uma nova topo-

logia de inversor trifásico com modulação por largura de pulsos (PWM)
fonte de tensão dois níveis com com potencial para ser otimizado em re-
lação a densidade de potência, rendimento e emissões eletromagnéticas.
Novas topologias multiníveis foram derivadas de maneira semelhante à
estudada na dissertação.
Ao longo do trabalho, foram propostas várias estratégias de mo-
dulação vetorial e baseadas em portadora para este conversor e o de-
sempenho de cada uma delas foi avaliado. Foi proposto um método
para estimação de esforços em conversores que apresentam divisão de
corrente entre dispositivos semicondutores durante um dado estado de
comutação. Um protótipo foi construído com o intuito de validar as as
análises realizadas. A aplicação desse conversor conectado à rede elé-
trica foi estudada onde os detalhes da implementação são fornecidos.
1.2.1 Artigos Publicados
No decorrer do ano destinado ao desenvolvimento do trabalho de

mestrado, foram publicados três artigos em conferências internacionais
relacionados com o tema desta dissertação [2]–[4].
1.3 Estrutura da Dissertação 5
1.3 Estrutura da Dissertação
Esta dissertação está dividida em seis capítulos destinados ao es-

tudo de uma nova topologia de inversor de tensão trifásico dois níveis.
Neste foi realizada uma contextualização do trabalho e suas contribui-
ções foram expostas.
No Capítulo 2, é feita uma revisão bibliográfica sobre topolo-
gias de inversores fonte de tensão utilizados em aplicações onde, em
baixa tensão e com média potência, um alto desempenho do conversor
é exigido. Ao final deste tópico, a topologia proposta é apresentada
juntamente com a metodologia seguida para a sua obtenção.
Os princípios de operação do conversor, bem como duas estra-
tégias de modulação vetorial, são apresentados no Capítulo 3. São
mostrados todos os estados e vetores possíveis que o conversor pode
implementar.
No Capítulo 4, são apresentadas algumas estratégias de modula-
ção PWM baseadas em portadoras para o conversor proposto. Aqui, é
apresentada uma metodologia para a geração de técnicas de modulação
PWM baseadas em portadora a partir dos padrões de pulsos desejados
para os interruptores. O procedimento desenvolvido pode ser estendido
para outros conversores trifásicos. Seguindo a mesma metodologia, téc-
nicas de modulação híbridas também são propostas para o conversor.
O procedimento para calcular as funções de modulação bem como a
estrutura dos moduladores são detalhados.
No Capítulo 5, o conversor proposto é comparado com um Inver-
sor Trifásico Fonte de Tensão dois Níveis (2L-VSI) para as modulações
propostas no Capítulo 4. As comparações foram feitas analiticamente
e verificadas por simulações e alguns resultados experimentais.
O estudo da aplicação do conversor proposto em sistemas conec-
tados à rede elétrica foi realizado no Capítulo 6. Nesse capítulo são
apresentadas especificações para o projeto de um inversor de 10 kW.
O modelo do conversor incluindo o seu filtro de saída para a realiza-
ção do controle de suas correntes também foi desenvolvido. O protótipo
construído é apresentado bem como resultados experimentais validando
algumas das teorias propostas no trabalho.
Por fim, no Capítulo 7, uma conclusão geral do trabalho é apre-
sentada bem como perspectivas para trabalhos futuros.
O apêndice A apresenta um algoritmo proposto para a deter-
minação dos esforços de corrente quando se tem mais de um caminho
6 1 Introdução
para a circulação das correntes nos interruptores em um estado de co-

mutação. No Apêndice B é mostrado o procedimento utilizado para a
realização do projeto físico dos indutores de filtro. O projeto foi reali-
zado para que o volume do filtro fosse otimizado. O Apêndice C mostra
os diagramas esquemáticos de todas as placas utilizadas no protótipo
construído.
7
2 INVERSORES TRIFÁSICOS DE ALTO DESEMPENHO

PARA APLICAÇÕES EM BT
2.1 Introdução
Neste capítulo, será feita uma revisão bibliográfica sobre inver-

sores trifásicos para aplicações em baixa tensão onde são requeridos
elevado rendimento e reduzidos peso e volume. Esses inversores, deno-
minados aqui de inversores de alto desempenho, geralmente não fazem
uso de transformadores de potência, pois tais elementos magnéticos
apresentam peso e volume elevados. Nesses conversores estão contidos
apenas capacitores, elementos semicondutores e, em alguns casos, tam-
bém pequenos componentes magnéticos para o auxílio da comutação.
2.2 Inversor Trifásico de Tensão Dois Níveis Convencional

(2L-VSI)
O 2L-VSI operando com Modulação por Largura de Pulso

(PWM) é mostrado na Figura 2.1. Esse inversor é denominado dois
níveis, pois aplica apenas dois níveis de tensão (-Vdc /2 e Vdc /2) entre
as fases e o ponto neutro do barramento CC e três níveis (-Vdc , Vdc e
0) entre as fases do lado CA conforme mostrado na Figura 2.2.
Desde a década de 1970, o 2L-VSI tem sido utilizado para o aci-
onamento de motores na indústria e em veículos elétricos [5] e, ainda
hoje, é a escolha padrão da indústria para realizar a conversão estática
de corrente contínua para corrente alternada [6]. Os principais moti-
vos para a utilização em larga escala desse conversor são a quantidade
reduzida de semicondutores, apenas seis interruptores ativos e seis in-
terruptores passivos (Diodos), a não necessidade de circuitos auxiliares
de comutação, a não necessidade de controle ativo da tensão de seus
capacitores, a boa distribuição de perdas, a facilidade de comando e a
robustez de operação. Além disso, existem hoje na literatura inúmeros
trabalhos reunidos em forma de artigos e livros [7], [8] sobre modelagem
e modulação desse conversor.
Como desvantagens, o 2L-VSI necessita de um filtro volumoso
de EMI devido a tensão com apenas três níveis entre seus terminais,
aumenta consideravelmente as perdas por comutação com o aumento
da frequência de comutação em relação a um conversor três níveis [6],
8 2 Inversores Trifásicos de Alto Desempenho para Aplicações em BT
Figura 2.1: Inversor trifásico fonte de tensão dois níveis convencional.
Figura 2.2: Tensão entre os terminais CA de um inversor trifásico dois níveis.
[9]–[11] e produz elevados níveis de emissões de modo comum 1 .

As vantagens, os desafios e melhorias para esse conversor vêm
sendo estudados desde a década de 1970 até hoje. Esse fato pode ser
constatado realizando uma busca no banco de dados do IEEE [12] por
Three-phase PWM inverter que retorna mais de 2.000 resultados.
Para tentar melhorar o desempenho desse inversor no que diz
respeito a perdas nos semicondutores, uma estratégia utilizada é o pa-
ralelismo de semicondutores. Esta técnica multiplica a quantidade de
interruptores utilizados com o intuito de reduzir as perdas por condução
1 A tensão de modo comum (v
cm ) foi definida neste trabalho como a média
das tensões nos terminais AC do conversor em relação ao centro do barramento
capacitivo (v10 + v20 + v30 )/3
2.3 Inversores Dois Níveis com Comutação Suave 9
do conversor [13]. Isso é obtido com o aumento nas perdas por comu-
tação e com a necessidade de estratégias de controle para balancear os
esforços de corrente entre os interruptores em paralelo.
2.3 Inversores Dois Níveis com Comutação Suave
Na década de 1990, para reduzir os esforços nos semicondutores

devido às perdas por comutação, diversos circuitos auxiliares foram pro-
postos para realizar a comutação sem perdas (suave) dos interruptores.
Três desses circuitos são mostrados na Figura 2.3. Por apresentarem
maior rendimento e um volume reduzido, os 2L-VSIs operando com
comutação suave são utilizados em aplicações como a tração automo-
tiva [14].
A Figura 2.3(a) [15] mostra o circuito auxiliar conectado em delta
às fases do inversor e a Figura 2.3(b) [16] mostra o circuito auxiliar co-
nectado em estrela. Nos dois circuitos, os interruptores auxiliares são
ligados momentos antes e desligados momentos depois dos interruptores
principais para que ocorra Comutação sob Tensão Nula (ZVS) dos in-
terruptores principais. O 2L-VSI com o circuito auxiliar conectado em
delta é mais vantajoso em relação 2L-VSI com o circuito auxiliar conec-
tado em estrela, pois não apresenta tensão flutuante nem sobretensão
nos interruptores auxiliares, não apresenta corrente de circulação nas
fases desligadas, e não necessita que os diodos auxiliares sejam rápidos.
A eficiência dos conversores dois níveis operando com comuta-
ção suave é aumentada, porém para isso tiveram que ser acrescentados
três interruptores bidirecionais em tensão e em corrente, seus respecti-
vos circuitos de comando e três indutores em relação ao 2L-VSI. Além
disso, há uma maior complexidade na geração dos sinais de comando
do inversor, pois existem três sinais a mais para serem gerados e sin-
cronizados.
Pensando em reduzir a quantidade de circuitos auxiliares para
obter comutação suave, topologias como a apresentada em [17] e mos-
trada na Figura 2.3 (c) foram propostas. Esse circuito é capaz de operar
com comutação suave em todos os interruptores, inclusive no auxiliar,
para toda a faixa de variação de carga. Como desvantagem, o inter-
ruptor auxiliar é submetido à elevados esforços de corrente no circuito
com grampeamento ativo.
102 Inversores Trifásicos de Alto Desempenho para Aplicações em BT
Figura 2.3: Inversores trifásicos de tensão dois níveis operando com comuta-
ção suave utilizando circuito auxiliar em: (a) estrela; (b) delta; (c) grampe-
amento ativo.
2.4 Inversores Dois Níveis Operando em Máquinas com Bo-

binas Acessíveis (Dual VSI)
Para tentar reduzir a tensão de modo comum e a ondulação de

corrente geradas pelos conversores dois níveis em aplicações para acio-
namento de máquinas, uma estratégia encontrada na literatura consiste
na utilização de dois 2L-VSI conectados aos terminais das bobinas, con-
forme ilustra a Figura 2.4.
Esse conversor é capaz de aplicar sete vetores, entre eles vetores
ativos e nulos, com tensão de modo comum nula. Utilizando a estratégia
de modulação adequada, é possível zerar a tensão de modo comum que
2.5 Inversores Três Níveis 11
Figura 2.4: Inversor trifásico de tensão dual.
a máquina é submetida [18], [19]. As desvantagens desse conversor são

o uso restrito de aplicações (máquinas com acesso aos dois terminais
das bobinas), a maior complexidade da modulação e a quantidade de
interruptores necessários.
2.5 Inversores Três Níveis
Os inversores trifásicos de tensão multiníveis [20] são a principal

solução para conversão de energia em tensões mais elevadas. Entre-
tanto, na década de 2000, os inversores multiníveis, em especial os
inversores três níveis, vêm se tornando uma alternativa interessante
também para a conversão de energia em baixa tensão. Os inversores de
tensão três níveis mais estudados na literatura para esse tipo de aplica-
ção são o com Ponto Neutro Grampeado (NPC) [21], [22], o com Ponto
Neutro Grampeado Ativamente (ANPC) [23], o Tipo T [6], [24] e o com
Capacitores Flutuantes [25], [26] . Esses inversores são mostrados na
Figura 2.5.
Os inversores três níveis têm como principais vantagens em re-
lação a um 2L-VSI, o maior número de níveis da tensão de fase, como
mostrado na Figura 2.6, menor geração de tensão de modo comum,
melhor distribuição das perdas entre os semicondutores e o decréscimo
menos acentuado da eficiência com o aumento da frequência de comu-
tação [6], [9]–[11].
Entretanto, esses conversores possuem maior quantidade de se-
micondutores e gate drivers isolados, a necessidade de balanço das ten-
Figura 2.5: Topologias de inversores trifásicos de tensão três níveis: (a) NPC;
(b) ANPC; (c) Capacitor Flutuante; (d) Tipo T.
Figura 2.6: Tensão entre os terminais CA de um inversor trifásico três níveis.
sões nos capacitores, maior quantidade de elementos passivos, e maior

complexidade na geração dos sinais de comando. Todas as desvantagens
apontadas reduzem a robustez desses conversores quando comparados
com as topologias dois níveis.
2.6 Topologia Proposta 13
2.6 Topologia Proposta
O Inversor Trifásico PWM Fonte de Tensão com Integração de

Interruptores Conectados em Delta (∆-VSI), mostrado na Figura 2.7
(a), possui dois grupos de interruptores em estrela e um grupo de inter-
ruptores em delta. Transistores Bipolares com Gatilho Isolado (IGBTs)
em antiparalelo com diodos foram utilizados para representar os inter-
ruptores conectados em estrela , podendo ser substituídos por outros
dispositivos semicondutores dependendo da aplicação do conversor. Da
mesma forma, os interruptores bidirecionais em tensão e em corrente
podem ser implementado de diferentes maneiras, conforme mostrado
na 2.7 (b).
Esse conversor aplica dois níveis de tensão, um positivo e um ne-
Figura 2.7: Inversor trifásico proposto: (a) topologia do conversor; (b) topo-
logia de possíveis interruptores bidirecionais em tensão e em corrente.
gativo entre as fases e o ponto central aos capacitores, sendo, portanto,

um inversor de dois níveis. Por ser um conversor dois níveis, muitas de
suas características são semelhantes as do 2L-VSI, como será visto nos
capítulos posteriores. Como nos inversores multiníveis, a adição dos
interruptores bidirecionais conectados em delta cria estados de comu-
tação redundantes que podem ser utilizados para distribuir esforços de
corrente entre os semicondutores, reduzir perdas por condução e tensão
de modo comum. Desta forma, o conversor proposto possui potencial
para ser otimizado e atingir valores elevados de rendimento e valores
reduzidos de tensão de modo comum.
2.6.1 Geração da Topologia

A topologia do ∆-VSI pode ser concebida de pelo menos quatro
maneiras distintas. A maneira mais intuitiva é adicionando interrup-
tores bidirecionais em tensão e em corrente em uma configuração delta
às fases de um 2L-VSI.
O conversor proposto também pode ser visto como a versão bi-
direcional do Retificador PWM Fonte de Tensão com Integração de
Interruptores Conectados em Delta (∆-VSR)(Figura 2.8(a)) proposto
em [27] e implementado pela primeira vez em [28]. Em [27] também
é proposto um retificador similar, porém os interruptores bidirecionais
são conectados em estrela. Estratégias de modulação foram propostas
Figura 2.8: Derivação do ∆-VSI a partir do: (a) ∆-VSR; (b) HERIC.
2.7 Interruptores Conectados em Delta para Topologias Multiníveis 15
ao longo dos anos para o ∆-VSR [29], [30] e, recentemente, a utilização

desse conversor vem sendo estudada em sistemas eólicos de pequeno
porte [31], [32] e em aplicações aeroespaciais [33]. O ∆-VSR é mais ro-
busto que um 2L-VSI operando no modo retificador, pois não é possível
a realização de um curto circuito no lado CC. Para a implementação
do ∆-VSI a partir do ∆-VSR, os interruptores passivos são trocados
por interruptores ativos, como IGBTs ou MOSFETs.
O ∆-VSI pode também ser interpretado como a versão trifá-
sica do Conceito de Inversor Eficiente e Confiável (HERIC), mostrado
na Figura 2.8(b) [34]. O HERIC difere do tradicional ponte completa
monofásico pela adição do interruptor bidirecional em tensão e em cor-
rente de forma paralela com a carga. O funcionamento deste inversor
é mostrado em [35]–[39] para aplicação em sistemas fotovoltaicos, onde
também são mostradas algumas variações desse conversor.
Tanto o ∆-VSR quanto o HERIC desconectam o lado CC do
conversor do lado CA nas suas respectivas etapas de roda livre. Esse
procedimento reduz a tensão de modo comum produzida pelas comu-
tações dos interruptores além de reduzir a troca de reativos entre os
lados CC e CA durante a aplicação do vetor nulo [40], o que aumenta o
rendimento desses conversores em comparação com o VSI tradicional.
Outra maneira de conceber o ∆-VSI é desfazendo a conexão exis-
tente com o centro dos capacitores do lado CC no circuito do inversor
trifásico do Tipo T (Figura 2.5 (d)) e conectando os interruptores bi-
direcionais em uma configuração delta.
2.7 Interruptores Conectados em Delta para Topologias

Multiníveis
As vantagens conseguidas com a adição dos interruptores em

delta ao 2L-VSI podem também ser obtidas com a implementação do
interruptor bidirecional em corrente e em tensão conectado em delta
às fases de conversores três níveis. Nos conversores NPC e Capacitor
Flutuante mostrados na Figura 2.5 (a) e (c), são necessários a adição
de seis interruptores bidirecionais em corrente (IGBT+Diodo) aos cir-
cuitos originais, conforme mostra a Figura 2.9 (a) e (b). Para realizar
o interruptor bidirecional em tensão em corrente no inversor do Tipo
T, apenas três interruptores precisam ser adicionados ao circuito ori-
ginal da Figura 2.5 (d). Com a substituição de alguns interruptores
bidirecionais por interruptores bidirecionais [41], obtém-se as versões
unidirecionais desses conversores conforme mostrado em Figura 2.10.
Figura 2.9: Novas topologias com interruptores conectados em delta deri-

vadas de conversores três níveis existentes: (a) ∆-NPC; (b) ∆-Capacitor
Flutuante; (c) ∆-Tipo T.
A principal vantagem do interruptor em delta aos conversores

multiníveis é a possibilidade de redução das perdas por condução em
relação às topologias originais.
2.8 Conclusão
Ao longo dos anos, diversas topologias de inversores de tensão

trifásicos de alto desempenho foram propostas como alternativa ao uso
do 2L-VSI convencional. De modo geral, a melhoria do rendimento e
a redução de emissões eletromagnéticas agrega maior complexidade na
operação dos conversores e, consequentemente, diminui a robustez do
sistema. Dependendo da aplicação em que o conversor será empregado,
escolhe-se a topologia mais adequada. Neste capítulo, uma topologia
de inversor trifásico dois níveis de alto desempenho (∆-VSI) que é ca-
paz de reduzir perdas por condução, distribuir melhor os esforços de
2.8 Conclusão 17
Figura 2.10: Novas topologias de retificadores com interruptores conectados

em delta derivadas de conversores três níveis existentes: (a) ∆-NPC; (b)
∆-Capacitor Flutuante; (c) ∆-Tipo T.
corrente entre os semicondutores e reduzir a tensão de modo comum,

em ralação ao 2L-VSI, foi proposta. Entretanto, da mesma forma que
nas topologias da revisão bibliográfica, são acrescidos mais elementos
semicondutores e circuitos de comando ao conversor. Ao longo desta
dissertação serão estudados a operação, a modulação e o controle do
∆-VSI. Outras topologias com interruptores conectados em delta po-
dem ser criadas a partir de topologia três níveis existentes, tais como
inversores e retificadores três níveis.
19
3 OPERAÇÃO E PRINCÍPIOS DE MODULAÇÃO VETO-

RIAL DO ∆-VSI
3.1 Introdução
Para a correta operação e para que se possam extrair as melho-

res características do ∆-VSI, uma análise detalhada dos seus possíveis
estados topológicos foi realizada. Cada estado topológico possui carac-
terísticas particulares e tais estados, quando sequenciados, baseados em
uma estratégia de modulação, podem melhorar a qualidade da energia
processada pelo conversor. Neste capítulo serão apresentados os princí-
pios de operação do conversor, bem como, a definição vetores e algumas
técnicas de comutação entre vetores para uma melhor distribuição de
perdas entre os semicondutores. Será visto que as estratégias de Mo-
dulação Vetorial baseadas nas modulações do 2L-VSI, tanto Contínuas
(SVM) quanto as Descontínuas (DSVM), podem ser implementadas no
∆-VSI.
A análise do funcionamento do conversor será feita baseada nos
conceitos de modulação vetorial. Essa abordagem foi apresentada pela
primeira vez em [42] para um 2L-VSI e, desde então, vêm sendo apri-
morada e sua utilização estendida para outros inversores e retificadores.
Os conceitos básicos de modulação vetorial podem ser encontrados hoje
em vários livros [7], [8], [43] e seu estudo é importante para a otimiza-
ção de algumas características do conversor, como será visto nas seções
posteriores.
3.2 Restrições de Operação do ∆-VSI
Os estados topológicos do ∆-VSI são determinados pela combi-

nação dos possíveis estados de cada interruptor. Para que o conversor
opere adequadamente, alguns estados topológicos do conversor não de-
vem ser utilizados. Esses estados provocam curto-circuito na fonte CC
podendo danificar os componentes do conversor e da fonte, além de
causar instabilidades no controle da energia trocada entre os lados CA
e CC.
As restrições de operação do conversor podem ser escritas em
forma de equação utilizando-se o conceito de função de comutação,
a qual é tipicamente definida como função lógica binária. Este con-
ceito diz que o estado de um interruptor, conduzindo ou bloqueando, é
20 3 Operação e Princípios de Modulação Vetorial do ∆-VSI
determinado pelo valor da sua função de comutação. O conversor, uti-

lizando interruptores ideais no lugar dos IGBTs e diodos, é mostrado
na Figura 3.1. A função de comutação para cada interruptor do ∆-VSI
Figura 3.1: ∆-VSI formado com interruptores ideais bidirecionais em tensão

e em corrente.
pode ser definida por

1 se Sij conduzindo
sij = , (3.1)
0 se Sij bloqueando
onde i ∈ {a, b, c} e j ∈ {a, b, c, p, n} com i 6= j. Para que não haja um

curto-circuito causado na fonte do lado CC causado exclusivamente
pelos interruptores conectados em estrela, a condição
sip + sin ≤ 1, (3.2)
deve ser satisfeita, onde i ∈ {a, b, c}. Para que não haja curto-circuito
no lado CC do conversor causado pelos interruptores conectados em
delta e em estrela, a condição
sip + sjn + sij ≤ 2 (3.3)
deve ser satisfeita, onde i ∈ {a, b, c} e j ∈ {a, b, c} com i 6= j. Todos

os estados topológicos que respeitem as condições descritas por (3.2)
e (3.3) simultaneamente podem ser utilizados na operação normal do
3.3 Análise Vetorial do ∆-VSI 21
conversor.
3.3 Análise Vetorial do ∆-VSI
De acordo com a teoria de modulação vetorial, cada vetor de

tensão está associado a uma combinação de tensões de fase que os
conversores aplicam em sua saída e que, por sua vez, está associado a
um ou mais estados topológicos do conversor. A Tabela 3.1 mostra a
relação que existe entre os vetores e os estados topológicos do conversor,
bem como as tensões de linha e a tensão de modo comum que cada
vetor gera. Os estados topológicos mostrados na Tabela 3.1 garantem
a aplicação dos vetores de tensão de saída independente do sentido das
correntes de fase do conversor.
Os asteriscos mostrados na Tabela 3.1 significam que aquele in-
terruptor não influencia na definição do vetor de tensão, uma vez que
ele já está definido pelos outros interruptores. Se o interruptor com
asterisco é comandado a conduzir, o vetor não é alterado, porém um
caminho alternativo é criado para a corrente, o qual tem o potencial
de reduzir as perdas por condução. Portanto, os estados topológicos
dos vetores ativos em que os interruptores em estrela e em delta são
utilizados simultaneamente para a divisão de corrente serão chamados
estados com Perdas por Condução Reduzidas (RCL).
Os valores dos asteriscos duplos da Tabela 3.1, contidos nos es-
tados topológicos do vetor nulo, definem o valor da tensão de modo
comum aplicada. A função f (saj , sbj , scj ) varia de acordo com os valo-
res de ∗∗ conforme

0 se ∗∗ = 0
f (saj , sbj , scj ) = , (3.4)
Vdc /2 se ∗∗ = 1
onde j = p, n.
As tensões trifásicas de fase que o conversor é capaz de imple-
mentar podem ser representadas em forma de um vetor em um espaço
vetorial, cujos vetores unitários que formam sua base, representam as
fases do conversor. Quando representado dessa forma, é dito que as
tensões do conversor estão em coordenadas abc ou naturais. Em [44]
é proposto representar as grandezas trifásicas em um espaço vetorial
tridimensional αβγ cujos vetores da base são ortogonais. Dentre as
vantagens de utilizar essa representação está a separação da compo-
nente que causa o desbalanço das tensões no eixo γ.
Tabela 3.1: Estados topológicos e tensões CA para o ∆-VSI.
22
Tensões de Linha Comandos
Vetor vcm
vab vbc vca sap sbp scp san sbn scn sab sbc sca
∗∗ ∗∗ ∗∗ 0 0 0 1 1 1 f (sap , sbp , scp )
3 Operação e Princípios de Modulação Vetorial do ∆-VSI

~0 0 0 0 ∗∗ ∗∗ ∗∗ 1 1 1 −f (san , sbn , scn )
V 0 0 0
1 1 1 0 0 0 ∗ ∗ ∗ +Vdc /2
0 0 0 1 1 1 ∗ ∗ ∗ −Vdc /2
1 0 0 0 1 1 0 ∗ 0
~1
V +Vdc 0 −Vdc 1 0 0 0 1 ∗ 0 1 0 −Vdc /6
1 0 0 0 ∗ 1 0 1 0
1 1 0 0 0 1 ∗ 0 0
~2
V 0 +Vdc −Vdc 1 ∗ 0 0 0 1 1 0 0 +Vdc /6
∗ 1 0 0 0 1 1 0 0
0 1 0 1 0 1 0 0 ∗
~3
V −Vdc +Vdc 0 0 1 0 1 0 ∗ 0 0 1 −Vdc /6
0 1 0 ∗ 0 1 0 0 1
0 1 1 1 0 0 0 ∗ 0
~4
V −Vdc 0 +Vdc 0 1 ∗ 1 0 0 0 1 0 +Vdc /6
0 ∗ 1 1 0 0 0 1 0
0 0 1 1 1 0 ∗ 0 0
~5
V 0 −Vdc +Vdc 0 0 1 1 ∗ 0 1 0 0 +Vdc /6
0 0 1 ∗ 1 0 1 0 0
1 0 1 0 1 0 0 0 ∗
~6
V +Vdc −Vdc 0 1 0 ∗ 0 1 0 0 0 1 −Vdc /6
∗ 0 1 0 1 0 0 0 1
3.3 Análise Vetorial do ∆-VSI 23
A representação das tensões trifásicas em coordenadas αβγ pode

ser obtida a partir da representação em coordenadas abc utilizando a
transformação de base denominada transformada de Clarke [44]
 1 1 
1 − −
√2 √2
   
vα  va

2 
3 3
 vβ  =   vb  . (3.5)

3 0
 −
vγ 2 2  vc

1 1 1

2 2 2
Como a componente γ é localizada na direção perpendicular ao
plano αβ e o sistema considerado é conectado a três fios, ela pode ser
desconsiderada e a transformada de Clarke se torna
 1 1    1 
1 − va 1
vα 2 2 vab
=  √2 √2   vb  =  √2  .
vβ 3 3 3 3 3
 vbc
0 − vc 0
2 2 2
(3.6)
Assim como o 2L-VSI, o ∆-VSI é capaz de sintetizar seis veto-
res espaciais de tensão no plano αβ. O mapa de vetores do ∆-VSI é
mostrado na Figura 3.2. Utilizando o resultado da expressão (3.6) e
a Tabela 3.1 para obter os valores das tensões de linha que o inversor
aplica em seus terminais CA, é possível determinar os valores dos ve-
tores de tensão em coordenadas estacionárias αβ. As coordenadas do
vetor V~1 são dadas por
 1 
1
vα 2 Vdc
= √2  . (3.7)
vβ 3 3 0
 
~1
V 0
2
Em coordenadas polares o vetor V

~1 pode ser representado por
~1 = 2 Vdc + j0 = 2 Vdc = 2 Vdc ej0 .

V (3.8)
3 3 3
As coordenadas do vetor V
~2 são dadas por
Figura 3.2: Mapa de vetores espaciais do ∆-VSI.
1 

1
vα 2 2  0
=  √ (3.9)
vβ V~ 3 3
 V
dc
2 0
2
e sua representação por em coordenadas polares é dada por
√
~2 = 1 Vdc + j 3 Vdc = 2 Vdc ej π3 .
V (3.10)
3 3 3
Realizando o mesmo procedimento para os demais vetores chega-
se na generalização
(
0 , para k = 0
V~k = 2 j(k−1)π/3 . (3.11)
Vdc e , para k ∈ {1, 2, .., 6}
3
Apesar do mapa de vetores ser o mesmo do 2L-VSI, a quantidade
de estados redundantes para cada vetor é aumentado como pode ser
visto na Figura 3.3. Ao todo são acrescidos dois estados redundantes
para os vetores ativos e um para o vetor nulo 1 . Na seção seguinte é
1 Não foram contabiilzados na figura os estados com RCL
3.4 Estados Topológicos do ∆-VSI 25
Figura 3.3: Mapa de vetores destacando a quantidade de estados redundantes

para cada vetor do: (a) ∆-VSI; (b) 2L-VSI.
feita uma análise qualitativa das características dos estados topológicos

do ∆-VSI.
3.4 Estados Topológicos do ∆-VSI
Os estados topológicos do ∆-VSI, contidos na Tabela 3.1, foram

classificados de acordo com a localização dos interruptores comandados
a conduzir. Para determinar o caminho das correntes no conversor, foi
considerada a condição de corrente descrita por ia > ib > 0, ic < 0 e
|ic | > |ia | > |ib |.
Os vetores ativos, quando formados pelos estados topológicos que
utilizam apenas os interruptores conectados em estrela foram denomi-
nados V ~i,VSI , onde i ∈ {1, 2...6}. Esses estados topológicos, mostrados
na Figura 3.4, são idênticos aos do 2L-VSI e, como será visto adiante,
podem ser utilizados durante os momentos em que ocorrem as comuta-
ções dissipativas do conversor para concentrar as perdas por comutação
nos interruptores em estrela.
Já os vetores ativos, quando formados pelos estados que utilizam
um interruptor conectado em delta e dois conectados em estrela, são
denominados de V ~i,SDj , onde i ∈ {1, 2...6} e j ∈ {1, 2}. Esses estados,
como os estados formados pelos interruptores em estrela, serão utiliza-
dos nos instantes que devem ocorrer as trocas de vetores, agora, para
concentrar as perdas por comutação nos interruptores em delta. De-

pendendo da região em que o vetor de referência encontra-se no plano
αβ, utiliza-se os vetores V
~i,SD1 ou V~i,SD2 . Neste trabalho o plano αβ
foi dividido em seis sextantes conforme mostrado na Figura 3.2. As
Figuras 3.5 e 3.6 mostram os vetores V ~i,SDj descritos anteriormente.
Por fim, quando os vetores ativos são formados utilizando-se três
interruptores conectados em estrela e um interruptor conectado em
delta, eles são denominados de V~i,RCL , onde i ∈ {1, 2...6}, pois reduzem
potencialmente as perdas por condução do conversor. Esses estados
topológicos foram reunidos na Figura 3.7.
Para uma máxima redução das perdas por condução, é recomen-
dado que os vetores com RCL sejam utilizados na maior parte do tempo
de aplicação do vetor. A Figura 3.8 (a) mostra um dos estados topo-
lógicos do vetor V~1 com RCL. Definido o sentido das correntes como
os mostrados na Figura 3.8 e substituindo os semicondutores por seus
respectivos modelos para condução, pode-se chegar no modelo equiva-
lente para distribuição de corrente da Figura 3.8 (b). Neste caso, foi
utilizado um modelo elétrico simplificado linear por partes para repre-
sentar os semicondutores. No modelo adotado, os IGBTs e os diodos
são representados por uma fonte de tensão em série com uma resistên-
cia. Se o mesmo é feito para um 2L-VSI o modelo equivalente obtido é
o mesmo da Figura 3.8 (c). Equacionando o circuito da Figura 3.8 (c)
para a tensão V21 obtém-se
V21 = VDbn + VScn + RDbn ib + RScn ic . (3.12)

0
A tensão V21 do circuito equivalente do ∆-VSI é dada por
0 RSbc V21 (RDbn + RScn ) VSbc

V21 = + . (3.13)
RDbn + RScn + RSbc RDbn + RScn + RSbc
Como a corrente no interruptor Sap é definida pela corrente ia para os
dois conversores, a condição para que se obtenha menores perdas por
condução no ∆-VSI durante o vetor ativo V1 em relação ao 2L-VSI é
definida por 0
V21 < V21 . (3.14)
Substituindo as (3.12) e (3.13) em (3.14) obtém-se
VSbc < VDbn + VScn + RDbn ib + RScn ic . (3.15)

Figura 3.4: Estados topológicos dos vetores ativos do ∆-VSI que utilizam
apenas os interruptores conectados em estrela.
Figura 3.5: Estados topológicos dos vetores ativos do ∆-VSI utilizando a

técnica SD1 e SD2.

técnica SD1 e SD2 (Continuação).

técnica RCL.
Figura 3.8: Representações topológicas do vetor V ~1 para o ∆-VSI e para o

2L-VSI: (a) Estado topológico do vetor V~1 utilizando a técnica RCL para o
∆-VSI ; (b) Circuito equivalente para condução do circuito do item (a); (c)
Circuito equivalente para condução do vetor V~1 para o 2L-VSI.
A condição mostrada em (3.15) é geralmente satisfeita quando se

utiliza componentes com maior capacidade de corrente para a formação
dos interruptores bidirecionais em delta, comparados aos interruptores
utilizados para a formação dos interruptores conectados em estrela.
A mesma análise pode ser realizada considerando que serão utili-

zados transistores MOSFETs no lugar dos IGBTs conectados em estrela
e que serão utilizados MOSFETs em antiparalelo para realizar os inter-
ruptores bidirecionais em tensão e em corrente. Considerando também
que a retificação síncrona dos MOSFETs é realizada, as equações 3.12
e 3.13 podem ser reescritas com as tensões de polarização nulas e com
as resistências de condução dos diodos igual as resistências de condu-
ção dos MOSFETs. Realizando o teste de (3.14), é possível novamente
encontrar a condição que leva à menores perdas por condução
RSbc < RSbn + RScn + RSbc . (3.16)
A condição descrita em 3.16 é sempre satisfeita independente do

valor de resistência dos MOSFETs conectados em delta, uma vez que a
resistência equivalente vista pelos terminais a e b são sempre menores
para o ∆-VSI.
Os estados topológicos que aplicam na saída o vetor nulo de
tensão são mostrados na Figura 3.9. O vetor nulo pode ser aplicado
utilizando apenas os interruptores conectados em estrela, mostrado na
Figura 3.9 (a), utilizando os interruptores em delta juntamente com os
interruptores conectados em estrela, mostrado na Figura 3.9 (b) 2 ou
com apenas os interruptores conectados em delta, conforme a Figura 3.9
(c).
O vetor nulo aplicado apenas com os interruptores em delta pos-
sui tensão de modo comum indeterminada e seu valor depende apenas
dos elementos parasitas do circuito podendo ser considerada nula [32].
Já o vetor nulo aplicado utilizando-se os interruptores conectados em es-
trela juntamente com os interruptores conectados em delta, provê uma
melhor distribuição de corrente entre os interruptores, porém aplica
uma tensão de modo comum com módulo igual a Vdc /2.
3.5 Modulação Vetorial do ∆-VSI
A modulação vetorial do conversor é baseada nos mesmos princí-

pios da modulação vetorial de um 2L-VSI. Nesta abordagem, as tensões
que se deseja aplicar na saída do conversor são representadas por um
vetor de referência. Esse vetor de referência, assumindo-se que o con-
2 Não
necessariamente todos os interruptores conectados em delta devem estar
acionados.
3.5 Modulação Vetorial do ∆-VSI 33
Figura 3.9: Estados topológicos do vetor nulo: (a) V

~0,RCL1 ; (b)V
~0,RCL2 ; (c)
~0,RCMV .
V
versor opera em alta frequência, pode ser considerado constante dentro

de um período de comutação. Baseando-se então no princípio do ba-
lanço “volt-segundo” que diz que o produto da tensão de referência com
o período de comutação é igual à soma das tensões dos vetores espaci-
ais multiplicados pelos respectivos intervalos de tempo de aplicação do
vetor.
3.5.1 Cálculo dos Tempos de Aplicação dos Vetores

O balanço “volt-segundo”, pode ser feito utilizando qualquer um
dos estados contidos na Tabela 3.1. Entretanto, para que os interrup-
tores de um mesmo braço sejam comandados a conduzir e a bloquear
apenas uma vez dentro de um período de comutação, apenas os vetores
mais próximos do vetor de referência são utilizados. Quando o vetor
de referência está localizado dentro do primeiro sextante, o “balanço
volt-segundo” é realizado com os vetores V~1 , V
~2 e V~0 , como mostra a
Figura 3.10 e representado em seguida na forma de equação (3.17).
Figura 3.10: Formação do vetor de referência a partir dos vetores do conversor

utilizando o balanço "volt-segundo".
~ ∗ Ts = V
V ~1 T1 + V
~2 T2 + V
~0 Tnull . (3.17)
Em (3.17) T1 , T2 , Tnull são os tempos de aplicação dos vetores V

~1 , V
~2
e V0 respectivamente, Ts é o período de comutação e V é o vetor de
~ ~ ∗
referência. Definindo o vetor de referência como

~ ∗ = V̂ ejθv∗ = vα∗ + jvβ∗
V (3.18)
e considerando que
Ts = T1 + T2 + Tnull , (3.19)
é possível encontrar os tempos de aplicação dos vetores dentro de cada
sextante do mapa de vetores. Tomando o primeiro sextante como exem-
plo, os vetores V~1 , V~2 , V
~0 são substituídos pelos seus respectivos valores
em coordenadas polares, obtidos em (3.11), em (3.17)

V̂ cos(θv∗ ) + j V̂ sen(θv∗ ) TS =

2

1 √
(3.20)
= Vdc + j0 T1 + Vdc + j 3Vdc T2 + 0Tnull .
3 3
Igualando as partes reais e imaginárias em (3.20) e utilizando (3.19)

encontra-se o sistema

3TS V̂
2T1 + T2 = cos(θv∗ )


Vdc


 √
3TS V̂ (3.21)
 T2 =
 sen(θv∗ )


 Vdc
Tnull = TS − T1 − T2
que, quando resolvido, resulta nos tempos de aplicação dos vetores no

primeiro sextante do mapa de vetores
 √
 T1 = 3Ts V̂ sen π − θv0


Vdc 3



 √
3Ts V̂ 0
, (3.22)
 T 2 = sen θ v
V

dc




Tnull = 1 − T1 − T2
0
onde θv é o ângulo atual do vetor de referência referenciado ao primeiro
0
sextante. Isso significa que sempre 0 ≤ θv ≤ π/3 e o seu valor é
calculado por 0
θv = θv∗ − (k − 1) π/3, (3.23)
onde k ∈ {1, 2...6} é o sextante que se encontra o vetor de referência.

Normalizando os tempos em relação ao período de comutação obtém-se
 √
3V̂ π 0

d = sen − θ

1
 v
Vdc 3



 √
3V̂ 0
. (3.24)
 d2 = sen θv
Vdc





dnull = 1 − d1 − d2
A Equação (3.24) é importante para a realização da modulação
vetorial e para as análises subsequentes de perdas e ondulação de cor-
rente. O resultado da equação (3.24) é mostrado na Figura 3.11 para
ângulos do vetor de tensão variando de 0 a π.
Os tempos de aplicação dos vetores normalizados podem ainda
ser escritos em função das funções de modulação d∗α e d∗β de referência
conforme mostrado na Tabela 3.2. Essa representação pode ser mais
adequada quando o controle do conversor é feito no eixo de coordenadas
estacionárias αβ.
Figura 3.11: Funções de razão cíclica para os tempos de aplicação dos vetores
para V̂ = 537,4 V e Vdc = 760 V.
3.5.2 Restrições para o Vetor de Referência

Na maioria das aplicações com inversores trifásicos fonte de ten-
são, deseja-se que as correntes nos terminais CA do conversor tenham
um aspecto senoidal com um conteúdo de alta frequência. Para que isso
seja possível, o conversor deve impor tensões em seus terminais cujos

valores médios em um período de comutação sejam senoidais.
Tensões trifásicas senoidais defasadas entre si de 120◦ e equili-
bradas resultam em uma circunferência no plano de coordenadas αβ,
como pode ser visto na Figura 3.2. Caso o raio da trajetória do vetor
de referência ultrapasse o raio da maior circunferência inscrita no he-
xágono formado pelas extremidades dos vetores de tensão do inversor,
as correntes serão distorcidas e apresentarão conteúdo harmônico de
baixa frequência. Isso acontece devido ao inversor de tensão trifásico
dois níveis só conseguir sintetizar em sua saída vetores que estejam com-
preendidos dentro do hexágono. O valor de V ~max
∗
pode ser calculado
usando o Teorema de Pitágoras na Figura 3.2
~∗ = V
V √dc . (3.25)
max
3
A região em que o conversor não consegue mais gerar tensões
senoidais é chamada de região de sobremodulação.
Tabela 3.2: Funções de razão cíclica dos tempos de aplicação dos vetores
escritas em função das coordenadas d∗α e d∗β do vetor de referência.
Funções de Razão Cíclica

Sextante 0 0
d1 d2
√ ∗

3 ∗ 1 ∗
SI dα − √ dβ 3dβ
2 3

3 1 3 1
SII d∗α + √ d∗β −d∗α + √ d∗β
2 3 2 3
√ ∗

3 1
SIII 3dβ − d∗α + √ d∗β
2 3
√

3 1
SIV −d∗α + √ d∗β − 3d∗β
2 3

3 ∗ 1 ∗ 3 ∗ 1 ∗
SV − dα + √ dβ dα − √ dβ
2 3 2 3
√ ∗

3 ∗ 1 ∗
SVI − 3dβ dα + √ dβ
2 3
3.5.3 Sequência de Vetores
A quantidade de vetores, a quantidade de troca entre vetores e a

sequência em que eles são aplicados dentro de um período de comutação
define a estratégia de modulação vetorial. As estratégias de modulação
vetorial mais utilizadas nos 2L-VSIs usam três vetores para realizar o
balanço "volt-segundo", trocam seis ou quatro vezes de vetor dentro
de um período de comutação e são simétricas dentro de um quarto do
período de comutação. As estratégias de modulação que trocam de
vetores seis vezes dentro de um período de comutação são divididas em
sete segmentos e as que trocam de vetor quatro vezes são divididas em
cinco segmentos.
Dentre as modulações de sete segmentos, a modulação SVM é a
mais utilizada, pois ela minimiza a quantidade de comutações em um
período de comutação. Já entre as modulações de cinco segmentos, a
DSVM é a mais utilizada, pois ela reduz significativamente as perdas
por comutação do conversor [8]. Para isso, as modulações descontínuas
deixam de comutar os interruptores que estão conduzindo a corrente
de fase de maior valor.
Para o ∆-VSI as modulações SVM e DSVM podem ser imple-
mentadas de duas maneiras distintas, dependendo da característica do
conversor que se deseja otimizar. Como foi visto anteriormente, o vetor
nulo do ∆-VSI pode ser aplicado com estados topológicos redundantes
quando se analisa a tensão de linha de saída, porém, com características
diferentes em relação a tensão de modo comum e esforços de corrente.
A Figura 3.12 (a) mostra o padrão de pulsos das estratégias de mo-
dulação SVM e DSVM quando se emprega o vetor nulo mostrado na
Figura 3.9 (a) e a Figura 3.12 (b) quando se emprega o vetor nulo da
Figura 3.9 (b) para um período de comutação no primeiro sextante.
Analisando a Figura 3.12, observa-se que os padrões de pulsos
das estratégias de modulação que aplicam o vetor nulo acionando os
interruptores em delta e os interruptores em estrela ao mesmo tempo
apresentam duas comutações a menos em relação às modulações que
aplicam o vetor nulo apenas com os interruptores em delta. Devido
a essa característica e a característica de reduzir os esforços de cor-
rente nos interruptores, as estratégias de modulação da Figura 3.12 (a)
apresentam Reduzidas Perdas (RL) em relação às estratégias da Figura
3.12 (b). Por outro lado, os padrões de pulsos que aplicam o vetor nulo
acionando apenas os interruptores conectados em delta apresentam Re-
Figura 3.12: Padrão de pulsos para as estratégias de modulação SVM e

DSVM com: (a) RL; (b) RCMV.
duzido Valor Eficaz da Tensão de Modo Comum (RCMV) em relação

às estratégias com RL. Tanto nas estratégias com RL quanto nas estra-
tégias com RCMV, os interruptores conectados em delta operam com
o dobro da frequência dos interruptores conectados em estrela.
Para a implementação da modulação SVM com eliminação das
harmônicas pares e com RL, são utilizadas as sequências de aplicação

dos vetores contidas na Tabela 3.3. Os intervalos onde as sequências a
e b devem ser utilizadas são mostrados na Figura 3.13
Figura 3.13: Mapa de vetores espaciais do ∆-VSI dividido em setores e em

subsetores.
Para gerar o padrão de pulsos da modulação SVM com RCMV

basta substituir (3.26) na Tabela 3.3
→
− →
− →
−
V 0,RCL1 = V 0,RCL2 = V 0,RCMV . (3.26)
O padrão de pulsos para as modulações descontínuas com RL
pode ser gerado a partir da Tabela 3.4. Se apenas os estados da
sequência a ou b forem utilizados, as modulações descontínuas apre-
sentam esforços desiguais entre os interruptores conectados em estrela.
Da mesma forma que para a SVM, o padrão de pulsos da DSVM com
RCMV pode ser gerado a partir da Tabela 3.4 realizando a substituição
contida em 3.26. A Figura 3.14 mostra os pulsos gerados pela modula-
ção SVM(a) para os seis sextantes do mapa de vetores.
3.6 Escolha dos Estados Redundantes e dos Semicondutores
A escolha dos estados redundantes deve ser feita juntamente com

a tecnologia dos semicondutores. A topologia proposta apresenta no-
Tabela 3.3: Sequência de vetores utilizada na SVM com eliminação de harmô-

nicas pares.
Sextante Sequência de Vetores

SI,a ~0,RCL1
V ~1
V V~2 V~0,RCL2 V ~2 ~1
V ~0,RCL1
V
SI,b ~0,RCL2
V ~2
V ~ ~
V1 V0,RCL1 V ~1 ~2
V ~0,RCL2
V
SII,a ~0,RCL2
V ~2
V V~3 V~0,RCL1 V ~3 ~2
V ~0,RCL2
V
SII,b ~0,RCL1
V ~3
V V~2 V~0,RCL2 V ~2 ~3
V ~0,RCL1
V
SIII,a ~0,RCL1
V ~3
V ~ ~
V4 V0,RCL2 V ~4 ~3
V ~0,RCL1
V
SIII,b ~0,RCL2
V ~4
V V~3 V~0,RCL1 V ~3 ~4
V ~0,RCL2
V
SIV,a ~0,RCL2
V ~4
V V~5 V~0,RCL1 V ~5 ~4
V ~0,RCL2
V
SIV,b ~0,RCL1
V ~5
V ~ ~
V4 V0,RCL2 V ~4 ~5
V ~0,RCL1
V
SV,a ~0,RCL1
V ~5
V V~6 V~0,RCL2 V ~6 ~5
V ~0,RCL1
V
SV,b ~0,RCL2
V ~6
V ~ ~
V5 V0,RCL1 V ~5 ~6
V ~0,RCL2
V
SVI,a ~0,RCL2
V ~6
V V~1 V~0,RCL1 V ~1 ~6
V ~0,RCL2
V
SVI,b ~0,RCL1
V ~1
V V~6 V~0,RCL2 V ~6 ~1
V ~0,RCL1
V
vos estados redundantes e possibilita a combinação desses estados para

realizar uma melhor distribuição de perdas entre os semicondutores.
Dessa forma, é possível utilizar mais de um estado para um mesmo
vetor dentro de um mesmo período de comutação de modo a otimi-
zar a eficiência do conversor. A seguir serão apresentadas estratégias
de utilização dos estados de comutação, visando concentrar as perdas
por comutação em dispositivos específicos com melhores características
dinâmicas.
3.6.1 Interruptores com Reduzidas Perdas por Condução

Conectados em Delta
Como foi visto na Seção 3.2, se os interruptores bidirecionais
conectados em delta apresentam maior capacidade de corrente que a
soma das capacidades de corrente que os interruptores e os diodos co-
nectados em estrela, há uma maior redução nas perdas de condução do
conversor. Entretanto, interruptores com maior capacidade de corrente
geralmente apresentam maiores perdas por comutação e, dependendo
da frequência de comutação do conversor, os ganhos de eficiência podem
Tabela 3.4: Sequência de vetores utilizada na DSVM com divisão dos esforços
entre os semicondutores.
Sextante Sequência de Vetores
SI,a ~1
V V~2 V~0,RCL1 V ~2 ~1
V
SI,b ~0,RCL2
V V~1 ~2
V ~1
V ~0,RCL2
V
SII,a ~3
V V~2 V~0,RCL1 V ~2 ~3
V
SII,b ~
V0,RCL2 ~
V3 ~
V2 ~3
V ~
V0,RCL2
SIII,a ~3
V V~4 V~0,RCL1 V ~4 ~3
V
SIII,b ~
V0,RCL2 ~
V3 ~
V4 ~3
V ~
V0,RCL2
SIV,a ~5
V V~4 V~0,RCL1 V ~4 ~5
V
SIV,b ~0,RCL2
V V~5 ~4
V ~5
V ~0,RCL2
V
SV,a ~5
V ~ ~
V6 V0,RCL1 V ~6 ~5
V
SV,b ~0,RCL2
V V~5 ~6
V ~5
V ~0,RCL2
V
SVI,a ~1
V V~6 V~0,RCL1 V ~6 ~1
V
SVI,b ~
V0,RCL2 ~
V1 ~
V6 ~1
V ~
V0,RCL2
ser anulados.
Para reduzir as perdas por condução sem aumentar as perdas
por comutação, é possível aplicar os vetores utilizando os interruptores
conectados em estrela e em delta ao mesmo tempo, mas, momentos an-
tes de ocorrer a mudança de vetor, os interruptores em delta devem ser
comandados a bloquear. O vetor continua sendo sintetizado pelos inter-
ruptores em estrela. A comutação dos interruptores em delta ocorre de
forma não dissipativa, uma vez que a tensão sobre o interruptor é nula.
Para que a entrada em condução dos interruptores em delta também
ocorra de forma não dissipativa, ela deve ocorrer momentos depois do
vetor ter sido definido pelos interruptores em estrela.
A Figura 3.15 (a) mostra o detalhe da comutação entre os vetores
V1 e V2 dentro do primeiro sextante do mapa de vetores. Esse proce-
~ ~
dimento adiciona na sequência de vetores dois estados intermediários
para cada transição de vetor, o que resulta em um acréscimo de seis
estados para uma modulação de cinco segmentos ou oito estados para
uma modulação de sete segmentos dentro de um período de comutação.
Na Figura 3.15 o vetor nulo com RCL foi diferenciado com “ ∗ ∗” por
Figura 3.14: Padrão de pulsos da SVM para a sequência a da Tabela 3.3.
apenas um interruptor conectado em delta estar acionado.
3.6.2 Interruptores com Reduzidas Perdas por Condução

Conectados em Estrela
Uma outra alternativa para reduzir as perdas por condução sem
aumentar as perdas por comutação em relação a um 2L-VSI é utilizar
interruptores lentos, com alta capacidade de corrente, conectados em
estrela e comutar entres os vetores apenas os interruptores conectados
em delta, que teriam a característica de baixas perdas por comuta-
ção. Para que isso seja possível, os interruptores conectados em estrela
devem entrar em condução depois dos interruptores em delta e blo-
quear antes dos interruptores conectados em delta. Realizando esse
procedimento, as perdas por comutação se concentrariam nos interrup-
tores em delta e os esforços de corrente seriam distribuídos em todos

os semicondutores do conversor. A Figura 3.15 (b) mostra a ordem das
comutações dentro de um quarto do primeiro sextante para um período
de comutação, caso a estratégia descrita seja empregada.
Figura 3.15: Escolha dos estados redundantes para concentrar as perdas por
comutação nos interruptores conectados: (a) em estrela; (b) em delta.
3.6.3 Seleção dos Semicondutores

No ∆-VSI todos os semicondutores são submetidos à tensão do
barramento CC. Para aplicações onde são exigidas tensões no lado CA
saída acima de 600 V, é recomendado o uso de dispositivos capazes
de bloquear tensões acima de 1.200 V. Em aplicações nessa faixa de
tensão e que processam uma potência superior a 10 kW, os IGBTs são
geralmente os dispositivos com menor custo e que possuem melhores
características de comutação e condução. Esses componentes podem
formar tanto os interruptores em estrela quanto os interruptores em
delta. Uma alternativa interessante para a formação dos interruptores
bidirecionais em delta são os IGBTs com Capacidade de Bloqueio de
Tensão Reversa (RB-IGBTs) [45]. O circuito elétrico equivalente desse
semicondutor consiste em um IGBT convencional em série com um
diodo. Ele é fabricado a partir de um IGBT de tecnologia NPT 3
3 Em
inglês significa non punch through . Esses IGBTs são construidos sem uma
camada n+ de buffer.
com a adição de uma camada p+ fortemente dopada em seu perímetro

para aumentar a capacidade de bloqueio de tensão reversa [45]–[47].
Devido a aspectos construtivos, o RB-IGBT apresenta perdas reduzidas
por condução, menor que a soma das perdas de um diodo com a de
um IGBT [48]. Entretanto, a longa corrente de calda e a recuperação
reversa de seu diodo intrínseco provocam perdas relativamente elevadas
por comutação.
A Figura 3.16 mostra um resultado experimental do detalhe da
comutação no interruptor Sca . É possível verificar que o interruptor
comuta sobre tensão nula uma vez que vca = 0 durante a comutação.
Entretanto também verifica-se na Figura 3.16 a elevada corrente de
recuperação reversa do RB-IGBT. Estudos foram feitos em [47] para
verificar a melhor forma de comutar esses dispositivos.A forma de onda
da corrente no interruptor Sca foi obtida com uma Bobina de Rogowski
e portanto está deslocada de um nível CC.
Figura 3.16: Detalhe da comutação do interruptor Sca conectado em delta

implementado com RB-IGBTs.
Diversos conversores já foram construídos com RB-IGBTs desde

a sua criação em 2001. Entre eles estão os conversores matriciais [47]
e retificadores de corrente [46]. Recentemente a empresa fabricante de
semicondutores Fuji-Electric lançou módulos contendo um braço para
a implementação de inversores Tipo T [48]–[50], conforme mostra a
Figura 3.17.
Esse módulo é composto de IGBTs de 1.200 V, formando os
interruptores unidirecionais em tensão, e de RB-IGBTs de 600 V em
Figura 3.17: Esquemático do módulo da Fuji para inversores Tipo-T.
antiparalelo, formando os interruptores bidirecionais em tensão. Um

módulo semelhante em que a tensão de bloqueio dos interruptores sejam
iguais poderia ser utilizado para a implementação do ∆-VSI.
Outra alternativa para a formação do ∆-VSI nas aplicações em
questão, são os MOSFETs de carbeto de silício. Existem hoje no mer-
cado componentes discretos de tensão de 1.200 V com baixas perdas
em condução. Esses componentes têm como características importan-
tes baixas perdas por comutação, pois a recuperação reversa de seus
diodos é quase inexistente e a capacidade de operar em mais altas tem-
peraturas quando comparados com IGBTs convencionais [51], [52].
3.7 Conclusão
A análise vetorial dos inversores fonte de tensão permite que

as potencialidades do conversor possam ser visualizadas. A partir da
seleção adequada dos vetores e da ordem que eles são aplicados, caracte-
rísticas podem ser otimizadas através de uma estratégia de modulação
adequada. O ∆-VSI possui a mesma quantidade de vetores espaciais
que um 2L-VSI, porém apresenta estados redundantes para cada vetor.
Esses estados podem ser utilizados pelo conversor para reduzir as per-
das por condução sem aumentar as perdas por comutação, ou reduzir
o valor eficaz da tensão de modo comum, gerada pelas comutações, em
relação ao 2L-VSI. A divisão dos esforços de corrente em mais semi-
condutores permite que a área de material semicondutor seja otimizada
e, como consequência disto, o conversor tenha seu custo de produção
reduzido e/ou seu rendimento e/ou níveis de emissão eletromagnética
melhorados.
47
4 MODULAÇÃO PWM BASEADA EM PORTADORAS
4.1 Introdução
Como foi visto no Capítulo 3, a modulação vetorial fornece ao

projetista total liberdade para escolher os vetores e definir o tempo
e a sequência em que eles são aplicados. Entretanto, devido ao cál-
culo dos tempos de aplicação dos vetores e as máquinas de estado,
que definem os estados topológicos do conversor, serem realizados via
software, a SVM requer microprocessadores com elevada capacidade de
processamento. Uma alternativa à modulação vetorial é a utilização
de técnicas de Modulação PWM Baseada em Portadoras (CBPWM)
que sejam equivalentes às técnicas SVM. Na CBPWM a implementa-
ção dos pulsos dos interruptores é realizada via hardware através da
comparação das funções de razão cíclica dos interruptores com uma
portadora, conforme mostrado na Figura 4.1. Devido à sua simplici-
dade, o modulador e os sinais de referência da Figura 4.1 (a) podem
ser implementados sem muitas dificuldades, com circuitos analógicos,
microprocessadores de baixo custo [8] e com periféricos dedicados em
microprocessadores projetados para eletrônica de potência.
Figura 4.1: Esquema para a geração dos pulsos do ∆-VSI: (a) Hardware do
modulador; (b) Sinais.
A CBPWM por um lado reduz a complexidade da programação

e o esforço computacional, mas por outro limita a alocação de vetores
dentro de um período de comutação. Neste capítulo será mostrado o
procedimento para a geração dos sinais de comando para o ∆-VSI para
diferentes estratégias de modulação.
48 4 Modulação PWM Baseada em Portadoras
4.2 Modelo Médio do ∆-VSI
O desenvolvimento do modelo do conversor baseado em variá-

veis quase instantâneas pode ser utilizado para realizar a equivalência
entre a modulação vetorial e a modulação vetorial baseada em porta-
doras. Além disso, este modelo também pode ser útil para desenvolver
o modelo orientado ao controle do conversor juntamente com o filtro do
lado CA. Para analisar apenas as tensões e correntes médias geradas
nos terminais do conversor, é possível simplificar o circuito da Figura
3.1 para o circuito da Figura 4.2. Esse circuito é o mesmo derivado
para um 2L-VSI convencional [53], [54].
Figura 4.2: Circuito equivalente do ∆-VSI com interruptores três portas que
representa as tensões de linha aplicadas nos terminais CA.
Nessa simplificação foi considerado que os interruptores em delta

são utilizados apenas para dividir os esforços de correntes sendo os veto-
res determinados apenas pelas transições dos interruptores em estrela.
Portanto, os interruptores do mesmo braço operam de forma comple-
mentar e a expressão
si = sip = 1 − sin (4.1)
é válida, onde i ∈ {a, b, c}. No circuito da Figura 4.2, as tensões nos
terminais AC do conversor são expressas por
vi = si Vdc . (4.2)
Utilizando o conceito de Valor Médio Quase Instantâneo (VMQI) [55],

é possível encontrar o valor médio das funções de comutação em um
4.2 Modelo Médio do ∆-VSI 49
período de comutação conforme mostra

Z t
Vdc t
Z
1
hvi iTs = vi (t)dt = si (t)dt =
Ts t−Ts Ts t−Ts
(4.3)
Vdc di Ts
Z
= 1dt = di Vdc ,
Ts 0
onde di é denominado função de razão cíclica de fase com i ∈ {a, b, c}. É

possível também encontrar o valor médio quase instantâneo das tensões
de fase em função das funções de modulação, que estão referenciadas ao
ponto n da Figura 4.2 e podem apresentar valores positivos e negativos
mi Vdc
hvi iTs = . (4.4)
2
Os valores médios quase instantâneos das tensões de linha podem
ser representados pelas funções de razão cíclica conforme
hvij iTs = Vdc (di − dj ) = Vdc dij , (4.5)
onde i ∈ {a, b, c}, j ∈ {a, b, c} com i 6= j. Realizando a lei dos nós

no circuito da Figura 4.2, é possível encontrar o modelo comutado da
corrente drenada ou entregue ao lado CC do conversor
idc = sa ia + sb ib + sc ic . (4.6)
Aplicando o conceito de VMQI em (4.6) é possível escrever o

VMQI da corrente que atravessa o link CC do conversor por
hidc i = da hia i + db hib i + dc hic i . (4.7)
O modelo do conversor em variáveis quase instantâneas, ou mo-

delo médio do conversor, pode ser sintetizado pela Figura 4.3. O mo-
delo gerado mostra que as funções de razão cíclica podem controlar a
corrente no link CC, bem como, as tensões de linha do ∆-VSI.
As funções de razão cíclica dos interruptores em estrela supe-
riores (dSip , com i = a, b, c) são geradas a partir das referências das
componentes fundamentais das tensões trifásicas que deseja-se obter
Figura 4.3: Modelo médio do ∆-VSI.
na saída do inversor, como mostra
va∗ = V̂f 1 cos

(ωt)
2π
vb∗= V̂f 1 cos ωt − (4.8)
3
∗ 2π
vc = V̂f 1 cos ωt + ,
3
onde V̂f 1 é o valor de pico da componente fundamental das tensões de

fase do conversor. Normalizando as referências trifásicas em relação à
metade da tensão do barramento e escrevendo-as em função do Índice
de Modulação (M), obtém-se
2
m∗a = √ M cos (ωt)
3
∗ 2 2π
mb = √ M cos ωt − (4.9)
3 3
∗ 2 2π
mc = √ M cos ωt + ,
3 3
onde √
3V̂f 1
M= . (4.10)
Vdc
O índice de modulação é um parâmetro importante para medir o
aproveitamento da tensão do barramento CC para geração das tensões
de fase do inversor. Para que o conversor opere fora da região de sobre-
modulação, esse índice de modulação deve ser no máximo unitário inde-
pendentemente da estratégia de modulação. Quando o conversor opera
na região de sobremodulação, significa que a componente fundamental
4.2 Modelo Médio do ∆-VSI 51
da função de razão cíclica do interruptor ultrapassou o valor de pico da

portadora. No caso da modulação senoidal (SPWM), o máximo índice
de modulação é encontrado quando as funções de modulação atingem
o pico da portadora
2
√ Mmax,SPWM = 1. (4.11)
3
Simplificando (4.11) para a obtenção do máximo índice de modulação
√
3
Mmax,SPWM = ≈ 0,866. (4.12)
2
Caso seja necessário operar o conversor com um índice de mo-
dulação mais elevado, é necessário adicionar um sinal de eixo zero às
referências de tensão
2
m∗a = √ M cos (ωt) + mz
3
∗ 2 2π
mb = √ M cos ωt − + mz (4.13)
3 3
2 2π
m∗c = √ M cos ωt + + mz .
3 3
Com a adição do sinal de eixo zero, é possível alcançar o valor má-

ximo de índice de modulação, que ocorre quando V ~ ∗ =V~max
∗
. Portanto
substituindo o valor da amplitude do vetor de referência em (4.10) pelo
valor encontrado em (3.25) obtém-se
Mmax,SVPWM = 1. (4.14)
Observa-se então a possibilidade de se obter um índice de mo-

dulação 15, 5% maior para a modulação SVPWM em relação à SPWM
conforme
Mmax,SVPWM 1
≈ ≈ 1,155. (4.15)
Mmax,SPWM 0,866
Isto significa que, para uma mesma tensão CA, é possível utilizar uma
tensão no barramento CC menor, o que pode ser uma vantagem em
termos de custo, segurança de operação e perdas por comutação.
O sinal de eixo zero desloca simultaneamente a posição vertical
dos sinais moduladores e, como será visto mais adiante, não afeta a
duração dos tempos de aplicação dos vetores ativos. O sinal de eixo zero
determina apenas a divisão dos tempos em que o vetor nulo é aplicado
dentro de um período de comutação. As funções de razão cíclica para
os interruptores em estrela superiores podem ainda ser obtidas a partir
das funções de modulação conforme
1
1 + m∗Sip , (4.16)

dSip =
2
com i = a, b, c. As funções de razão cíclica dos interruptores em estrela
inferiores são complementares às dos interruptores superiores do mesmo
braço
dSin = 1 − dSip . (4.17)
É possível encontrar uma relação entre os sinais modulantes dos
interruptores em delta e os dos interruptores em estrela. Como será
visto, é necessário realizar uma análise vetorial dos pulsos de cada setor
para os interruptores em estrela e para os interruptores em delta.
4.3 Relação Entre a CBPWM e a SVM para os Interruptores

em Estrela
Existem diversos trabalhos na literatura que correlacionam mo-

dulação vetorial com a modulação baseada em portadoras para o 2L-
VSI. Nesses trabalhos, são encontradas relações entre as funções de
razão cíclica dos interruptores e os tempos de aplicação dos vetores [56]–
[58]. O mesmo procedimento pode ser utilizado para a obtenção das
funções de razão cíclica do ∆-VSI. A Figura 4.4 mostra de forma simul-
tânea os pulsos dos interruptores do ∆-VSI sendo gerados utilizando o
processo de modulação PWM.
Os valores médios quase instantâneos das funções de razão cíclica
dos interruptores em estrela superiores podem ser escritos em função
dos tempos de aplicação dos vetores e do período de comutação. Para
o primeiro sextante a relação
dSap Ts = T1 + T2 + T0
dSbp Ts = T2 + T0 (4.18)
dScp Ts = T0
é encontrada. Substituindo dx = Tx /Ts , com x = 1, 2, 0, 7, reescreve-se

4.3 Relação Entre a CBPWM e a SVM para os Interruptores em Estrela53
Figura 4.4: Esquema para a geração dos pulsos do ∆-VSI: (a) para o primeiro
sextante; (b) para o segundo sextante.
(4.18) como
dSap = d1 + d2 + d0
dSbp = d2 + d0 (4.19)
dScp = d0 .
Representando (4.19) na forma matricial obtém-se
    
dSap 1 1 1 d1
 dSbp  =  0 1 1   d2  . (4.20)
    
dScp 0 0 1 d0
Escrevendo (4.20) de forma vetorial, têm-se
d~s = [ASI ~
s ]dt . (4.21)
Generalizando (4.21) para os demais sextantes chega-se em
d~s = [AS n ~
s ]dt , (4.22)
onde n ∈ {I, II...VI}. Realizando o mesmo procedimento para os outros

sextantes encontra-se as matrizes [ASs ], mostradas na Tabela 4.1
n
d~s = [AS n ~
s ]dt . (4.23)
Tabela 4.1: Relação entre d~s e d~t para os seis sextantes.
As funções de razão cíclica dos tempos de aplicação dos vetores

são obtidas através de
d~t = [AS n −1 ~
s ] ds , (4.24)
−1
onde os valores de [AS
s ]
n
são reunidos na Tabela 4.2 para os seis
sextantes.
Tabela 4.2: Relação entre d~t e d~s para os seis sextantes.
A partir de (4.19) é possível encontrar os valores de d~t em função

4.4 Relação Entre a CBSVM e a SVM para os Interruptores em Delta 55
das funções de razão cíclica de linha



 d1 = dSap − dSbp
d2 = dSbp − dScp (4.25)

−d1 + d2 = dScp − dSap

A equação (4.25) evidencia que o tempo de aplicação dos vetores

ativos depende apenas das tensões de linha e não da tensão de eixo zero
aplicada, sendo, portanto, independente da estratégia de modulação.
Sabendo disso, sem perda de generalidade, é possível substituir em
(4.25) as funções de razão cíclica dos interruptores em estrela superiores
pelas funções de razão cíclicas de referência senoidais conforme
(
d1 = d∗a − d∗b
. (4.26)
d2 = d∗b − d∗c
Os valores de d1 e d2 para os demais sextantes, mostrados na Tabela

4.3, podem ser calculados de maneira semelhante.
Tabela 4.3: Funções de razão cíclica dos tempos de aplicação dos vetores
ativos escritas em função do vetor de referência.
Funções de Razão Cíclicas

Sextante
d1 d2
SI d∗a − d∗b d∗b − d∗c
SII d∗a − d∗c −d∗a + d∗b
SIII d∗b − d∗c −d∗a + d∗c
SIV −d∗a + d∗b −d∗b + d∗c
SV −d∗a + d∗c d∗a − d∗b
SVI −d∗b + d∗c d∗a − d∗c
4.4 Relação Entre a CBSVM e a SVM para os Interruptores

em Delta
A Figura 4.4 mostra que os interruptores conectados em delta

são comandados a conduzir e a bloquear duas vezes em cada período
de comutação. Portanto, diferentemente dos interruptores em estrela,
não é possível gerar os sinais de gatilho utilizando uma portadora e

um sinal modulador. Uma solução para a geração do padrão de pulsos
consiste em dividi-lo em duas partes e utilizar um sinal modulador para
cada uma delas. Um sinal modulador foi utilizado para a aplicação
dos vetores centrais à janela de comutação (dSij2 , com i = a, b, c, j =
a, b, c 6= i) e o outro para a aplicação dos vetores das bordas da janela de
comutação (dSij1 , com i = a, b, c, j = a, b, c 6= i). A geração dos pulsos
é feita por um modulador adequado cujo detalhamento é realizado na
Seção 4.7
Da mesma forma que para os interruptores em estrela, o valor
médio quase instantâneo das funções de razão cíclica podem ser escri-
tos em função dos tempos de aplicação dos vetores e do período de
comutação. Para o primeiro sextante
     
dSab1 −1 −1 −1 1
 dSab2   0 1 1   0 
      
 d
 dSbc1   0 −1 −1   1   1 
    

 d
=   d2  +   . (4.27)
 Sbc2   0 0 1 
   0 
 d0
  
 dSca1   −1 −1 −1   1 
    
dSca2 0 0 1 0
Reescrevendo (4.27) de forma vetorial,
d~d = [AS I ~ ~
d ]dt + dcte , (4.28)
onde d~cte é um vetor com os mesmos valores independente do sextante.

Generalizando (4.28) para os demais setores chega-se em
d~d = [ASn ~ ~
d ]dt + dcte , (4.29)
onde n ∈ {I, II...VI}. Realizando o mesmo procedimento para os outros

sextantes encontra-se as demais relações de [ASd ] que foram reunidas
n
na Tabela 4.4.

em Estrela
As estratégias de modulação baseadas em portadoras são clas-

sificadas em contínuas (CPWMs) e descontínuas (DPWMs) de acordo
4.5 Geração dos Sinais Moduladores para os Interruptores em Estrela 57
Tabela 4.4: Relação entre d~d e d~t para os seis sextantes.
com o padrão de pulsos. Nas modulações contínuas, os sinais modu-

lantes estão sempre entre os valores de pico da portadora triangular
e, portanto, dentro de cada período da portadora, há pelo menos uma
comutação. Nas modulações descontínuas, a forma de onda dos mo-
duladores possui pelo menos um segmento que é grampeado no topo
ou na base da triangular, significando que, nesses instantes, não há
comutação na fase.
As modulações descontínuas são apropriadas quando se deseja
reduzir as perdas de comutação do conversor e as contínuas quando
se deseja reduzir a distorção das correntes de fase do conversor [7],
[8]. Ambas as estratégias de modulação contínuas e descontínuas são
possíveis de se implementar no ∆-VSI.
A seguir será apresentada uma metodologia para geração dos
sinais moduladores para os interruptores em estrela do ∆-VSI para as
estratégias SVPWM e DPWM. A metodologia seguida é baseada no
principio de equivalência das modulações vetoriais com as baseadas em
portadora. A metodologia proposta pode ser seguida para a derivação
das funções de modulação dos interruptores de uma modulação PWM
equivalente à uma modulação vetorial para a maioria dos conversores
trifásicos, sejam eles dois níveis ou multiníveis.
4.5.1 SVPWM
A SVPWM é a modulação baseada em portadora que equivale

à SVM apresentada na Seção 3.5.3. Nesta estratégia de modulação,
os interruptores são comandados a conduzir e a bloquear apenas uma
vez por período de comutação. Além disso, o tempo em que o vetor
da extremidade é aplicado é o mesmo tempo que o vetor nulo central
à janela de comutação. Isso significa que é necessário apenas uma
portadora para formar o padrão de pulsos e que a relação
dnull
d0 = (4.30)
2
é válida. Substituindo o valor de d0 em (4.19) e utilizando a relação
contida em (3.24) para calcular dnull , é possível encontrar d~s em função
apenas das funções de razão cíclica dos tempos de aplicação dos vetores
ativos d1 e d2
d1 + d2 + 1
dSap =
2
−d1 + d2 + 1
dSbp = (4.31)
2
−d1 − d2 + 1
dScp = .
2
O mesmo procedimento foi utilizado para encontrar o valor de d~s para
os demais sextantes e o resultado é mostrado na Tabela 4.5.
Tabela 4.5: Relação entre d~s e d~t para os seis sextantes utilizando a SVPWM.
SVPWM
Sextante dSap dSbp dScp
SI (d1 + d2 + 1)/2 (−d1 + d2 + 1)/2 (−d1 − d2 + 1)/2
SII (d1 − d2 + 1)/2 (d1 + d2 + 1)/2 (−d1 − d2 + 1)/2
SIII (−d1 − d2 + 1)/2 (d1 + d2 − 1)/2 (−d1 + d2 + 1)/2
SIV (−d1 − d2 + 1)/2 (d1 − d2 + 1)/2 (d1 + d2 + 1)/2
SV (−d1 + d2 + 1)/2 (−d1 − d2 + 1)/2 (d1 + d2 + 1)/2
SVI (d1 + d2 + 1)/2 (−d1 − d2 + 1)/2 (d1 − d2 + 1)/2
Substituindo (4.26) em (4.31) e sabendo que
d∗a + d∗b + d∗c = 3/2, (4.32)
encontra-se os valores de d~s em função das funções de razão cíclicas de

referência em coordenadas abc
dSap = −1/4 + d∗b /2 + d∗a

dSbp = −1/4 + d∗b /2 + d∗b
(4.33)
dScp = −1/4 + d∗b /2 + d∗c .
| {z }
dz
Para encontrar d~s em função das funções de razão cíclica em

coordenadas abc substitui-se d1 e d2 da Tabela 4.5 pelos valores contidos
na Tabela 4.3. Para encontrar em coordenadas αβ, substitui-se d1 e
d2 pelos valores contidos na Tabela 3.2, respeitando seus respectivos
sextantes. O resultado de d~s em coordenadas abc é mostrado na Tabela
4.6.
Tabela 4.6: Relação entre d~s e d~∗abc para os seis sextantes utilizando a
SVPWM.
SVPWM
Sextante dSap dSbp dScp
SI −1/4 + d∗b /2 + d∗a −1/4 + d∗b /2 + d∗b −1/4 + d∗b /2 + d∗c
SII −1/4+d∗a /2+d∗a −1/4 + d∗a /2 + d∗b −1/4 + d∗a /2 + d∗c
SIII −1/4 + d∗c /2 + d∗a −1/4 + d∗c /2 + d∗b −1/4 + d∗c /2 + d∗c
SIV −1/4 + d∗b /2 + d∗a −1/4 + d∗b /2 + d∗b −1/4 + d∗b /2 + d∗c
SV −1/4+d∗a /2+d∗a −1/4 + d∗a /2 + d∗b −1/4 + d∗a /2 + d∗c
SVI −1/4 + d∗c /2 + d∗a −1/4 + d∗c /2 + d∗b −1/4 + d∗c /2 + d∗c
Observa-se na Tabela 4.6 que as funções de razão cíclica dos

interruptores são formadas por uma parcela de valor igual a função de
razão cíclica da fase a qual o interruptor está diretamente conectado e
por uma parcela que é comum às três fases dentro de um sextante. O
sinal que é comum às três fases é chamado de razão cíclica de eixo zero
e será denominado dz . Por inspeção da tabela 4.6, é possível chegar
na expressão geral que define os sinais de modulação para a SVPWM,

bastante conhecida na literatura
d~∗s,SVPWM = dz,SVPWM + d~∗abc (4.34)
onde,
dz,SVPWM =

~ ∗abc |)
1 1 + min(|m

mid(d~∗abc ) (4.35)
=
2 2 2
Os valores das funções de modulação utilizados para implementar o
sinal de eixo zero para a SVPWM são localizados na região 3 da Figura
4.5, onde as funções de modulação assumem seus menores valores em
módulo. A implementação da SVPWM surgiu pela primeira vez na
Figura 4.5: Funções de modulação de referência em um plano separando as

regiões onde as funções atingem seus valores máximo mínimos e intermediá-
rios em módulo.
literatura, provavelmente, em 1974 [59], antes mesmo da implementação

vetorial ter sido desenvolvida em 1986 [42], [59].
4.5.2 DPWM
A modulação PWM descontínua faz com que pelo menos uma
das fases do inversor permaneça não modulada por mais de um período
de comutação. Nessas modulações, o vetor nulo é aplicado em um só
período de tempo e pode estar localizado em duas posições diferentes na
janela de comutação. A Figura 3.12 (a) mostra o caso em que V

~0,RCL1
é aplicado durante um tempo proporcional a
d0 = dnull . (4.36)
Neste caso d7 = 0. A Figura 3.12 (b) mostra o caso em que V ~0,RCL2 é

aplicado durante o tempo proporcional a d7 = dnull , ou seja,
d0 = 0. (4.37)
Para o caso em que d0 = dnull , é possível encontrar d~s em função

~
de dt . No primeiro sextante, esta relação é obtida substituindo (4.36)
em (4.19) e, considerando a relação contida em (3.24), obtém-se
dSap = d1 + d2 + d0 = 1
dSbp = d2 + d0 = 1 − d1 (4.38)
dScp = d0 = 1 − d1 − d2 .
Substituindo os valores de d1 e d2 encontrados em (4.26) na
expressão (4.38) obtém-se d~s em função das funções de razão cíclica de
referência para o primeiro sextante
dSap = 1 = 1 − d∗a + d∗a

dSbp = 1 − d∗a + d∗b
(4.39)
dScp = 1 − d∗a +d∗c .
| {z }
dz
Realizando o mesmo procedimento anterior, agora considerando

o caso em que d0 = 0, escreve-se d~s em função de d~t conforme
dSap = d1 + d2 + d0 = d1 + d2
dSbp = d2 + d0 = d2 (4.40)
dScp = d0 = 0.
Substituindo os valores de d1 e d2 encontrados em (4.26) na
expressão (4.40) obtém-se d~s em função das funções de razão cíclica de
referência para o primeiro sextante
dSap = 0 − d∗c + d∗a

dSbp = 0 − d∗c + d∗b
(4.41)
dScp = 0 − d∗c +d∗c .
| {z }
dz
Realizando o mesmo procedimento para os demais sextantes,

encontra-se as possíveis funções de razão cíclica para as modulações
descontínuas em coordenadas abc. As funções de razão cíclica encon-
Tabela 4.7: Relação entre d~s e d~t para os os seis sextantes do plano vetorial
αβ considerando a DPWM.
DPWM
Sextante d0 dSap dSbp dScp
dnull 1 1 − d1 1 − d1 − d2
SI
0 d1 + d2 d2 0
dnull 1 − d2 1 1 − d1 − d2
SII
0 d1 d1 + d2 0
dnull 1 − d1 − d2 1 1 − d1
SIII
0 0 d1 + d2 d2
dnull 1 − d1 − d2 1 − d2 1
SIV
0 0 d1 d1 + d2
dnull 1 − d1 1 − d1 − d2 1
SV
0 d2 0 d1 + d2
dnull 1 1 − d1 − d2 1 − d2
SVI
0 d1 + d2 0 d1
tradas foram reunidas na Tabela 4.8. Realizando uma inspeção na Ta-

bela 4.8 é possível definir a estrutura base para as modulações PWM
descontínuas
d~s = dz (d~∗abc ,~i∗abc ) + d~∗abc , (4.42)
Tabela 4.8: Relação entre d~s ,d~∗abc e d0 para os os seis sextantes do plano
vetorial αβ considerando a DPWM.
DPWM
Sextante d0 dSap dSbp dScp
dnull 1− d∗a + d∗a 1− d∗a + d∗b 1 − d∗a + d∗c
SI
0 0− d∗c + d∗a 0− d∗c + d∗b 0 − d∗c + d∗c
dnull 1− d∗b + d∗a 1− d∗b + d∗b 1 − d∗b + d∗c
SII
0 0− d∗c + d∗a 0− d∗c + d∗b 0 − d∗c + d∗c
dnull 1− d∗b + d∗a 1− d∗b + d∗b 1 − d∗b + d∗c
SIII
0 0− d∗a + d∗a 0− d∗a + d∗b 0 − d∗a + d∗c
dnull 1− d∗c + d∗a 1− d∗c + d∗b 1 − d∗c + d∗c
SIV
0 0− d∗a + d∗a 0− d∗a + d∗b 0 − d∗a + d∗c
dnull 1− d∗c + d∗a 1− d∗c + d∗b 1 − d∗c + d∗c
SV
0 0− d∗b + d∗a 0− d∗b + d∗b 0 − d∗b + d∗c
dnull 1− d∗a + d∗a 1− d∗a + d∗b 1 − d∗a + d∗c
SVI
0 0− d∗c + d∗a 0− d∗c + d∗b 0 − d∗c + d∗c
onde
dz (d~∗abc ,~i∗abc ) = (4.43)

= 1/2 − sinal 1/2 − h(d~∗abc ,~i∗abc ) 1/2 − h(d~∗abc ,~i∗abc ).
O valor de h(d~∗abc ,~i∗abc ), dependendo da modulação utilizada,

pode depender da amplitude das referências de corrente CA
i∗a = Iˆpk cos (θ + ϕ)

∗ ˆ 2π
ib = Ipk cos θ − +ϕ (4.44)
3
∗ ˆ 2π
ic = Ipk cos θ + +ϕ ,
3
ou diretamente de d~∗abc . O entendimento do significado das expressões

(4.42) e (4.43) permite gerar qualquer DPWM existente, ou até mesmo
criar outras que sejam mais adequadas a uma dada aplicação. A de-
terminação do valor de h(d~∗abc ,~i∗abc ) consiste em escolher a fase que não
será modulada dentre as duas maiores fases em módulo de m ~ ∗abc . As
fases que podem ser não moduladas em cada sextante encontram-se nas
regiões um e dois da Figura 4.5.
4.5.2.1 Tipos de DPWMs
As modulações descontínuas foram concebidas com o intuito de

reduzir as perdas por comutação dos conversores [59], [60]. A maior
parte das modulações descontínuas presentes na literatura mantém uma
fase não modulada por 120◦ por período das funções de modulação de
referência.
A Modulação PWM Descontínua Generalizada (GDPWM) [59],
[60] é a modulação descontínua que mais reduz as perdas por comu-
tação, considerando uma larga faixa de variação do ângulo de fator
de potência. Por outro lado, essa estratégia também é a que provoca
maior distorção nas correntes CA. Quando o conversor opera utilizando
a GDPWM, as fases que conduzem a maior corrente naquele momento
deixam de comutar maximizando, assim, os ganhos de eficiência. Nos
intervalos descritos, as perdas por comutação são as mais elevadas e
a redução na quantidade de comutações tem um maior impacto no
aumento do rendimento do conversor.
O padrão de pulsos da GDPWM é gerado substituindo a fun-
ção h(d~∗abc ,~i∗abc ) pelo valor correspondente em função de razão cíclica
(d~∗abc ) à fase do maior valor em módulo de ~i∗abc . Se o valor da referência
de corrente (~i∗abc ) escolhido é positivo, o grampeamento é feito através
dos interruptores superiores, caso a corrente seja negativa o grampe-
amento é realizado pelos interruptores inferiores. O algoritmo para a
implementação da GDPWM pode ser descrito em forma de equações
compostas conforme
GDPWM ⇒
h(d~∗abc ,~i∗abc ) = fmax (d~∗abc ,~i∗abc )

se fmax (~i∗abc ,~i∗abc ) ≥ fmin (~i∗abc ,~i∗abc )



d =d
0 null
~∗ ,~i∗ ) = fmin (d~∗ ,~i∗ ) ,
h( d abc abc abc abc
se fmax (~i∗abc ,~i∗abc ) < fmin (~i∗abc ,~i∗abc )



d0 = 0

(4.45)
onde

∗
y a
 se x∗a ≤ x∗b e x∗a ≤ x∗c
∗ ∗
fmin (~yabc , ~xabc ) = yb∗
se x∗b ≤ x∗a e x∗b ≤ x∗c (4.46)
 ∗
x∗c ≤ x∗a e x∗c ≤ x∗b

yc se
e 
∗
ya
 se x∗a ≥ x∗b e x∗a ≥ x∗c
∗ ∗
fmax (~yabc , ~xabc ) = yb∗
se x∗b ≥ x∗a e x∗b ≥ x∗c . (4.47)
 ∗
x∗c ≥ x∗a e x∗c ≥ x∗b

yc se
Na estratégia DPWM3, as fases deixam de ser moduladas nos
valores intermediários em módulo das funções de razão cíclica. Se o
valor da função de modulação intermediária é positivo, o grampeamento
é feito pelos interruptores superiores, caso contrário, o grampeamento é
feito pelos interruptores inferiores. O algoritmo utilizado para o cálculo
de h(d~∗abc ,~i∗abc ) é mostrado
DPWM3 ⇒
h(d~∗abc ,~i∗abc ) = fmid (d~∗abc , m
~ ∗abc )

se fmid (d~∗abc , m
~ ∗abc ) − 0, 5 ≥ 0



 d =d
0 null
~ ~∗ ~ ∗ ) ,
h( d ∗ ~∗
abc iabc ) = fmid (dabc , m
, abc
fmid (d~∗abc , m
~ ∗abc ) − 0, 5 < 0


 se
d0 = 0

(4.48)
onde

∗
se |m∗b | ≤ |m∗a | ≤ |m∗c | ou |m∗c | ≤ |m∗a | ≤ |m∗b |
da

fmid (d~∗abc , m
~ ∗abc ) = d∗b
se |m∗a | ≤ |m∗b | ≤ |m∗c | ou |m∗c | ≤ |m∗b | ≤ |m∗a | .
 ∗
se |m∗a | ≤ |m∗c | ≤ |m∗b | ou |m∗b | ≤ |m∗c | ≤ |m∗a |

dc
(4.49)
As funções de modulação escolhidas por esta estratégia
localizam-se na região dois da Figura 4.5. Em [61] e [62] é comprovada
uma redução nas perdas causadas por correntes harmônicas em relação
a SVPWM.
Nas estratégias de modulação DPWMMIN e DPWMMAX, o
sinal com o valor mínimo e com o valor máximo definem o sinal de eixo
zero respectivamente, como mostra
(
h(d~∗abc ,~i∗abc ) = fmax (d~∗abc , d~∗abc )
DPWMMAX ⇒ (4.50)
d0 = dnull
e (
h(d~∗abc ,~i∗abc ) = fmin (d~∗abc , d~∗abc )
DPWMMIN ⇒ . (4.51)
d0 = 0
O sinais que compõe h(d~∗abc ,~i∗abc ) para a DPWMMAX e

DPWMMIN são localizados nas regiões um e dois superiores e inferio-
res da Figura 4.5, respectivamente. Nestas estratégias de modulação,
os esforços de condução são diferentes entre os semicondutores superi-
ores e inferiores. Por conta disto, essas duas estratégias de modulação
não serão abordadas nesta dissertação.
As modulações conhecidas na literatura como DPWM0 [62],
DPWM1 e DPWM2 [63] são casos particulares da GDPWM em que os
ângulos de defasagem entre as tensões e correntes de fase são −60◦ , 0◦
e +60◦ respectivamente. A distribuição do vetor nulo no plano vetorial
αβ para as modulações abordadas até o momento pode ser visualizada
na Figura 4.6.
Como já foi mencionado, a modulação SVPWM contínua realiza
o vetor nulo duas vezes por período de comutação e o tempo de apli-
cação desses vetores são iguais à metade de dnull . As modulações des-
contínuas DPWMMAX e DPWMMIN, como na modulação SVPWM
distribui o vetor nulo sempre de maneira constante, com a diferença
que o período de aplicação é concentrado em apenas um intervalo. As
modulações DPWM0 1,2,3 e GDPWM alternam a distribuição do vetor
nulo a cada 60◦ . A modulação GDPWM muda a região de aplicação
do vetor nulo dentro dos sextantes de acordo com o ângulo do fator de
potência. As funções de modulação dos interruptores em estrela uti-
lizando as estratégias de modulação apresentadas até o momento são
mostradas na Figura 4.7.
A estratégia de modulação DPWM1 é a mais adequada quando
se deseja injetar energia na rede elétrica ou alimentar um motor AC à
imãs permanentes de baixa indutância. Nessas situações deseja-se fator
de potência unitário. A estratégia DPWM2 é mais adequada quando
se deseja acionar cargas indutivas com ângulo de fator de potência pró-
ximo de 30 graus como é o caso de motores de indução. Para operação
Figura 4.6: Diagramas mostrando a distribuição do vetor nulo para a: (a)

SVPWM, DPWMMAX e DPWMMIN; (b) GDPWM; (c) DPWM3; (d)
DPWM1; (e) DPWM0; (f) DPWM2.
Figura 4.7: Sinais de modulação do interruptor Sap considerando M = 0,71

para a: (a) SPWM; (b) SVPWM; (c) DPWM1; (d) DPWM3; (e) DPWM0;
(f) DPWM2.
de máquinas de indução como geradores, a DPWM0 é a mais adequada.
4.5.3 Novas Estratégias de Modulação

As estratégias de modulação vistas até agora deixam as fases do
conversor não moduladas por no máximo 120◦ , durante um período da
componente fundamental, e apresentam um padrão de pulsos com cinco
ou com sete segmentos. Embora 120◦ de descontinuidade seja o limite

por fase, nada impede que as descontinuidades ocorram por menos
tempo e que se tenha modulações utilizando padrões de pulsos com
cinco e sete segmentos ao mesmo tempo em um ciclo da componente
fundamental. Baseado nisto, as estratégias de modulação podem ser
combinadas para dar origem a novas modulações com características
intermediárias em relação às originais.
Conforme é mostrado em [59], [64], as modulações contínuas de
sete segmentos possuem melhores características quando a Taxa de Dis-
torção Harmônica (TDH) das correntes CA é priorizada, mas quando
se deseja menores perdas por comutação, as estratégias descontínuas
possuem melhor desempenho. Em certas aplicações, como em sistemas
conectados à rede elétrica, as modulações descontínuas geralmente não
são utilizadas nos 2L-VSIs devido aos requisitos de EMI que devem ser
atingidos. Nestes casos as modulações contínuas são utilizadas sacri-
ficando, assim, o rendimento do sistema, porém reduzindo o tamanho
dos filtros no lado CA.
Uma possível alternativa para a situação descrita é o emprego de
modulações que hora apresentam um padrão de pulsos dos interruptores
com cinco segmentos, hora com sete segmentos dentro de um período
da componente fundamental de tensão CA. Caso o conversor tenha que
operar com fator de potência unitário, pode ser vantajoso manter as
descontinuidades por 30◦ utilizando o padrão de pulsos da DPWM1,
e no restante do tempo, realizar a modulação de sete segmentos como
mostrado nas Figuras 4.8 (a) e 4.8 (b). Na modulação D1SVPWM o
padrão de pulsos da DPWM1 é localizado no pico das cossenoides de
referência, enquanto que na SVD1PWM o padrão de pulsos da SVPWM
é que se localiza no pico. Fazendo isso, as perdas são reduzidas sem
degradar tanto o espectro da corrente CA.
Da mesma forma que as modulações DPWM0,1,2 são derivadas
de uma estratégia mais geral GDPWM, as modulações das Figuras 4.9
(a) e 4.9 (b) são derivadas da GDSVPWM e as das Figuras 4.9 (c) e
4.9 (d) da SVGDPWM.
Caso o conversor tenha que operar com correntes defasadas com
mais de 75◦ da fundamental de tensão, pode ser vantajoso operar com
o padrão de pulso da DPWM3 durante 30◦ e, no restante do tempo,
operar com a modulação de sete segmentos, conforme mostra o sinal
de modulação das Figuras 4.8 (c) e 4.8 (d).
Em casos onde se queira que a eficiência do conversor não sofra

para a: (a) D1SVPWM; (b) SVD1PWM; (c) D3SVPWM; (d) SVD3PWM;
(e) DPWM13; (f) DPWM31.
muita variação com a mudança do ângulo de fator de potência, as

descontinuidades podem ser mais distribuídas ao longo do período da
fundamental de tensão de referência. Para isso, os padrões de pulsos
das estratégias DPWM1 e DPWM3 podem ser alternados para gerar
as formas de onda dos sinais moduladores das Figuras 4.8 (e) e 4.8 (f).
O grau de hibridez das modulações descritas nesta seção também
pode ser alterado conforme critérios do projetista bastando, para isso,

para a: (a) SVD0PWM; (b) SVD2PWM; (c) D0SVPWM; (d) D2SVPWM.
aumentar ou diminuir o tempo em que as descontinuidades ocorrem.

A Figura 4.10 mostra o que se espera das modulações híbridas quando
comparadas com as modulações originais.
Como foi visto, as modulações híbridas utilizam duas modula-
ções conhecidas que se alternam dentro de um período da componente
fundamental das tensões de referência. As características de distorção
harmônica da corrente e perdas por comutação da modulação hibrida
será mais próxima da modulação que é empregada no pico das corren-
tes CA. Uma análise mais detalhada deve ser feita para a comprovação
desta hipótese.
A Figura 4.11 mostra a distribuição do vetor nulo nas modula-
ções hibridas. Nas modulações em que o padrão de pulsos das modula-
ções descontínuas é localizado no topo das funções de razão cíclica de
referência, o vetor nulo é deslocado a cada 30◦ conforme é mostrado
nas Figuras 4.11 (a) e 4.11 (c). Nas modulações em que o padrão de
pulsos da SVPWM é utilizado no topo das funções de razão cíclica de
referência e nas modulações que utilizam os padrões de pulsos de duas
Figura 4.10: Tendência das características de perdas por comutação e TDH

de corrente para as modulações híbridas quando comparadas com as estra-
tégias de modulação clássicas.
modulações descontínuas, a localização do vetor nulo é mudado a cada

15◦ e 30◦ de maneira alternada.
4.5.4 Alternância entre Estratégias de Modulação
As estratégias de modulação abordadas até o momento possuem

desempenhos diferentes no que diz respeito às perdas por comutação e
distorção na corrente de saída para diferentes índices de modulação e
ângulo de fator de potência. Para otimizar o desempenho do conversor,
as estratégias de modulação podem ser trocadas de acordo com o ângulo
δ de fator de potência, conforme mostrado em [60] e ilustrado mais
adiante na Figura 5.16 para a redução das por comutação.
Figura 4.11: Diagramas mostrando a distribuição do vetor nulo para a:

(a) D1SVPWM; (b) SVD1PWM; (c) D3SVPWM; (d) SVD3PWM; (e)
DPWM13; (f) DPWM31.

em Delta
O sinais moduladores dos interruptores em delta podem ser ob-

tidos a partir dos sinais modulantes dos interruptores em estrela. Para
obtê-los numericamente, substitui-se (4.24) em (4.29)
d~d = [AS Sn ~ ~ Sn ~ ~
d ][As ]dm + dcte = [Ads ]dm + dcte .
n
(4.52)
O resultado das funções de razão cíclica em função dos sinais
moduladores de referência são mostrados na Tabela 4.9.
Tabela 4.9: Relação entre d~d e d~s para os seis sextantes do mapa de vetores
αβ.
Sinais de Modulação
Sextante
dSab1 dSab2 dSbc1 dSbc2 dSca1 dSca2
I 1 − dSap dSbp 1 − dSbp dScp 1 − dSap dScp
II 1 − dSbp dSap 1 − dSbp dScp 1 − dSap dScp
III 1 − dSbp dSap 1 − dSbp dScp 1 − dScp dSap
IV 1 − dSbp dSap 1 − dScp dSbp 1 − dScp dSap
V 1 − dSap dSbp 1 − dScp dSbp 1 − dScp dSap
VI 1 − dSap dSbp 1 − dScp dSbp 1 − dSap dScp
A Figura 4.12 mostra o sinal de modulação do interruptor delta

Sab gerado a partir dos sinais moduladores dos interruptores superiores
em estrela mSap e mSbp a ele conectados, para as estratégias de mo-
dulação clássicas abordadas na Seção 4.5. O resultado da Tabela 4.9
é de grande importância, pois permite que os pulsos dos interruptores
em delta do ∆-VSI sejam gerados a partir de qualquer estratégia de
modulação existente para um 2L-VSI. O sinal de modulação de um
interruptor em delta depende apenas dos sinais de modulação dos in-
terruptores em estrela que estão a ele conectados. Para encontrar os
valores de d~d em função de d~∗abc para as modulações descritas na Se-
ção 4.5, basta substituir na Tabela 4.9 os valores de d~s .
4.6 Geração dos Sinais Moduladores para os Interruptores em Delta 75
Figura 4.12: Sinais de modulação do interruptor delta mSab sendo gerados

a partir dos sinais de modulação dos interruptores em estrela mSap e mSbp
considerando M = 0,71 para a: (a) SPWM; (b) SVPWM; (c) DPWM1; (d)
DPWM3; (e) DPWM0; (d) DPWM2.
4.7 Moduladores
Para as estratégias de modulação com RL, os pulsos de gatilho de

cada interruptor controlado em estrela podem ser gerados com apenas
um comparador, uma portadora triangular e um sinal modulador para
cada interruptor. Os pulsos gerados mantêm os interruptores acionados
sempre no centro da janela de comutação por um tempo proporcional à
função de razão cíclica de referência. Os sinais de gatilho dos interrup-
tores em delta mantém os interruptores acionados em dois intervalos
de tempo distintos, um localizado no centro e o outro nas extremidades
da janela de comutação. Para isso, dois comparadores se fazem ne-
cessários. A Figura 4.13 apresenta três propostas de moduladores que
podem ser implementado para os interruptores em delta.
Figura 4.13: Possiveis moduladoes para a geração dos pulsos dos interrupto-
res conectados em delta utilizando: (a) a mesma portadora e lógica externa;
(b) portadoras defasadas e lógica externa; (c) apenas o microprocessador.
O modulador da Figura 4.13 (a) utiliza dois comparadores com

lógica invertida, apenas uma portadora e o resultado das comparações
são somados através de uma porta OU. O modulador da Figura 4.13 (b)
utiliza dois comparadores com a mesma lógica, duas portadoras defa-
sadas de 180◦ e os resultados das comparações são somados através
de uma porta OU. Essas duas implementações podem ser realizadas
4.7 Moduladores 77
de maneira analógica, com o auxílio de circuitos digitais, ou de forma

microprocessada, com o auxílio de circuitos digitais externos.
A Figura 4.13 (c) mostra como implementar o modulador de ma-
neira completamente microprocessada. Dois contadores são utilizados
e comparados com as funções de razão cíclica d~s respectivamente. Os
comparadores possuem lógica invertida e o resultado das comparações
atua sobre a mesma saída. A Figura 4.14 ilustra como são obtidos os
sinais de modulação do ∆-VSI. Os sinais de modulação dos interrupto-
res em delta (mSijx , com i = a, b, c, j = a, b, c 6= i e x = 1, 2) são obtidos
a partir dos sinais de modulação dos interruptores em estrela (mSip ,
com i = a, b, c).
Figura 4.14: Esquema para a geração dos pulsos do ∆-VSI.
Nas estratégias de modulação com RCMV, os sinais de comando

dos interruptores em estrela superiores e inferiores não são complemen-
tares, conforme visto na Figura 3.12. Além disso, cada interruptor é
comandado a conduzir e a bloquear duas vezes a cada ciclo de comuta-
ção. A mesma técnica utilizada para gerar os sinais dos interruptores
em delta poderia ser utilizada, entretanto, seriam necessários dois com-
paradores, ou contadores para comandar cada interruptor. Os sinais
modulantes teriam de ser baseados nos tempos de aplicação de cada ve-
tor e, não mais, nas cossenoides de referência. Esses fatores implicam
na necessidade de utilização de um processador com maior número de
canais PWM independentes.
Para gerar os sinais dos interruptores, sem modificações no pro-
cedimento para gerar os sinais modulantes de cada interruptor, consiste

em adicionar uma lógica externa à saída dos comparadores associados
à cada um dos interruptores em estrela. A lógica desliga todos os in-
terruptores em estrela sempre que os três interruptores em delta forem
comandados a conduzir. A lógica que deve ser adicionada a cada inter-
ruptor em estrela é mostrada na Figura 4.15.
Figura 4.15: Lógica adicional para os interruptores conectados em estrela

para a realização das estratégias com RCMV.
4.8 Estratégia de Transição entre Vetores
A Seção 3.6.1 mostrou duas estratégias de transição entre vetores

para os interruptores do ∆-VSI. A estratégia descrita na Figura 3.15
(a), que concentra as perdas por comutação nos interruptores conec-
tados em estrela, pode ser implementada realizando um deslocamento
vertical das funções de razão cíclica dos interruptores conectados em
delta. Se o modulador da Figura 4.13 (a) ou (c) for utilizado, o deslo-
camento das funções de razão cíclica dos interruptores em delta deve
ser feito conforme
( 0
dSij1 = dSij1 + ∆d
0 . (4.53)
dSij2 = dSij2 − ∆d
Essa técnica, visualizada na Figura 4.16, tem a limitação de es-
treitar os pulsos de maneira simétrica em relação ao vale da triangular.
O valor de ∆d pode ainda ser variado conforme os valores de corrente.
4.9 Resultados do ∆-VSI Operando em Malha Aberta
Para validar o funcionamento das estratégias de modulação pro-

postas para o ∆-VSI, um protótipo de um conversor back-to-back, mos-
trado na Figura 4.17, foi adaptado para funcionar como um ∆-VSI.
4.9 Resultados do ∆-VSI Operando em Malha Aberta 79
Figura 4.16: Implementação da estratégia que concentram as perdas de comu-

tação nos interruptores em estrela para modulações baseadas em portadoras.
Figura 4.17: Conversor Back-to-Back adaptado para funcionar como um ∆-

VSI.
4.9.1 Resultado para as Modulações Tradicionais

A Figura 4.18 mostra as tensões de linha aplicadas pelo conver-
sor juntamente com a corrente de fase ia para as SVPWM e DPWM1.
Como em um 2L-VSI, as tensões de fase apresentam apenas dois níveis
de tensão. A frequência de comutação foi reduzida a 1.980 Hz com o
intuito de visualizar, nos resultados experimentais, os pulsos de gatilho
dos interruptores. As correntes de fase, juntamente com a tensão de
modo comum gerada pelo conversor, para diferentes modulações com
RL, são mostradas na Figura 4.19. A tensão de modo comum é exa-
tamente igual à tensão de modo comum gerada por um 2L-VSI para
modulações equivalentes e pode assumir valores em módulo de Vdc /2 e
Vdc /6 para todas as modulações. As mesmas estratégias de modulação,
agora com RCMV, foram simuladas e são mostradas na Figura 4.20.
Observa-se uma considerável redução nos níveis da tensão de modo
comum que passam a apresentar valores em módulo de 0 e Vdc /6.
4.9.2 Resultados para as Modulações Híbridas

Com o intuito de validar o funcionamento das estratégias híbri-
das propostas na Seção 4.5.3, elas foram simuladas com o conversor
funcionando em malha aberta alimentando uma carga ligeiramente in-
dutiva conforme mostra a Figura 4.21
4.9.3 Problema da Distorção na Entrada e na Saída da Re-

gião de Descontinuidade
Como pode ser visto nos resultados experimentais e de simulação,
as correntes CA apresentam uma pequena distorção de baixa frequência
na entrada e saída das regiões de descontinuidade em modulações des-
contínuas. Isso ocorre devido à aplicação de uma sequência de vetores
diferente em relação às sequências originadas das modulações vetoriais.
Para minimizar essas distorções nas CBPWM, pode-se sincronizar a
atualização dos sinais moduladores com a frequência de comutação e,
em alguns casos, inverter o sinal da portadora nos momentos de entrada
e saída da descontinuidade.
4.9.4 Detalhe da Transição Entre Vetores

A estratégia de transição entre vetores em que as perdas por co-
mutação ficam concentradas nos interruptores em estrela foi implemen-
Figura 4.18: Resultados experimentais da corrente de fase ia (5 A/Div),

as tensões de linha (100 V/Div), os sinais de gatilho dos interruptores em
estrela superiores (GSap , GSbp , GScp ) e os sinais de gatilho complementares
dos interruptores em delta (GSab , GSbc , GSca ) para diferentes estratégias
de modulação com RL: (a) SVPWM; (b) DPWM1. Índice de modulação
M = 0,71, Vdc = 50 V, frequência fundamental ff = 60 Hz, frequência de
comutação fs = 1.980 Hz, carga em estrela com indutância L = 2,57 mH em
série com uma resistência R = 7,5 Ω.
Figura 4.19: Resultados experimentais das correntes de fase (2 A/Div), ten-

são de modo comum vcm = (vag + vbg + vcg )/3, ver Figura 4.2, (20 V/Div),
sinais de gatilho dos interruptores em estrela superiores (GSap , GSbp , GScp ) e
os sinais de gatilho complementares dos interruptores em delta (GSab , GSbc ,
GSca ) para diferentes estratégias de modulação com RL: (a) SPWM; (b)
SVPWM; (c) DPWM3; (d) DPWM0; (f) DPWM1 (g) DPWM2. Índice de
modulação M = 0,71, Vdc = 50 V, frequência fundamental ff = 60 Hz, frequên-
cia de comutação fs = 1.980 Hz, carga em estrela com indutância L = 2,57 mH
em série com uma resistência R = 7,5 Ω.
Figura 4.20: Resultados de simulação das correntes de fase (1 A/Div), tensão

de modo comum vcm = (van + vbn + vcn )/3, ver Figura 4.2 (2 V/Div), sinais
de gatilho dos interruptores em estrela superiores (GSap , GSbp , GScp ) e os
sinais de gatilho complementares dos interruptores em delta (GSab , GSbc ,
GSca ) para diferentes estratégias de modulação com RCMV: (a) SPWM;
(b) SVPWM; (c) DPWM1; (d) DPWM3. Índice de modulação M = 0,71,
Vdc = 50 V, frequência fundamental ff = 60 Hz, frequência de comutação
fs = 1.980 Hz, carga em estrela com indutância L = 2,57 mH em série com
uma resistência R = 7,5 Ω.
tada. A Figura 4.22 mostra o resultado experimental de um período de

comutação do ∆-VSI operando com uma modulação descontínua, para
os padrões de pulsos contidos na Figura 3.12 (a).
A Figura 4.22 (a) mostra o padrão de pulso onde o vetor nulo se
localiza no centro da janela de comutação. No período t0 − t1 , o vetor
~1 é aplicado utilizando o estado com RCL. No instante t1 o interruptor
V
Sbc é comandado a bloquear, porém o vetor continua assegurado pelos
interruptores em estrela. No intervalo t1 − t2 , não há nenhum interrup-
tor em delta acionado. No instante t2 , ocorre a mudança de vetor que
pode ser percebida pela mudança do valor da tensão do modo comum.
No intervalo t2 −t3 , continua não havendo nenhum interruptor em delta
acionado. No instante t3 , o interruptor Sab é acionado para formar o
Figura 4.21: Detalhe da simulação das correntes de fase ia ib e ic , da tensão

de linha vSbc , o valor médio quase instantâneo hvSbc i e as funções de razão
cíclica dos interruptores superiores dSap , dSbp , dScp para diferentes estraté-
gias de modulação híbridas com RL dentro de um período da componente
fundamental para a: (a) D1SVPWM; (b) SVD1PWM; (c) D3SVPWM; (d)
SVD3PWM; (e) DPWM13 e (f) DPWM31. Índice de modulação M = 0,71,
Vdc = 760 V, frequência fundamental ff = 60 Hz, frequência de comutação
fs = 19.980 Hz, carga em estrela com indutância L = 2,57 mH em série com
uma resistência R = 7,5 Ω.
Figura 4.22: Resultados experimentais do detalhe da corrente de fase ia , da

corrente delta iad , da tensão sobre o interruptor Sab (vSab ), da tensão de
modo comum vcm , dos sinais de gatilho dos interruptores em estrela superi-
ores GSap , GSbp , GScp e dos sinais de gatilho complementares dos interrup-
tores em delta GSab , GSbc , GSca para uma modulção descontínua de cinco
segmentos em que: (a) d0 = dnull ; (b) d0 = 0.
vetor V~2 com RCL, fato que pode ser verificado com o crescimento da
corrente iad da Figura 2.7. No instante t4 , ocorre a troca para o vetor
~0 , que pode ser visto pela mudança da tensão de modo comum para
V
0 V. No instante t6 , os outros dois interruptores em delta são acio-
nados para realizar o vetor nulo com RCL. Observa-se que a corrente
de fase é praticamente toda desviada para os interruptores em delta e

que a tensão de modo comum não sofre alteração, pois os interruptores
superiores continuam ligados. A análise dos intevalos restantes e dos
intervalos da Figura 4.22 (b) pode ser feita de maneira análoga à já
apresentada até o momento.
A Figura 4.23 mostra uma simulação contendo as perdas instan-
tâneas dos interruptores Sap e Sbc . Como pode ser verificado, aplicando
Figura 4.23: Potência instantânea nos interruptores Sap e Sbc .
a técnica da Figura 4.22 , as perdas por comutação ficam concentradas

apenas nos interruptores conectados em estrela.
4.10 Conclusão
Neste capítulo foi mostrado que é possível encontrar modula-

ções equivalentes baseadas em portadoras para as modulações vetoriais
contínuas e descontínuas do Capítulo 3. Para isso, foi proposta uma
metodologia que parte do padrão de pulsos que se deseja implementar
nos interruptores e finda com a derivação dos sinais de razão cíclica dos
interruptores em função das funções de razão cíclica de referência. Esse
procedimento pode ser estendido para outros conversores trifásicos.
As funções de razão cíclica dos interruptores conectados em delta
foram encontrados em função das funções de razão cíclica dos interrup-
tores conectados em estrela. Dessa forma, para qualquer estratégia de
modulação que seja utilizada nos interruptores em estrela, um padrão
de pulsos adequado é obtido para os interruptores em delta. Ao longo
4.10 Conclusão 87
do estudo da geração dos sinais dos interruptores em estrela, foram

implementadas estratégias híbridas de modulação que apresentam ca-
racterísticas intermediárias no que diz respeito à TDH e perdas por
comutação em relação às modulações tradicionais. Foi mostrado que
as estratégias de modulação descontínuas baseadas em portadoras não
são equivalentes às descontínuas vetoriais no instante da entrada e da
saída da região de não modulação. Para reduzir esse efeito, é possível
realizar a inversão da portadora durante as transições.
Nas estratégias com RL são necessários dois sinais moduladores
por interruptor bidirecional conectado em delta e um para cada braço
de interruptor conectado em estrela. Já nas estratégias de modulação
com RCMV, os interruptores em estrela não operam de forma comple-
mentar e, portanto, também necessitariam de dois sinais moduladores
para serem comandados. Um circuito lógico adicional foi proposto para
reduzir a complexidade dos moduladores.
A concentração das perdas por comutação apenas nos interrupto-
res em estrela pode ser implementada realizando apenas o deslocamento
vertical das funções de razão cíclica proporcional ao tempo de entrada
em condução e de bloqueio dos interruptores em estrela.
Os resultados experimentais e de simulação apresentados neste
capítulo validaram a operacionalidade das estratégias de modulação e
de comutação propostas para o ∆-VSI.
89
5 ANÁLISE DO DESEMPENHO DO ∆-VSI
Neste capítulo, o desempenho do ∆-VSI no que diz respeito aos

esforços de corrente, perdas nos semicondutores, ondulação das corren-
tes de fase e geração de tensão de modo comum foram avaliados. A
análise descrita foi realizada para as modulações contínuas e descontí-
nuas permitindo ao projetista otimizar o desempenho do conversor de
acordo com a aplicação. Para identificar as vantagens e desvantagens
da topologia ∆-VSI em relação à topologia do VSI um estudo de caso
foi realizado.
5.1 Descrição do Estudo de Caso
Desempenho e custo de produção são dois aspectos importantes

que devem ser levados em consideração antes da escolha de uma to-
pologia para uma determinada aplicação. Existem aplicações críticas
onde o conversor, muitas vezes, tem de fornecer energia com baixos
níveis de emissões de alta frequência, e (ou) com elevado rendimento e
(ou) processar elevada densidade de energia. Nesses casos, é aceitável
escolher topologias mais complexas e com maior custo de produção que
as soluções tradicionais, mas que atendam aos requisitos exigidos. Em
outras aplicações, o custo é o fator decisivo e soluções mais simples que
empregam menos componentes são candidatas fortes a serem adotadas.
Para avaliar a viabilidade de utilização do ∆-VSI nas duas si-
tuações descritas, um estudo de caso foi realizado que o compara com
a solução padrão da indústria para inversores trifásicos operando com
baixa tensão, o 2L-VSI.
Como mostrado no Capítulo 2, o ∆-VSI possui seis interruptores
a mais que um 2L-VSI convencional e, portanto, maior área de silício
total. Para verificar as melhorias que a adição dos interruptores causa,
o ∆-VSI foi comparado com um 2L-VSI utilizando seis interruptores.
É natural que conversores que utilizam maior área de silício que outras
tenham desempenho, seja em relação a rendimento ou a EMI, superior à
outras que possuam menor área de silício total. Nesses casos, o aumento
do desempenho é obtido com maior custo de produção.
O custo de fabricação de um conversor é fortemente influenciado
pela a área necessária de silício para processar a energia. Uma técnica
encontrada na literatura para realizar a comparação entre duas topo-
logias levando em conta o custo de produção se baseia em analisar o
90 5 Análise do Desempenho do ∆-VSI
desempenho dos conversores construídos com a mesma área de silício

total [9], [65]. Em outras palavras, considerou-se que cada interruptor
do 2L-VSI utiliza um interruptor equivalente a dois dos utilizados para
cada dispositivo do ∆-VSI. Igualando a área de silício, consequente-
mente o custo com semicondutores, é possível então avaliar os ganhos
obtidos inerentes à topologia.
5.2 Esforços de Corrente nos Interruptores
Como foi visto no Capítulo 3, a corrente que circula pelos se-

micondutores não é totalmente definida pelo estado de comutação de
cada vetor. Isto quer dizer que, quando um interruptor do circuito em
delta é acionado, em determinados estados de comutação, surgem ca-
minhos paralelos para a circulação das correntes de fase. Dessa forma,
a corrente nos semicondutores passa também a ser influenciada pe-
las características de condução dos componentes. Os datasheets dos
dispositivos semicondutores geralmente trazem curvas características
que relacionam tensão de polarização com a corrente que atravessa o
componente. Essas curvas dependem da tecnologia dos componentes,
da Temperatura na Junção (Tj ) e da tensão de gate para transistores
sendo, dessa forma, geralmente funções não lineares.
Para que os esforços de corrente fossem calculados de maneira a
considerar a divisão de corrente entre os dispositivos em paralelo, um
modelo mais simplificado para condução foi utilizado para os semicon-
dutores. Os IGBTs, os RB-IGBTs, os diodos e os MOSFETs foram
modelados como uma fonte de tensão em série com uma resistência
como mostrado na Figura 5.1.
Figura 5.1: Modelo equivalente de condução simplificado para diferentes tipos

de semicondutores, incluindo o interruptor genérico, onde i ∈ {a, b, c} e j ∈
{a, b, c, p, n} com i 6= j.
As Figuras 3.7 e 3.9 e mostraram que, para cada vetor aplicado

pelo conversor, diferentes interruptores são acionados e, consequente-
5.2 Esforços de Corrente nos Interruptores 91
mente, diferentes circuitos equivalentes são formados. Para o cálculo

dos esforços nos semicondutores, é suficiente que se estude o compor-
tamento das correntes nos circuitos equivalentes em que um mesmo
interruptor é acionado. Os esforços de corrente foram calculados para
os semicondutores Sap , Dap e Sbc do ∆-VSI (ver Figura 2.7) e para os
semicondutores S1p , D1p do VSI (ver Figura 2.1).
Os interruptores citados para o ∆-VSI são acionados durante a
aplicação dos vetores 1, 2, 4, 6 e nulo. Os circuitos equivalentes formados
quando os vetores ativos são realizados com RCL e quando os vetores
nulos são formados com RCL, RCMV e da mesma forma que o VSI, são
mostrados na Figura 5.2. O interruptor Sap é comandado a conduzir
nos vetores 1, 2, 6 e nulo (RCL e VSI). Nesses vetores a corrente pode
circular tanto pelo interruptor controlado quanto pelo interruptor não
controlado dependendo do sentido das correntes de fase. O interruptor
Sbc é comandado a conduzir na aplicação dos vetores 1, 4 e nulos (RCL
e RCMV). Nesses vetores, a corrente pode circular tanto no sentido po-
sitivo quanto no sentido negativo, dependendo do sentido das correntes
de fase ib e ic .
Para o cálculo dos esforços de corrente, é necessário que a envol-
tória de corrente que circula pelos dispositivos seja calculada para cada
um dos vetores citados acima. Mesmo adotando um modelo mais sim-
plificado para os interruptores, a envoltória de corrente para o ∆-VSI
foi calculada utilizando um algoritmo devido às várias possibilidades de
caminhos para a corrente em cada estado de comutação. O algoritmo
utilizado para o cálculo das envoltórias de corrente, considerando as
fontes de tensão dos modelos dos interruptores, é mostrado no Apên-
dice A.
Para realizar o estudo de caso descrito na Seção 5.1, foram utili-
zados interruptores MOSFETs. Para sistemas que processam potências
inferiores a 10 kW, operando em baixa tensão (<800 V) os MOSFETs,
sejam de silício ou de carbeto de silício, apresentam, geralmente, me-
nores perdas que os IGBTs. Como, atualmente, os MOSFETs SiC são
os que possuem melhores características de condução e de comutação,
foram escolhidos para esta aplicação.
As funções que definem envoltórias de corrente nos semicondu-
tores foram derivadas considerando algumas hipóteses simplificadoras.
Foi assumido que:
• As correntes de fase não apresentam ondulação e são definidas
conforme (4.44) e ilustradas na Figura 5.3. O fator de potência
Figura 5.2: Circuitos equivalentes de condução do ∆-VSI para os veto-

res: (a)V~1,RCL ; (b)V
~2,RCL ; (c)V
~4,RCL ; (d)V
~6,RCL ; (e)V
~0,RCMV ; (f)V
~0,RCL1 ;
(g)V0,VSI .
~
é, portanto, definido apenas pelo Ângulo de Deslocamento (δ);

• MOSFETs idênticos são utilizados para a realização dos interrup-
tores em estrela e dos interruptores bidirecionais em delta e para
a realização dos interruptores do 2L-VSI, conforme mostrado na
Figura 5.4;
• a tensão de condução dos diodos intrínsecos aos MOSFETs é
Figura 5.3: Formas de onda das correntes e das tensões consideradas para o
cálculo dos esforços de corrente e das perdas nos conversores.
Figura 5.4: Circuitos utilizados para realizar o estudo de caso: (a) ∆-VSI
composto com mosfets; (b) 2L-VSI composto por MOSFETs.
muito maior que as tensões de condução dos canais dos MOS-

FETs. Dessa forma, a corrente vai sempre fluir totalmente pelo
canal durante os momentos que em ocorre a retificação síncrona 1 ,
1 Técnica utilizada para redução de perdas em conversores que utilizam a tecno-
logia MOSFET. Nos períodos em que a corrente deveria ser conduzida pelos diodos
de roda livre, o MOSFET é acionado através do sinal de gatilho.
conforme mostrado na Figura 5.5;
Figura 5.5: Caminho para as correntes nos interruptores MOSFETs para um

interruptor: (a) bidirecional em tensão e em corrente conectado em delta; (b)
conectado em estrela; (c) conectado em estrela composto por dois MOSFETs
em paralelo.
• a corrente é dividida igualmente pelos MOSFETs operando em

paralelo, conforme mostrado na Figura 5.5.
Adotando as considerações descritas anteriormente, os circuitos

equivalentes da Figura 5.2 podem ser simplificados para os da Figura 5.6
Figura 5.6: Circuitos equivalentes de condução do ∆-VSI utilizando

MOSFETs para os vetores: (a)V ~1,RCL ; (b)V
~2,RCL ; (c)V
~4,RCL ; (d)V
~6,RCL ;
(e)V
~0,RCMV ; (f)V
~0,RCL1 ; (g)V
~0,VSI .
A expressão que descreve a envoltória de corrente que circula no

canal do interruptor Sap durante a aplicação dos vetores ativos pode ser
obtida utilizando a lei dos nós nos circuitos equivalentes da Figura 5.6
(a), (b) e (d) e é dada por


 iSap,V~ 1,RCL (δ) = |ia (δ)|


3ia (δ) + ib (δ)


iSap,V~ 2,RCL (δ) =
4 . (5.1)

3i (δ) + ic (δ)


 a
 iSap,V~ 6,RCL (δ) =

4
Para o restante dos vetores ativos, a corrente em Sap é nula. Deve

ser observado que, embora a corrente no canal do MOSFET apresente
valores positivos e negativos, para o cálculo de esforços e de perdas,
essa corrente deve ser considerada sempre positiva.
Como será visto, a corrente nos interruptores pode variar bas-
tante dependendo do estado utilizado para implementar o vetor nulo. O
valor da envoltória de corrente que circula por Sap durante a aplicação
de V~0,VSI é calculado por
(
iSap,V~ 0,VSI1 (δ) = |ia (δ)|
. (5.2)
iSap,V~ 0,VSI2 (δ) = 0
Para o vetor nulo V

~0,RCL , a corrente em Sap é expressa por

|2ia (δ)|
iSap,V~ 0,RCL1 (δ) =

5 . (5.3)
 i (δ) = 0
~ 0,RCL2
Sap,V
Se o vetor nulo for aplicado com V

~0,RCMV
iSap,V~ 0,RCMV (δ) = 0. (5.4)
Para o interruptor Sbc as envoltórias de corrente para os vetores

ativos são

 i |ib (δ) − ic (δ)|
~ 1,RCL (δ) =

Sbc,V
4
|ib (δ) − ic (δ)| (5.5)
 i

~ 4,RCL (δ) =
Sbc,V
4
As envoltórias de corrente do interruptor Sbc durante a aplicação dos
vetores nulos são expressas por
iSbc,V~ 0,VSI (δ) = 0, (5.6)
|ib (δ) − ic (δ)|

iSbc,V~ 0,RCL (δ) = (5.7)
5
e
|ib (δ) − ic (δ)|
iSbc,V~ 0,RCMV (δ) = . (5.8)
3
Observa-se que com as simplificações adotadas as envoltórias de
corrente adquirem valores independentes dos parâmetros dos interrup-
tores. As envoltórias de corrente que podem circular em cada semicon-
dutor foram calculadas para uma faixa de ângulo de fator de potência
δ 2 que varia entre 0 a π.
A partir das envoltórias calculadas, é possível calcular os valores
médio e eficaz das correntes nos interruptores do ∆-VSI em relação ao
índice de modulação e o ângulo de fator de potência δ. Para simpli-
ficar a notação das equações, o símbolo θ foi omitido dos argumentos
das funções das envoltórias de corrente e das funções de modulação.
Também foi omitida a abreviação RCL nas funções que definem as cor-
rentes dos vetores ativos. O valor médio da corrente nos interruptores
em estrela é calculado por
iSap,med (M, δ) =
 Z 
π/3
 [d1 (M )iSap,V 1 (δ) + d2 (M )iSap,V 2 (δ)] dθ+ 
 0 
 Z 2π/3 Z 5π/3 
  ,
1 
 d1 (M )iSap,V 2 (δ)dθ + d2 (M )iSap,V 6 (δ)dθ+ 

π/3 4π/3
2π 
 2πZ 


 [d1 (M )iSap,V 6 (δ) + d2 (M )iSap,V 1 (δ)] dθ+ 

 5π/3 
fSap,V~0 ,med (M, δ)
(5.9)
2 Foi considerado neste trabalho que, quando δ = 0, o fator de potência é unitário
e o conversor trabalha como retificador. Quando δ = π, o fator de potência é

também unitário, porém negativo, e o conversor opera como inversor.
onde
fSap,V~0 ,med (M, δ) =

1 2π
 Z

 d0 (M )iSap,V~ 0,VSI (δ)dθ se Vetor nulo V
~0,VSI1
 Z2 2π0



 ,
d0 (M )iSap,V~ 0,RCMV (δ)dθ se Vetor nulo V
~0,RCMV

 0Z
 2π
 1

Vetor nulo V
~0,RCL1

d0 (M )iSap,V~ 0,RCL1 (δ)dθ se

2 0
(5.10)
O valor eficaz da corrente nos interruptores em estrela é dado
por
iSap,rms (M, δ)2 =

 Z π/3 h i 
2 2
 d1 (M )iSap,V 1 (δ) + d2 (M )iSap,V 2 (δ) dθ+ 
 Z0 
 2π/3 
2
d1 (M )iSap,V 2 (δ) dθ+
 
 
 π/3  ,
1 
 5π/3
Z 
2 
2π 
 d2 (M )iSap,V 6 (δ) dθ+ 

 Z 4π/3 
 2π h i 
2 2

 d1 (M )iSap,V 6 (δ) + d2 (M )iSap,V 1 (δ) dθ+ 

 5π/3 
fSap,V~0 ,rms (M, δ)
(5.11)
onde
fSap,V~0 ,rms (M, δ) =

1 2π
 Z

 d0 (M )iSap,V~ 0,VSI (δ)2 dθ se Vetor nulo V
~0,VSI
2

 Z 2π0



d0 (M )iSap,V~ 0,RCMV (δ)2 dθ se Vetor nulo V
~0,RCMV


 0
Z 2π
 1

d0 (M )iSap,V~ 0,RCL1 (δ)2 dθ Vetor nulo V
~0,RCL .

se

2 0
(5.12)
Se (5.12) for substituída em (5.11) é possível encontrar as expressões
simplificadas
iSap,rms (M, δ, Iˆpk ) =

Iˆ p

 √pk −9M + 8π + 6M cos(2δ) se vetor nulo ~0,VSI

 V
4 2π



 ˆ r

Ipk 3M p .
5 + 2 cos(2δ) se vetor nulo ~0,RCMV
V

 4 2π
Iˆpk p



√ 279M + 32π + 150M cos(2δ) se vetor nulo ~0,RCL
V



20 2π
(5.13)
O valor médio da corrente nos interruptores em delta é calculado
por
iSbc,med (δ, M ) =
 Z π/3 Z π 
 d 1 (M )i Sbc,V 1 (δ)dθ + d2 (M )iSbc,V 4 (δ)dθ+ 
0 2π/3  ,
1  Z 4π/3
 Z 2π 
2π  d1 (M )iSbc,V 4 (δ)dθ + d2 (M )iSbc,V 1 (δ)dθ+
 

 π 5π/3 
fSbc ,V~0 ,med (M, δ)
(5.14)
onde
fSbc,V~0 ,med (M, δ) =

1 2π
 Z

 d0 (M )iSbc,V~ 0,VSI (δ)dθ se vetor nulo V
~0,VSI
2 0




 Z 2π .
d0 (M )iSbc,V~ 0,RCMV (δ)dθ se vetor nulo V
~0,RCMV

 0Z
 1 2π

vetor nulo V
~0,RCL

d0 (M )iSbc,V~ 0,RCL (δ)dθ se


2 0
(5.15)
O valor eficaz da corrente nos interruptores em delta é calculado
por
iSbc,rms (δ, M )2 =
 Z π/3 Z π 
2 2
 d 1 (M )iSbc,V 1 (δ) dθ + d2 (M )iSbc,V 4 (δ) dθ+ 
0
1  Z 4π/3 Z2π/3
2π
 ,

2 2
2π  d1 (M )iSbc,V 4 (δ) dθ + d2 (M )iSbc,V 1 (δ) dθ+
 

 π 5π/3 
fSbc ,V~0 ,rms (M, δ)
(5.16)
onde
fSbc,V~0 ,rms (M, δ) =

1 2π
 Z

 d0 (M )iSbc,V~ 0,VSI (δ)2 dθ se vetor nulo V
~0,VSI
2

 Z 2π0


 .
d0 (M )iSbc,V~ 0,RCMV (δ)2 dθ se vetor nulo V
~0,RCMV


 0 Z 2π
 1

d0 (M )iSbc,V~ 0,RCL (δ)2 dθ vetor nulo V
~0,RCL

se

2 0
(5.17)
Se (5.17) for substituída em (5.16) é possível encontrar as expressões
simplificadas
iSbc,rms (M, δ, Iˆpk ) =

 √
Iˆpk M p
√ 3 − 2 cos(2δ) vetor nulo V
~0,VSI


 se
 4 √2π




Iˆpk M p .
√ −39M + 16π − 6M cos(2δ) se vetor nulo V
~0,RCMV

 4 6π
Iˆpk p


vetor nulo V
~0,RCL

√ −69M + 48π − 50M cos(2δ) se



20 2π
(5.18)
A Tabela 5.1 mostra os valores de corrente eficaz para os in-
terruptores conectados em delta e em estrela obtidos através de simu-
lações e através das expressões deduzidas. Os valores foram obtidos
para diferentes ângulos de fator de potência. Os valores médio e eficaz
das correntes nos interruptores em delta e em estrela parametrizados
em relação a corrente de pico CA são mostrados na Figura 5.7 para
M = 0,709.
O valor eficaz da corrente nos interruptores conectados em delta e

dos interruptores conectados em estrela obtidos pelas expressões (5.13)
(5.18) foram parametrizados em relação a corrente de pico média no
lado CA e são mostrados na Figura 5.8, variando o ângulo de fator de
potência de 0 a π e o índice de modulação de 0 a 1.
Tabela 5.1: Comparação dos valores eficazes simulados e calculados com as

expressões deduzidas.
Interruptores Conectados em Estrela

~0,VSI
V ~0,RCMV
V ~0,RCL
V
Simu. Calc. Simu. Calc. Simu. Calc.
δ = π/4 9,34 A 9,28 A 7,01 A 6,99 A 7,43 A 7,41 A
δ = π/2 8,23 A 8,16 A 5,45 A 5,42 A 5,98 A 5,94 A
δ=π 10,31 A 10,28 A 8,27 A 8,27 A 8,62 A 8.62 A
Interruptores Conectados em Delta
V~0,VSI ~0,RCMV
V ~0,RCL
V
Simu. Calc. Simu. Calc. Simu. Calc.
δ = π/4 3,12 A 3,12 A 5,86 A 5,88 A 4,31 A 4,32 A
δ = π/2 4,04 A 4.04 A 6,41 A 6,41 A 5,02 A 5.02 A
δ=π 1,73 A 1,80 A 5,28 A 5,30 A 3,49 A 3,49 A
Dependendo do estado do vetor nulo que esteja sendo aplicado

pelo conversor, os esforços de corrente apresentam comportamentos di-
ferentes à variação de M e de δ. Observa-se pela Figura 5.8 que, quando
o vetor nulo é aplicado com o estado em que apenas os interruptores
conectados em estrela são utilizados (V~0,VSI ), há uma tendência desses
componentes sofrerem maiores esforços de corrente do que os interrup-
tores conectados em delta. No limite, quando M é zero, idealmente
não circula corrente pelos interruptores em delta.
O contrário é verificado quando o vetor nulo é implementado
apenas com os interruptores conectados em delta (V ~0,RCMV ). Esse
comportamento pode ser explicado pelo fato de dnull aumentar com
a diminuição de M , o que aumenta o valor da corrente eficaz nos inter-
ruptores utilizados no vetor nulo. Quando o vetor nulo é implementado
utilizando, simultaneamente, os interruptores conectados em delta e em
Figura 5.7: Valores médios e eficazes para a corrente nos: (a) interruptores
em estrela; (b) interruptores em delta.
estrela, há uma tendência a aumentar os esforços nos interruptores em

delta com a diminuição de M , pois a impedância equivalente do cir-
cuito em delta é menor que a impedância equivalente em estrela. Essa
tendência pode mudar dependendo dos interruptores utilizados.
A Figura 5.9 mostra o valor da corrente eficaz nos interruptores
do 2L-VSI e do ∆-VSI para diferentes valores de M. Observa-se que os
esforços de corrente dos interruptores conectados em estrela aumentam
quando o conversor opera com δ 6= 0 ou δ 6= π e atinge o seu mínimo
Figura 5.8: Valores eficazes das correntes nos interruptores conectados em:
(a) estrela; (b) delta.
em δ = π/2. O contrário é verificado para os interruptores conectados

em delta, ou seja, os menores esforços de corrente são verificados para
operação com fator de potência unitário.
5.3 Perdas nos Semicondutores
As perdas em um conversor eletrônico de potência estão for-

temente ligadas à tecnologia dos interruptores utilizados para a sua
construção e à potência que o mesmo deve ser capaz de processar. Em
aplicações que incluem sistemas fotovoltaicos conectados à rede elétrica
e para o acionamento de máquinas de baixa tensão, são normalmente
utilizados inversores trifásicos em potências superiores a 3 kW. Para
atender este tipo de aplicação, foi escolhido construir um protótipo
capaz de processar 10 kW e que apresentasse elevado rendimento e re-
duzido volume. Para que isso seja possível, o conversor deve apresentar
elevado rendimento operando com elevada frequência de comutação,
pois o volume dos filtros de EMI necessários é inversamente proporci-
onal à frequência de comutação do conversor.
A utilização de dispositivos de silício como IGBTs para imple-
mentação dos interruptores em estrela e de RB-IGBTs para os inter-
ruptores em delta foi levada em consideração. Entretanto, foi verificado
na prática, que as perdas do conversor aumentavam demasiadamente
com a frequência de comutação, principalmente, devido ao fenômeno de
comutação dos RB-IGBTs. Para atender aos requisitos determinados,
foram utilizados interruptores MOSFETs SiC de 1.200 V para a im-
5.3 Perdas nos Semicondutores 103
Figura 5.9: Comparação entre os valores eficazes das correntes nos interrup-
tores do 2L-VI e do ∆-VSI para diferentes valores de M utilizando o: (a)
vetor nulo V
~0,VSI ; (b) vetor nulo V
~0,RCL ; (c) vetor nulo V
~0,RCMV .
plementação de todos os interruptores. Estes componentes apresentam

perdas reduzidas por comutação, quando comparados com dispositivos
de silício em frequências de comutação mais elevadas.
O interruptor utilizado para o cálculo de perdas foi o MOSFET
da empresa CREE CMF20120D. Esse MOSFET é capaz de conduzir
correntes com valor eficaz de até 24 A operando a 100◦ C. As especifica-
ções de projeto utilizadas para o cálculo das perdas nos semicondutores
foram reunidas na Tabela 5.2
As perdas devido à condução e comutação das correntes de fase
Tabela 5.2: Parâmetros utilizados para o cálculo de perdas nos interruptores.
Parâmetro Valor
Tensão no Barramento CC (Vcc ) 760 V
Tensão eficaz de linha no lado CA (Vo,rms ) 380 V
Corrente de pico no lado CA (Iˆpk ) 21,5 A
Potência de Saída com FP=1 (Po ) 10 kW
Temperatura na Junção (Tj ) 135◦ C
Frequência da fundamental (ff ) 60 Hz
Frequência de comutação(fs ) 19.960 Hz
Interruptor Utilizado CMF20120D
foram calculadas e verificadas via simulação numérica para as diferentes

estratégias de modulação. Na Seção 5.3.3 as perdas totais são obtidas
e comparadas com as perdas de um 2L-VSI.
5.3.1 Perdas por Condução

O cálculo das perdas nos semicondutores pode ser feito baseado
em medições experimentais [66] ou em dados fornecidos nas folhas de
dados dos componentes. Para o cálculo das perdas em condução em
MOSFETs, o gráfico id vs. vds (id ) é utilizado para aproximar curvas
P erdas(id ) vs. id . A Figura 5.10 (b) mostra o comportamento das
curvas aproximadas P erdas(id ) vs. id junto com os pontos retirados da
folha de dados para duas temperaturas diferentes.
As curvas são aproximações polinomiais de segunda ordem dadas
pelas equações
(
PMosfet,25 (ic ) = b0 + b1 ic + b2 ic 2 = −0,04ic + 0,079ic 2
. (5.19)
PMosfet,135 (ic ) = −0,06ic + 0,11ic 2
Uma aproximação linear pode ser feita para encontrar as curvas de

perdas para outras temperaturas como ilustra a Figura 5.10 (a)
PMosfet,cond (T, ic ) = (c1 + c2 T ) ic + (d1 + d2 T ) ic 2 =

(5.20)
= (−0, 03 − 0.0002T ) ic + (0, 07 + 0.0003T ) ic 2 .
Figura 5.10: Gráficos P erdas(id ) vs. id do componente MOSFET

CMF20120D: (a) perdas por condução; (b) vista inferior do gráfico do
item (a).
Como a curva id vs. vds (id ) do MOSFET pode ser aproximada

por uma reta com uma precisão aceitável, as perdas por condução são
consideradas exclusivamente resistivas e podem ser calculadas por
PMosfet,cond (δ) = IRms (δ)2 RM . (5.21)

As perdas por condução totais do conversor e do 2L-VSI foram
calculadas para as condições descritas na Tabela 5.2 e o resultado é
mostrado na Figura 5.11 variando ângulo de fator de potência de 0 a π.
Percebe-se que, para esse índice de modulação, as perdas por condu-
ção do ∆-VSI são menores que um 2L-VSI utilizando seis MOSFETs,
porém maiores que as do 2L-VSI utilizando o dobro de área de silício,
independente do vetor nulo empregado nas modulações. Isso significa
que, em se tratando de perdas por condução, o 2L-VSI com capaci-
dade de corrente equivalente é mais vantajoso em termos de custo com
semicondutores que o ∆-VSI para M = 0 709.
Observa-se também pela Figura 5.11 que as perdas por condu-
ção do ∆-VSI utilizando o V ~0,VSI são maiores que as perdas utilizando
o V0,RCMV . Esse fato se deve à impedância do circuito equivalente
~
formado pelos interruptores em delta ser menor que a impedância do
circuito conectado em estrela, conforme mostrado na Figura 5.12.
Uma vez que as perdas por condução são proporcionais às resis-
tências equivalentes da Figura 5.12, observa-se uma redução de 33% nas
perdas de condução durante a aplicação do vetor nulo quando V ~0,RCMV
Figura 5.11: Perdas totais por condução do ∆-VSI e do 2L-VSI para M =

0,709.
é utilizado. As perdas durante a aplicação do vetor nulo podem ser

ainda mais reduzidas se V ~0,RCL for utilizado. Nesse caso, a redução na
perdas é de 60% em relação ao V ~0,VSI . O impacto da utilização do cir-
cuito em delta para redução das perdas por condução pode ser melhor
visualizado na Figura 5.13.
Com a diminuição do índice de modulação, percebe-se que as per-
das por condução do ∆-VSI, como nos esforços de corrente, apresentam
comportamentos diferentes dependendo do estado utilizado para rea-
lizar o vetor nulo. Quando o vetor nulo é feito utilizando apenas os
interruptores em estrela, há uma tendência das perdas por condução
se igualarem às perdas de um 2L-VSI com seis MOSFETs. Quando o
vetor nulo é aplicado com os interruptores em delta, ao contrário do
vetor anterior, há uma tendência das perdas reduzirem com o índice de
modulação. Se o ∆-VSI é construído com os mesmo interruptores que
o 2L-VSI com interruptores em paralelo, as perdas do ∆-VSI sempre
serão maiores. Se os interruptores em estrela e em delta são utilizados
simultaneamente para realizar o vetor nulo, as perdas totais do ∆-VSI
podem chegar a ser menores que em um 2L-VSI com interruptores em
paralelo. Esse resultado é bastante interessante, pois mostra que os
interruptores conectados em delta utilizam melhor a área de silício do
que quando conectados em estrela para a implementação do vetor nulo.
Se o gráfico da Figura 5.13 (a) é visualizado por baixo, é possível
Figura 5.12: Simplificação do circuito equivalente de perdas para: (a)

~0,RCMV ; (b) V
V ~0,RCL ; (c) V
~0,VSI .
Figura 5.13: Perdas totais por condução do ∆-VSI juntamente com as perdas
totais do 2L-VSI: (a) perdas totais por condução; (b) vista inferior do gráfico
do item (a).
identificar os valores de M em que as perdas por condução do ∆-VSI

passam a ser menores que as do 2L-VSI com interruptores em paralelo,
conforme mostrado na Figura 5.13 (b). Na medida em que o ângulo δ
fica mais próximo de π/2, o ∆-VSI começa a apresentar menores perdas

por condução que o 2L-VSI com interruptores em paralelos para valores
maiores de M . Quão mais claro é a região colorida da Figura 5.13 (b),
menores são as perdas por condução.
Esta característica do ∆-VSI de ser mais eficiente, quando opera
com índice de modulação mais baixo, pode ser explorada em sistemas
de acionamento de máquinas elétricas para veículos elétricos ou para o
setor industrial, que precisam estar constantemente partindo e parando
em seu funcionamento normal.
5.3.2 Perdas por Comutação

Uma das vantagens em se dividir a área de silício do conversor
em mais interruptores é a possibilidade de concentrar os esforços de co-
mutação nos dispositivos com melhores características de comutação.
Para o cálculo das perdas por comutação do ∆-VSI, será considerado
que o conversor opera com a estratégia de transição entre vetores des-
crita na Seção 4.9.4 que concentra as perdas por comutação idealmente
apenas nos interruptores conectados em estrela.
No estudo de caso que vem sendo realizado até então, todos os
interruptores do ∆-VSI e do 2L-VSI são realizados com o MOSFET SiC
CMF20120D. As perdas por comutação de interruptores MOSFETs são,
em grande maioria, devido à carga e descarga dos capacitores parasi-
tas entre o dreno e a fonte [67]. Portanto, as perdas de comutação
nos MOSFETs operando em paralelo serão consideradas o dobro das
perdas por comutação de apenas um MOSFET, conforme mostrado na
Figura 5.14 (a).
As perdas por comutação foram calculadas com base nos dados
de energia de comutação contidos nas folhas de dados dos componen-
tes 3 . Para obter maior fidelidade com os resultados práticos, as curvas
podem ser obtidas através de ensaios com as amostras dos componentes
que serão utilizados no protótipo.
Seguindo a mesma metodologia adotada em [68], as energias de
comutação (Eon e Eoff ) são somadas e os resultados obtidos são uti-
lizados para a obtenção de uma função polinomial de segunda ordem
que permite encontrar as energias de comutação para outros pontos
3 Ao se considerar os dados do datasheet foi assumido que as perdas por comuta-
ção pouco variam com o aumento da temperatura e que o comportamento do diodo

utilizado para os testes é similar ao diodo intrínseco do MOSFET.
de operação. Se existirem dados de energias de comutação para vá-

rias temperaturas, aproximações podem ser feitas também levando em
consideração essa variação.
A função de energia de comutação obtida para os MOSFETs
CMF20120D é dada por
Etot (id ) = b0 + b1 id + b2 i2d = (77 + 8,52id + 0,95id 2 ) · 10−6 [J] (5.22)
e mostrada na Figura 5.14.
Figura 5.14: Energia dissipada durante a comutação do MOSFET SiC

CMF20120D.
As perdas por comutação para as modulações contínuas e des-

contínuas convencionais podem ser calculadas conforme as expressões
Z 2π
Vdc 1
PCom,SVPWM = E(ia (δ))dθ , (5.23)
Vdata 2πfs 0
PCom,GDPWM = !
(5.24)
Z 5π/6+φ Z 11π/6+φ
Vdc 1
E(ia (δ))dθ + E(ia (δ))dθ
Vdata 2πfs π/6+φ 7π/6+φ
PCom,DPWM3 =
 Z π/6 Z 2π/3 
 E(ia (δ))dθ + E(ia (δ))dθ+ 
 0Z π/3 
7π/6 5π/3
Vdc 1 
Z 
 + E(ia (δ))dθ + E(ia (δ))dθ+ ,
 
Vdata 2πfs 
 Z5π/6 4π/3 
2π

 
+ E(ia (δ))dθ
11π/6
(5.25)
onde Vdata é a tensão na qual foram realizados os testes de comutação
do datasheet e φ um ângulo que idealmente deve ser igual ao ângulo de
deslocamento δ entre tensão e corrente de fase para que haja maiores
ganhos de eficiência.
Os intervalos de integração representam as regiões em que há co-
mutação dentro de um ciclo da fundamental das funções de modulação.
A figura Figura 5.15 mostra as perdas por comutação calculadas para
o ∆-VSI para as modulações estudadas. Observa-se que as perdas por
comutação são mínimas para as estratégias de modulação diferentes
dependendo do ângulo δ.
As perdas por comutação nas modulações descontínuas podem
chegar a 50% das perdas por comutação de quando a SVPWM é uti-
lizada. Para aplicações onde se exija que o conversor opere sempre
da maneira mais eficiente possível, independente do ângulo de fator
de potencia, as estratégias de modulação podem ser alternadas sempre
para a que leva a menores perdas, conforme proposto em [59], [60]. A
Figura 5.16 mostra o algoritmo que escolhe sempre a modulação mais
eficiente a partir da determinação do ângulo φ proveniente das leis de
controle do conversor ou das medidas das correntes de fase. Embora
as modulações descontínuas reduzam as perdas por comutação, para
índices de modulação menores, a distorção causada nas correntes de
fase devido às regiões de sobremodulação, são geralmente inaceitáveis
para a maioria das aplicações.
5.3.3 Perdas Totais nos Interruptores

As perdas totais nos semicondutores são calculadas a partir da
soma das perdas por comutação e condução de todos os interruptores
da topologia. As perdas totais foram comparadas entre o 2L-VSI e o
Figura 5.15: Perdas por comutação para o ∆-VSI, considerando a estraté-

gia de comutação em que só os interruptores em estrela comutam de forma
dissipativa, para diferentes estratégias de modulação.
Figura 5.16: Algoritmo utilizado para minimização das perdas por comutação
do ∆-VSI ou do 2L-VSI.
∆-VSI.
A Figura 5.17 mostra as perdas totais do ∆-VSI e do 2L-VSI
variando δ para as estratégias de modulação DPWM1 e SVPWM.
Observa-se que, para o índice de modulação M = 0,709, as per-
das totais nos semicondutores do ∆-VSI são mínimas quando δ = π/2
e máximas quando δ = 0 ou δ = π. Esse comportamento mostra que
o conversor proposto é mais adequado para operar com cargas induti-
vas ou capacitivas do que com cargas com fator de potência unitário .
Figura 5.17: Perdas totais por comutação dos conversores ∆-VSI e 2L-VSI
para M = 0,709 em função de δ para as estratégias de modulação: (a)
DPWM1; (b) SVPWM.
Para a modulação DPWM1 um comportamento contrário é identificado

para o 2L-VSI que é mais eficiente quando opera com fator de potência
unitário.
Como esperado, o conversor ∆-VSI é sempre mais eficiente que
um 2L-VSI com seis interruptores, dadas as condições do estudo de
caso. Entretanto, quando o conversor proposto é comparado com o
2L-VSI com área de silício aumentada, esse fato só é constatado para
algumas condições. À medida que as perdas por comutação aumentam
em relação às perdas totais nos dois conversores, o ∆-VSI tende a ser

mais eficiente. Esse fato pode ser visualizado na Figura 5.17 onde a
faixa de δ em que o ∆-VSI se torna mais eficiente aumenta quando a
SVPWM é utilizada. Esse comportamento também pode ser verificado
através da Figura 5.18, onde M e δ foram mantidos constantes e a
frequência de comutação foi aumentada. Nos gráficos foram marcadas
Figura 5.18: Perdas por comutação do ∆-VSI e do 2L-VSI operando com

M = 0,709 e utilizando a modulação: (a) SVPWM com δ = π; (b) SVPWM
com δ = π/2; (c) DPWM1 com δ = π; (d) DPWM3 com δ = π/2.
as frequências de comutação em que o ∆-VSI começa a ter um rendi-

mento melhor que o 2L-VSI com área de silício aumentada para as três
variações de aplicação do vetor nulo.
Como visto nas seções anteriores, incluindo esta, o ∆-VSI apre-
sentou melhor desempenho que o um 2L-VSI para determinadas con-
dições de operação. Na Seção 5.3.1 foi mostrado que o ∆-VSI é mais
eficiente que o 2L-VSI para baixos índices de modulação e nesta seção
verificou-se que o ∆-VSI é mais eficiente para frequências de comutação
mais elevadas.
5.4 Estudo da Ondulação das Correntes de Fase
O estudo da ondulação de corrente causada pelas tensões em

alta frequência aplicadas na saída do conversor é um dos critérios mais
utlizados para o dimensionamento dos filtros de modo diferencial dos
inversores trifásicos. Como será visto, cada estratégia de modulação
provoca comportamentos diferentes para a ondulação das correntes CA
[69], [70].
Como já visto no Capítulo 3, o ∆-VSI é capaz de aplicar os
mesmos sete vetores espaciais de tensão que um 2L-VSI. Portanto, no
que diz respeito a ondulação de corrente de fase, os dois conversores
são idênticos. A análise da ondulação de corrente será realizada para a
corrente de fase ia considerando um filtro L trifásico com indutâncias
de valores iguais. Cada vetor de tensão do conversor está associado a
um ou mais estados topológicos que aplicam entre fases do conversor
diferentes valores de tensão. Os oito estados topológicos do 2L-VSI são
mostrados na Figura 5.19.
Para cada um dos circuitos da Figura 5.19 é possível deduzir um
circuito equivalente de Thévenin que representa a tensão e a impedância
equivalente vista pela fase a em função das fases b, c e o link CC. Os
circuitos equivalentes são mostrados na Figura 5.20. A equação que
descreve o circuito equivalente gerado pela aplicação do vetor nulo é
dada por
L dia (vb + vc )
L+ + va − = 0. (5.26)
2 dt 2
Isolando a derivada da corrente ia em relação ao tempo e substi-
tuindo as tensões de fase va , vb , vc pelos seus respectivos valores médios
quase instantâneos da Vdc /2, db Vdc /2, dc Vdc /2 obtém-se

dia Vdc db + dc
= − da . (5.27)
dt 3L 2
A equação que descreve o circuito equivalente gerado pela apli-

cação do vetor V
~1 é dada por

L dia (vb + vc )
L+ + va − − Vdc = 0. (5.28)
2 dt 2
Novamente, substituindo as tensões de fase va , vb , vc pelos seus
respectivos valores médios quase instantâneos da Vdc /2, db Vdc /2, dc Vdc /2
5.4 Estudo da Ondulação das Correntes de Fase 115
Figura 5.19: Simplificação dos estados do ∆-VSI por estados equivalentes do

2L-VSI que produzem as mesmas tensões de linha do: (a) V ~0 ; (b) V
~1 ; (c) V
~2 ;
(d) V
~3 ; (e) V
~4 ; (f) V
~5 (f); V
~6 .
e isolando a derivada da corrente ia obtém-se

dia 2Vdc db + dc
= 1+ − da . (5.29)
dt 3L 2
As derivadas de corrente podem, para os demais estados topoló-
gicos, ser encontradas de maneira análoga. O resultado da análise foi re-
sumido na Tabela 5.3. As equações da tabela são válidas para qualquer
modulação contínua e descontínua, uma vez que os termos referentes
Figura 5.20: Circuitos Equivalentes de Thévenin para as fases b e c dos

circuitos da Figura 5.19.
ao sinal de eixo zero são sempre cancelados em sistemas equilibrados.

Para a SVPWM, a ondulação de corrente em um período de
comutação possui 7 partes lineares e é anti-simétrica com relação à
metade da janela de comutação, conforme mostrado na Figura 5.21.
Assumindo que o valor da derivada da ondulação de corrente para o os
vetores V~x e V
~y sejam p1 e p2 , calculados na Tabela 5.3 para todos os
vetores de tensão do conversor. Os vetores V ~x são sempre os vetores
nulos e os vetores Vy são os vetores aplicados após o primeiro vetor nulo
~
da janela de comutação. A máxima ondulação de corrente calculada
para um período de comutação é dada pelo máximo valor de x e y
(Ondmax = max (|x| , |y|)), onde x e y são calculados pela expressão
x = p1 tnull

4 . (5.30)
y = p tnull + p tj
1 2
4 2
Tabela 5.3: Derivadas da corrente de fase ia em relação ao tempo para os

circuitos equivelentes da Figura 5.20.
Vetor Derivada de Corrente (dia /dt)

Vdc db + dc
V0 (0, 0, 0) − da
3L 2

Vdc db + dc
V0 (1, 1, 1) − da
3L 2

2Vdc db + dc da
V1 (1, 0, 0) 1+ −
3L 4 2

2Vdc 1 db + dc da
V2 (1, 1, 0) + −
3L 2 4 2

Vdc db + dc
V3 (0, 1, 0) − 1 − da
3L 2

2Vdc db + dc da
V4 (0, 1, 1) −1 + −
3L 4 2

Vdc db + dc
V5 (0, 0, 1) − 1 − da
3L 2

2Vdc 1 db + dc da
V6 (1, 0, 1) + −
3L 2 4 2
Os valores de tnull e de tj podem ser obtidos por (3.22). O valor de j

varia entre 1 e 2 dependendo do setor. Os vetores que definem p2 e j
podem ser escolhidos inspecionando a Figura 3.14 e foram reunidos na
Tabela 5.4.
Tabela 5.4: Tempos de aplicação dos vetores que definem a ondulação de cor-
rente para todos os seis sextantes do mapa de vetores referentes à modulação
SVPWM.
SI SII SIII SIV SV SVI

tj t1 t2 t1 t2 t1 t2
~
Vy ~
V1 ~
V3 ~
V3 ~
V5 ~
V5 ~
V1
Figura 5.21: Padrões de pulsos do primeiro sextante para modulações con-

tínuas e descontínuas: (a) SVPWM; (b) DPWM (Grampeamento Superior);
(c) DPWM (Grampeamento inferior).
Se as modulações descontínuas são usadas no lugar da SVPWM,

a ondulação de corrente tem um comportamento diferente. Diferen-
temente da SVPWM, a ondulação de corrente possui apenas 5 partes
lineares em um período de comutação. O vetor nulo passa a ser aplicado
em apenas um intervalo dentro do período de comutação. Quando o
vetor nulo é realizado acionando os interruptores em estrela superiores,
o vetor nulo é aplicado no centro da janela de comutação e o padrão
de pulsos em um período de comutação é o mesmo representado pela
Figura 5.21 (b). Já quando o vetor nulo é realizado acionando os in-
terruptores em estrela inferiores, o vetor nulo é aplicado nas bordas da
janela de comutação e o padrão de pulsos em um período de comutação
é o mesmo representado pela Figura 5.21(c).
A máxima ondulação de corrente calculada para um
período de comutação é dado pelo máximo valor de x e y
(Ondmax = max (|x| , |y|)), onde x e y são calculados por
x = p1 tnull

2 . (5.31)
y = p tnull + p tj
1 2
2 2
Para a DPWM1, os valores de tj e de V ~y são mostrados na Tabela 5.5.
DPWM1.

tj t2 t1 t2 t1 t2 t1 t2 t1 t2 t1 t2 t1
~
Vy ~
V2 ~
V1 ~
V3 ~
V2 ~
V4 ~
V3 ~
V5 ~
V4 ~
V6 ~
V5 ~
V1 ~
V6
Já para a DPWM3, os valores de tj e de V

~y são mostrados na
Tabela 5.6.
DPWM3.

tj t1 t2 t1 t2 t1 t2 t1 t2 t1 t2 t1 t2
~y
V ~1
V ~2
V ~2
V ~3
V ~3
V ~4
V ~4
V ~5
V ~5
V ~6
V ~6
V ~1
V
O resultado dos cálculos de ondulação de corrente para as modu-

lações SVPWM, DPWM1 e DPWM3 podem ser visualizados na Figura
5.22. Os resultados obtidos foram normalizados pelo fator Vdc /3Lfs ,
comum à todas as expressões. A Figura 5.22(a) mostra uma com-
paração entre as ondulações máximas de corrente para as SVPWM e
DPWM1 para os índices de modulação M = 0,5 e M = 0,7. Observa-se
que as ondulações máximas da DPWM1 são sempre maiores que as on-
dulações máximas da SVPWM. A Figura 5.22(b) mostra que o mesmo
não ocorre quando a SVPWM é comparada com a DPWM3. Existem
algumas regiões entre π/3 e 2π/3 e entre 4π/3 e 5π/3 que a SVPWM
apresenta maiores valores de ondulação, apesar de o pico de máxima
ondulação ser maior para a DPWM3. Quando as duas modulações des-
contínuas são comparadas, o que se observa é que a DPWM1 apresenta,
para os índices de modulação avaliados, ondulações máximas superiores
ou iguais às obtidas com a DPWM3.
A Figura 5.23(a-c) mostra o perfil das ondulações máximas de
corrente para cada período de comutação variando o ângulo θ das
Figura 5.22: Ondulação de corrente parametrizada para os índices de modu-

lação M = 0, 5 e M = 0, 7 referentes as modulações: (a) DPWM1 e SVPWM;
(b) DPWM3 e SVPWM; (c) DPWM3 e DPWM1.
funções de modulação e o índice de modulação para as modulações

SVPWM, DPWM1 e DPWM3 respectivamente. A Figura 5.23(d) mos-
tra que a ondulação de corrente produzida pela DPWM1 é sempre
maior para a SVPWM.
A análise realizada foi testada através de simulações e os resulta-
dos são mostrados na Figura 5.24. Observa-se que a máxima ondulação
das correntes simuladas são aproximados em relação aos valores obtidos
analiticamente.
5.5 Espectro da Tensão de Modo Comum 121
Figura 5.23: Gráficos tridimensionais mostrando a variação da ondulação de

corrente no lado CA variando índice de modulação e o ângulo θ.
5.5 Espectro da Tensão de Modo Comum
Para aplicações industriais, principalmente em acionamentos de

máquinas, é importante que a tensão de modo comum gerada pelos
conversores eletrônicos seja reduzida. Essa tensão de modo comum é
resultado da comutação dos interruptores e pode gerar correntes de
modo comum. Estas, podem circular internamente ao conversor ou do
conversor para outros equipamentos que estejam acoplados ao conversor
através de capacitâncias parasitas. Essas correntes de modo comum
podem influenciar no funcionamento de equipamentos ou até mesmo
danificá-lo.
O espectro da tensão de modo comum foi obtido através de si-
mulação para as modulações com RL e com RCMV. As amplitudes dos
harmônicos para as estratégias de modulação com RL são as mesmas
do 2L-VSI com modulações equivalentes. Com a utilização do vetor
nulo V~0,RCMV percebe-se uma significativa redução na amplitude das
Figura 5.24: Formas de onda para a mostrando a ondulação de corrente má-

xima obtidas para as modulações: (a) DPWM3; (b) DPWM1; (c)SVPWM.
componentes harmônicas
5.6 Conclusão
Neste capítulo buscou-se evidenciar as principais características

do conversor ∆-VSI proposto e verificar em quais condições de operação
o seu desempenho é superior ao de um 2L-VSI. Para isso, o estudo
de caso realizado considerou a comparação do ∆-VSI com o 2L-VSI
com apenas 6 interruptores e o 2L-VSI construído com 12 interruptores
(mesmos interruptores da topologia proposta).
Na análise de esforços de corrente, verificou-se que o conversor
proposto divide os esforços de corrente em seus doze interruptores de
5.6 Conclusão 123
Figura 5.25: Espectro harmônico das tensões de modo comum gerados utili-
zando as estratégias de modulação com: (a) RL; (b) RCMV.
maneira diferente, dependendo do ângulo de fator de potência. Essa

característica não é verificada para o 2L-VSI e pode ser vantajosa, pois
permite a otimização dos semicondutores para determinados pontos de
operação.
Analisando as perdas por condução do conversor, se os vetores
ativos são realizados com RCL, pode-se concluir que o ∆-VSI é sem-
pre mais eficiente que o 2L-VSI com seis interruptores independente do
estado utilizado para realizar o vetor nulo. Observou-se que a impedân-
cia equivalente do vetor nulo realizado com apenas os interruptores em

delta reduz em 30% as perdas por condução (durante o período em que
o vetor nulo é implementado) em relação ao vetor nulo de um 2L-VSI
utilizando seis interruptores. Entretanto, as perdas por condução são
sempre maiores que as do 2L-VSI com área de silício aumentada.
O vetor nulo que se mostrou mais eficaz para a redução das
perdas por condução foi o que utiliza os interruptores em delta e em
estrela simultaneamente. A redução verificada foi de 60% que chega a
ser maior que a redução de 50% obtidas com o 2L-VSI com interrup-
tores em paralelo. Essa característica pode ser explorada operando o
conversor com baixos índices de modulação. A partir de certos valo-
res de M o ∆-VSI começa a ser mais eficiente que o 2L-VSI com 12
interruptores.
A estratégia de modulação do conversor deve ser escolhida de
acordo com a característica que se deseja otimizar do conversor. As
modulações descontínuas por um lado, podem reduzir em até 50% as
perdas por comutação quando comparada com a modulação SVPWM,
mas por outro lado, provocam ondulação de corrente sempre superiores.
Observando o espectro da tensão de modo comum do conversor,
verifica-se a grande vantagem de se utilizar apenas os interruptores em
delta para implementar o vetor nulo. A amplitude das harmônicas e
consequentemente do valor eficaz da tensão de modo comum do con-
versor mostram uma redução bastante significativa quando o V ~0,RCMV
foi utilizado em relação aos V
~0,RCL e V
~0,VSI .
125
6 APLICAÇÃO DO CONVERSOR ∆-VSI CONECTADO

À REDE ELÉTRICA
6.1 Introdução
Como foi verificado, ao longo dos cinco primeiros capítulos, o

conversor proposto pode, dependendo da escolha dos vetores utilizados
em sua modulação, ser otimizado para a redução de perdas ou de emis-
sões de modo comum. Devido à estas características, o ∆-VSI pode ser
uma escolha adequada para realizar a conexão entre fontes alternativas
de energia, como a eólica e a fotovoltaica, com a rede elétrica. Para
validar essa afirmação, foi projetado um protótipo de 10 kW capaz de
injetar energia na rede elétrica. O dimensionamento do filtro de EMI,
modelagem do conversor e dos controladores serão mostrados. Ao fi-
nal serão fornecidos alguns detalhes da implementação do protótipo
seguidos dos resultados experimentais obtidos.
6.2 Especificações do Projeto
As especificações utilizadas para realizar a escolha dos semicon-

dutores, estratégia de modulação, filtro de saída e controladores foram
resumidos na Tabela 6.1.
Tabela 6.1: Parâmetros utilizados para realizar o projeto do conversor.
Parâmetro Valor
Tensão no barramento CC (Vdc ) 760 V
Tensão eficaz de fase no lado CA (Vo,rms ) 380 V
Corrente de pico no lado AC (Iˆpk ) 21,5 A
Potência de saída com FP=1 (Po ) 10 kW
Temperatura máxima na junção (Tj ) 135◦ C
Frequência da fundamental (ff ) 60 Hz
Frequência de comutação(fs ) 19.960 Hz
Ondulação na corrente na rede 3% de Iˆpk
Como deseja-se operar o conversor com elevada eficiência e com

volume reduzido, foram escolhidos interruptores MOSFETs de carbeto
126 6 Aplicação do Conversor ∆-VSI conectado à Rede Elétrica
de silício CMF20120D, cujas perdas já foram determinadas no Capí-

tulo 3 para a as condições descritas na Tabela 6.1.
A rede elétrica escolhida para conectar o sistema gerador + in-
versor possui valor eficaz de 380 V de linha e frequência fundamental de
60 Hz. No Capítulo 5, foi mostrado que as perdas totais do ∆-VSI são
reduzidas à medida que o índice de modulação é reduzido. Entretanto,
o aumento da tensão do link CC resulta no aumento de volume e de
custos com capacitores eletrolíticos, um dos elementos mais caros do
conversor. Diante dessas limitações, foi decidido operar com uma ten-
são máxima de 900 V com um barramento formado por capacitores de
450 V, bastante acessíveis hoje no mercado. Por questões de segurança,
e, pensando que o barramento do conversor possa sofrer variações, foi
decidido operar com um link CC de 760 V.
O principal critério utilizado para o dimensionamento dos filtros
de modo diferencial, foi o valor da ondulação máxima das correntes de
fase 1 que se deseja.
6.3 Estudo do Filtro de Modo Diferencial
O filtro para as correntes de modo diferencial é um elemento

indispensável para a conexão de conversores à rede elétrica. É devido
a sua impedância indutiva que é possível conectar um inversor fonte
de tensão à rede elétrica, que é essencialmente também uma fonte de
tensão. As fontes geradoras de energia conectadas com conversores
de potência são responsáveis pela introdução de harmônicos de tensão
em alta frequência na rede. Estas tensões em alta frequência podem
causar o aparecimento de correntes que interferem em equipamentos
sensíveis e aumentam as perdas na rede. A solução mais simples e a
mais empregada em conversores industriais para reduzir a amplitude
desses harmônicos consiste em utilizar um simples indutor em cada fase
do conversor, conforme mostra a Figura 6.1.
Em aplicações em torno de centenas de kW, como em sistemas
eólicos, a frequência de comutação é reduzida para diminuir as perdas
por comutação. Portanto, para atenuar os harmônicos de corrente de
modo a atender os códigos de rede seria necessário um valor de indutân-
cia muito elevado, o que aumentaria muito os custos o peso e o volume
da estrutura.
No nível de sistema, no caso de parques eólicos e solares, a maior
1 Variação de corrente em torno do valor médio em um período de comutação.
6.3 Estudo do Filtro de Modo Diferencial 127
Figura 6.1: Conversor trifásico bidirecional conectado à rede através de um

filtro L.
preocupação é devido ao distúrbio produzido por alguns harmônicos

específicos. Dessa forma, uma possível solução seria o emprego de filtros
LC sintonizados, como mostrado na Figura 6.2
Figura 6.2: Conversor trifásico bidirecional conectado à rede através de filtros

sintonizados LC.
Entretanto, para algumas normas como a IEEE 519, a IEC 1000-

3-2, IEC 61000-3-4 códigos de rede, os inversores devem respeitar certos
limites de emissão de harmônicos em alta frequência que variam de 2
a 150 kHz [71], [72]. Portanto, um filtro passa-baixa mais eficaz é
necessário.
A Figura 6.3 mostra um conversor trifásico bidirecional conec-
tado à rede através de um filtro LCL. Este filtro é de ordem mais
elevada e provê uma atenuação de 60 dB/década para os distúrbios
causados pela comutação em alta frequência e pelas bandas laterais
Figura 6.3: Conversor trifásico bidirecional conectado à rede através de um

filtro LCL.
dos harmônicos de tensão. Com essa solução é possível obter resul-

tados que atendem as normas com pequenos valores de indutância e
capacitância e, portanto, será a empregada neste trabalho.
6.3.1 Escolha dos Parâmetros do Filtro LCL

Existem diversos critérios para o dimensionamento dos filtros
de modo diferencial LCL que visam otimizar alguns parâmetros do
sistema. Para isso, o projeto deve ser realizado juntamente com o
do conversor e normalmente emprega algoritmos complexos, como o
proposto em [73]. Como o objetivo da dissertação não é a otimização do
filtro, a metodologia seguida leva em conta apenas o valor de ondulação
limite que se deseja para as correntes injetadas na rede [72] .
O indutor do lado do conversor, também conhecido como indutor
boost, é normalmente projetado para atenuar a maior parte da ondula-
ção de corrente [74], [75]. Para simplificar a análise é considerado que
os capacitores do filtro LCL funcionam como um curto circuito e o in-
dutor do lado da rede apresenta impedância infinita para as corrente de
alta frequência. O circuito simplificado que é levado em consideração
para o projeto é mostrado na Figura 6.4.
Para o primeiro estágio do filtro, foi especificado que a ondulação
de corrente de 30% da amplitude da componente fundamental das cor-
rentes de fase. Foi verificado no Capítulo 5 que a modulação DPWM1
era a modulação que produzia os maiores valores de ondulação de cor-
rente e, portanto, foi a escolhida para determinar o valor da indutância
boost. Para um índice de modulação de 0,709, o máximo valor da on-
Figura 6.4: Circuito simplificado do filtro LCL utilizado para dimensiona-

mento do indutor do lado do conversor.
dulação de corrente ocorria para os ângulos θ = π e θ = 0. Com essa

informação, é possível, com o auxílio de (5.31) e da Tabela 5.5, deduzir
a equação que permite o cálculo do valor da indutância do primeiro
estágio do filtro √
2 3 − 3M M Vdc
Lc = . (6.1)
12fs ∆imax
Substituindo o valor dos parâmetros da Tabela 6.1 em (6.1) e conside-
rando
∆imax = 0,3Iˆpk = 6,45 A, (6.2)
é possível se obter o valor da indutância do lado do convesor
√
2 3 − 3M M Vdc
Lc = = 460 µH. (6.3)
12fs ∆imax
O valor da indutância do lado da rede foi escolhida considerando
uma limitação no valor da indutância total do filtro (Ltot ). A frequência
de ressonância de um filtro LCL é calculada por
s
1 Lc + Lr
fress,LCL = . (6.4)
2π Lc Lr Cf
Fixando o valor de Ltot e escrevendo a indutância Lr em função de Lc
(
Lc + Lr = Ltot
, (6.5)
Lr = rLc
é possível encontrar o valor da frequência de ressonância em função da

indutância total Ltot e da relação entre as indutâncias conforme

s
2
1 (1 + r)
fress,LCL = . (6.6)
2π Ltot rCf
Resolvendo (6.6) para Cf e parametrizando esse resultado em relação

a 1/(ωress
2
Ltot ) a expressão
2
(1 + r)
Cf = (6.7)
r
é obtida. A expressão (6.7) é importante, pois mostra que, quando se
tem uma indutância total limitada, dada uma frequência de ressonância
para o filtro, o valor de capacitância mínimo é obtido quando Lr = Lc .
Essa propriedade pode ser visualizada na Figura 6.5
Figura 6.5: Capacitância do filtro parametrizada em função da relação entre

as indutâncias do filtro LCL.
Como explanado, para que o valor da capacitância do filtro fosse

minimizado, o valor das duas indutâncias Lc e Lr deveriam ser iguais.
Entretanto, o projeto do filtro foi influenciado pela quantidade de nú-
cleos disponíveis no laboratório. Como só haviam três núcleos disponí-
veis por fase, dois núcleos foram utilizados para a confecção do indutor
boost e um para a confecção do indutor do lado da rede, o que resulta
em r = 0,5 e Lr = 230 µH. No inicio da seção, foi definido que a
ondulação de corrente deveria ser de 3% do pico da corrente CA na
rede elétrica. Uma vez definidos os valores das indutâncias, o ajuste da
ondulação final é feita pela capacitância do filtro.
Para evitar que haja um decremento significativo do fator de
potência, há recomendações de que a capacitância do filtro absorva no

máximo 5% [74], [75] da potência total do conversor e, portanto,
5 Po
Cf,max = = 9,1 µF. (6.8)
100 2πfg Vo 2
Sabendo que a atenuação da corrente na rede em relação a corrente no
indutor do lado do conversor pode ser calcaulada por
ir (s) r+1
= , (6.9)
ic (s) Cf Ltot rs2 + r + 1
escolhe-se o valor adequado de Cf de modo que a ondulação de corrente
no indutor da rede seja apenas 10% da ondulação de corrente no indutor
do lado do conversor. A amplitude da função de transferência de (6.9)
é mostrada na Figura 6.6 para diferentes valores de capacitância de
filtro.
Figura 6.6: Atenuação da corrente injetada na rede em relação a corrente no

lado do conversor, em função da relação entre as indutâncias.
Como pode ser visto, o valor de capacitância de 3 µF seria o

suficiente, entretanto um valor de 4 µF foi o adotado por ser o valor de
capacitância dos capacitores disponíveis no laboratório.
Para verificar a validade dos cálculos realizados, uma simulação
foi realizada com os parâmetros encontrados para o filtro e o resultado é
mostrado na Figura 6.7. Os detalhamentos do projeto físico do indutor
são fornecidos no Apêndice B
Figura 6.7: Corrente de fase no indutor Lc e no indutor Lr destacando a

ondulação devido à comutação dos interruptores.
6.4 Modelagem do Conversor Aplicado ao Controle
Para a implementação do controle das tensões e correntes do lado

CA do conversor, é necessário obter o modelo matemático do conversor
juntamente com o seu filtro de EMI. A Figura 6.8 mostra o filtro LCL
adicionado ao modelo em VMQI do ∆-VSI para o lado CA, obtido no
Capítulo 4.
Figura 6.8: Inversor de tensão conectado à rede elétrica através de um filtro

LCL não ideal.
6.4 Modelagem do Conversor Aplicado ao Controle 133
Observa-se que foram adicionados ao modelo do filtro LCL ideal

da Figura 6.3 as resistências dos indutores, bem como as resistências
série equivalentes dos capacitores de filtro. A inserção do capacitor
Cf provoca o fenômeno de ressonância que amplifica as componentes
harmônicas de corrente situadas na frequência de ressonância do filtro.
Apesar do filtro LCL possuir um desempenho superior na atenuação
das componentes harmônicas da corrente injetada na rede em relação
ao filtro L, alguns cuidados a mais devem ser tomados para o dimensio-
namento dos controladores. Um circuito RC de amortecimento passivo
foi adicionado com o intuito de facilitar o projeto dos controladores e
tornar o sistema menos oscilatório. Esse circuito auxiliar introduz per-
das no sistema e pode ser substituído pela introdução de técnicas de
amortecimento ativo no controle das correntes CA.
O sistema de equações não lineares em coordenadas abc que re-
presentam o filtro LCL a ser modelado é dado por
d~ic,abc

Lc = d~abc Vdc − Rc~ic,abc − vcap,abc + vcf ~u


dt




d~ir,abc


= −Rr~ir,abc + ~vcap,abc − ~vr,abc − vrf ~u


 Lr


 dt
d~vcf,abc d~vcd,abc ~ , (6.10)
Ccf + Ccd = ic,abc − ~ir,abc


 dt dt

 d~vcf,abc d~vcd,abc
~vcf,abc + Rcf Ccf = ~vcd,abc + Rcd Ccd


dt dt



d~vcf,abc



 ~vcap,abc = ~vcf,abc + Rcf Ccf
dt
onde Lc = Lc I3 , Lr = Lr I3 , Ccf = Ccf I3 , Ccd = Ccd I3 e Ccap =
Ccap I3 ,
~ic,abc = [ic,a ic,b ic,c ]T








 ~ir,abc = [ir,a ir,b ir,c ]T

 ~vCf,abc = [vcf,a vcf,b vcf,c ]T


T
(6.11)
 ~vCd,abc = [vcd,a vcd,b vcd,c ]



 T
~vcap,abc = [vcap,a vcap,b vcap,c ]





 T
~u = [1 1 1]
e 
 vcr = vn,c − vn,r

vcf = vn,c − vn,f . (6.12)

vrf = vn,r − vn,f

O modelo em coordenadas estacionárias abc pode ser obtido pela

análise de circuitos e não necessita de nenhum tipo de transformação.
Entretanto, realizar o controle das correntes do lado CA utilizando esse
modelo requer o uso de controladores de ordens mais elevadas ou não
lineares para garantir o segmento de referência e uma adequada rejeição
de perturbação. Visando simplificar a implementação dos controlado-
res o modelo de (6.11) normalmente é transformado para para um mo-
delo em coordenadas síncronas dq. As correntes e tensões variantes no
tempo passam a ser estacionárias no modelo dq e, portanto, podem ser
controladas com compensadores mais simples como os Proporcionais
Integrais (PI) [76].
A vantagem de facilitar o projeto dos controladores é conseguida
com o aumento do esforço computacional para realizar as transforma-
das, que dependem do ângulo do vetor de tensões da rede. Além disso,
o modelo para as correntes do conversor apresenta variáveis acopladas
bem como termos de dinâmica rápida como a tensão da rede, o que
resulta na necessidade de malhas de desacoplamento e de feedfoward.
Uma alternativa interessante à modelagem e ao controle feito em
coordenadas dq, e que, nos últimos anos vem sendo bastante utilizada
para sistemas conectados à rede elétrica, é a modelagem do conver-
sor em coordenadas estacionárias αβ e o controle com compensadores
Proporcionais Ressonantes (PR).
O modelo do conversor em coordenadas αβγ pode ser obtido
multiplicando (6.11) pela matriz de transformação de Clarke de (3.5).
Considerando um sistema equilibrado, as componentes do eixo γ podem
ser omitidas e o resultado é mostrado em
d~ic,αβ

Lc = d~αβ Vdc − Rc~ic,αβ − vcap,αβ


dt




d~ir,αβ


= −Rr~ir,αβ + ~vcap,αβ − ~vr,αβ


 Lr


 dt
d~vcf,αβ d~vcd,αβ ~ , (6.13)
Ccf + Ccd = ic,αβ − ~ir,αβ


 dt dt

 d~vcf,αβ d~vcd,αβ
~vcf,αβ + Rcf Ccf = ~vcd,αβ + Rcd Ccd


dt dt



d~vcf,αβ



 ~vcap,αβ = ~vcf,αβ + Rcf Ccf
dt
onde Lc = Lc I2 , Lr = Lr I2 , Ccf = Ccf I2 , Ccd = Ccd I2 e Ccap =
Ccap I2 . Observa-se que os termos referentes às tensões nos pontos co-
muns não aparecem nas equações em coordenadas αβ pois
T
~u[T ]αβ = [0 0 1] . (6.14)
O modelo em espaço de estados, bem como as funções de trans-
ferência que serão usadas para realizar o controle do conversor, podem
ser derivados de (6.13). De acordo com a necessidade do projetista al-
guns dos termos de (6.13) podem ser desconsiderados para a obtenção
de modelos mais simples. Afim de escolher valores adequados para o
circuito de amortecimento, um modelo em variáveis de estado foi le-
vantado em (6.15) desconsiderando as resistências dos indutores e do
capacitor de filtro, por serem normalmente muito menores que a resis-
tência de amortecimento. Linearizando o modelo em torno dos pontos
de operação e aplicando a transformada de Laplace, é possível encontrar
as funções de transferência do filtro.
A associação da indutância Lr com a capacitância Ccf pode ser
vista como um filtro LC em série com o indutor boost, e de acordo com
[55], o valor do resistor do amortecimento passivo pode ser escolhido
para otimizar o fator de qualidade Q 2 .
2 O Fator Q é está relacionado com a seletividade, com o amortecimento, e com a
capacidade de absorver energia em uma dada frequência de ressonância para filtros

de segunda ordem.
 1 
0 0 0 −
   Lc  
i̇c,i  1  ic,i
 0 0 0 
 i̇r,i  
Lr
 ir,i 
= +
    

v̇cd,i 1 1 
vcd,i
   0 0 −  
CCd RCd CCd RCd 
 
v̇cf,i  vcf,i
 1 1 1 1 
− −
CCf CCf CCf RCd CCf RCd
Vdc
 
 Lc 0 " #
 1 
 di
0 −

+ Lr

 v
i
 0 0
 

0 0
(6.15)
A escolha do valor da capacitância do ramo de amortecimento
do filtro deve ser visto como uma relação de compromisso entre o valor
de capacitância e do amortecimento que se deseja. O valor de capa-
citância Ccd = Ccf é geralmente escolhido, pois resulta em um bom
compromisso entre o volume de capacitor e amortecimento que é pos-
sível se obter [55], [73]. Uma vez escolhido o valor da capacitância de
amortecimento, um valor adequado de Rcd pode ser determinado para
minimizar o fator de qualidade. Definindo a variável n como
Ccf
n= , (6.16)
Ccd
o valor de resistência de amorteciemnto Rcd que minimiza o fator Q do
filtro é calculado por
s
(2 + n) (4 + 3n)
RCd = Ro Qopt = Ro , (6.17)
(2n2 ) (4 + n)
onde Ro é a impedância característica do filtro Lr Ccf dada por
s
Lr
Ro = (6.18)
Ccf
Os diagramas de Bode das principais funções de transferência
do filtro LCL são mostrados na Figura 6.9 para diferentes valores de

capacitância de filtro, mostrando o efeito do circuito de amortecimento.
Figura 6.9: Diagramas de bode das principais funções de transferência do

filtro LCL para diferentes valores de capacitância de amortecimento: (a)
ic (s)/d(s); (b) ir (s)/d(s); (c) (d) vcap (s)/d(s) (d) ir (s)/ic (s).
A frequência de ressonância obtida para os parâmetros do filtro

pode ser calculada através de (6.4)
s
1 Lc + Lr
fress,LCL = ≈ 6,4 kHz. (6.19)
2π Lc Lr Cf
De acordo com [72], a frequência de ressonância obtida é um valor
adequado pois está entre dez vezes a frequência da rede e metade da
frequência de comutação. Esses limites são recomendados para evitar
problemas de que a ressonância possa causar no espectro da corrente

em alta e em baixa frequência.
6.5 Controle das Correntes do Lado CA
Para que se possa controlar a potência injetada na rede pelo

conversor, é necessário controlar as correntes no lado CA. Como citado
anteriormente, para este trabalho, foi decidido fazer uso de um contro-
lador PR para realizar o controle das correntes CA em coordenadas αβ.
Este compensador emprega o princípio do modelo interno para evitar
o uso de transformações de coordenadas, no caso, a transformada de
Park. Esse princípio mostra que é suficiente inserir a perturbação no
modelo do compensador para garantir a sua perfeita rejeição [35], [77].
Dessa forma, controlador PR pode funcionar como um filtro notch para
compensar os harmônicos de uma forma bastante seletiva. A estrutura
ideal do compensador PR [78] é dada em
2s
P R(s) = Kp + Ki , (6.20)
s2 + ωc2
onde ωc é a frequência da perturbação que se deseja compensar e Kp
e Ki são os ganhos proporcionais e integrais do controlador respecti-
vamente. Para evitar problemas de instabilidade numérica [35], [79], a
estrutura ressonante ideal é substituída por uma com ganho finito
2ωb s
P R(s) = Kp + Ki , (6.21)
s2 + 2ωb s + ωc2
onde ωb é a frequência do zero do controlador PI equivalente [35], [80].
Uma das grandes vantagens do controlador PR é a facilidade de se as-
sociar compensadores em paralelo para agir principalmente nos harmô-
nicos de baixa ordem.
Existem na literatura várias estratégias de controle das corren-
tes injetadas na rede em conversores conectado à um filtro LCL. Geral-
mente, quanto melhor a performance que se deseja, maior a quantidade
de sensores utilizados [35]. A estratégia utilizada neste trabalho con-
siste em controlar apenas as correntes do lado do conversor com um
controlador PR sintonizado na frequência da rede elétrica (60 Hz).
Para verificar a validade do modelo de pequenos sinais obtido
para a corrente no indutor do lado do conversor, foi aplicado um degrau
de 10% na função de razão cíclica e verificado o comportamento da
6.5 Controle das Correntes do Lado CA 139
corrente ao longo do tempo. Como pode ser visto na Figura 6.10,

o modelo derivado para a corrente no lado do conversor segue com
precisão o resultado simulado.
Figura 6.10: Resposta da corrente no lado do conversor à um degrau de 10%

de variação na função de razão cíclica.
O controle de corrente foi realizado com base no diagrama de

blocos da Figura 6.11 A função de transferência que descreve o mo-
delo de pequenos sinais da corrente no lado do conversor em função da
Figura 6.11: Diagrama de blocos da malha de corrente destacando os ele-

mentos internos ao DSC.
variação da tensão CA em coordenadas αβ é dada por
ic,αβ (s)
= Gic (s) =
vαβ (s) .
Ccd Ccf Lr Rcd s3 +Lr s2 (Ccd +Ccf )+Ccd Rcd s+1
Ccd Ccf Lc Lr Rcd s4 +Lc Lr s3 (Ccd +Ccf )+s2 (Ccd Lc Rcd +Ccd Lr Rcd )+s(Lc +Lr )
(6.22)
Além da função de transferência do controlador e da planta que
descreve o comportamento físico do sistema, também deve ser levado
em conta a influência dos sensores, circuitos de condicionamento de
sinal e dos ganhos e atrasos dos circuitos microprocessados. Para dar
uma maior imunidade ao controle à ruídos, um filtro passa baixa de
primeira ordem foi adicionado na leitura das correntes de fase. A função
de transferência do circuito de condicionamento de sinal e do sensor é
dada por
ωcut
Hic (s) = Ksens Kcond , (6.23)
s + ωcut
onde Ksens é o ganho do sensor de corrente, Kcond é o ganho do circuito
de condicionamento e ωcut é a frequência angular de corte do filtro. O
ganho dos circuitos de Conversão Analógico Digital (ADC) podem ser
calculados dados a sua resolução (ResADC ) e o valor de fundo escala
da tensão analógica (VADC ) conforme
ResADC
KADC = . (6.24)
VADC
O atraso devido aos cálculos das rotinas de controle e do modu-
lador podem ser modelados no domínio de Laplace como [43], [81]

1 1
GP W M (s) = KP W M e−s(1−D)Ts + e−sDTs . (6.25)
2 2
Em (6.26) foi considerado um modulador triangular com atualização

dupla. O projeto do compensador de corrente proporcional ressonante
pode ser realizado da mesma forma que de um compensador PI. O pro-
jeto do compensador é realizado analisando a Função de Transferência
de Laço Aberto do sistema (FTLA)
F T LA(s) = P R(s)GP W M (s)Gic (s)Hic (s)KADC . (6.26)

Para que a FTLA cruze pelo zero na frequência fcr ,
|F T LA(2πfcr )| = 1 (6.27)
deve ser satisfeita. Esse procedimento define a largura de banda do
controlador. Para que a FTLA(s) tenha uma margem de fase Mf , deve
ser satisfeita a condição
arg(F T LA(2πfcr )) + 180 = Mf . (6.28)

Uma margem de fase, uma frequência de cruzamento pelo zero
e uma frequência de ressonância são fornecidas e os valores de Kp e
de Ki devem ser escolhidos para satisfazer as condições do sistema de
equações dado por (6.27) e (6.28). Para o projeto do controlador foi
definida uma margem de fase de 50◦ , uma frequência de cruzamento
pelo zero de 2 kHz e uma frequência de ressonância igual a da rede
elétrica (60 Hz). Os valores de Kp = 12.965 e Ki = 1,461 · 103 foram
os obtidos considerando os ganhos do ADC, do modulador, do sensor
de corrente e do condicionamento de sinal unitários. Os diagramas de
Bode do controlador e da FTLA são mostrados na Figura 6.12 para os
ganhos calculados.
Figura 6.12: Diagramas de Bode do: (a) controlador de corrente Cic (s); (b)
função de transferência de laço aberto FTLA(s).
A função de transferência do controlador foi discretizada pelo

método Tustin, ou seja,

2 z−1
s= , (6.29)
Ts z + 1
e o resultado da discretização no domínio z é dado por
b0 z 2 + b1 z + b2
P R(z) = . (6.30)
a0 z 2 + a1 z + a2
Normalizando todos os coeficientes em relação a a0 encontra-se a equa-
ção a diferença utilizada para o controlador
y[k] = −(a1 y[k − 1] + a2 y[k − 2])+ (6.31)

b2 e[k − 2] + b1 e[k − 1] + b0 e[k].
Para que a malha de controle não seja saturada devido a ação

integral, algoritmos de anti-windup podem ser utilizados. Da mesma
forma que em controladores PI discretos, o fenômeno de windup pode
evitado separando a parte proporcional da parte integral ressonante e
limitando a ação da segunda [82].
A Figura 6.13 mostra o circuito de potência do conversor junta-
mente com o esquema de modulação e controle propostos. As Figuras
6.14 e 6.15 mostram as formas de onda das correntes e funções de razão
cíclica do conversor operando em malha fechada e utilizando o compen-
sador PR projetado para a malha de corrente.
No instante 110 ms um degrau de 30% é aplicado nas referências
de corrente. Observa-se que o controlador PR projetado apresenta uma
resposta rápida e amortecida para variações nas referências de corrente
independente da estratégia de modulação utilizada. Como os contro-
ladores PI no plano estacionário dq, o controlador PR foi capaz de
realizar o seguimento das referências de corrente. A simulação também
indica que os parâmetros do escolhidos para o filtro são favoráveis para
a implementação do controle. É importante ressaltar que deve ser ana-
lisada a estabilidade dos controladores para variações das indutâncias
e tensões da rede.
6.5 Controle das Correntes do Lado CA
143
Figura 6.13: Diagrama mostrando as estratégias de controle e modulação do ∆-VSI propostas.
Figura 6.14: Resultados de simulação do conversor operando com o filtro

LCL e com o controlador PR projetados para a modulação DPWM1.
Figura 6.15: Resultados de simulação do conversor operando com o filtro

LCL e com o controlador PR projetados para a modulação SVPWM.
6.6 Protótipo Implementado
O protótipo construído consiste em uma placa de condiciona-

mento de sinais e controle, uma placa de potência, uma fonte auxiliar,
doze circuitos de gate-driver e uma placa contendo os filtros de EMI.
A separação dos circuitos do protótipo em placas distintas foi reali-
zada pensando no reaproveitamento dos elementos em outros projetos.
A seguir será feita uma breve descrição de cada placa que compõe o
protótipo.
6.6.1 Placa de Controle e Condicionamento de Sinais

A placa de condicionamento de sinais e controle pode ser divi-
dida em seis partes: circuitos de condicionamento de sinal das correntes
amostradas; circuitos de condicionamento de sinal das tensões amos-
tradas; circuitos de proteção contra sobretensão ou sobrecorrente; Kit
do Controlador Digital de Sinais (DSC) TMS320F28335; Kit de FPGA
De0 Nano; buffers de saída e interface com o usuário.
A placa de controle foi construída pensando em contemplar as
necessidades de diferentes tipos de conversores trifásicos e CC-CC. Ela
pode ser utilizada para modulação e controle de conversores trifásicos
dois níveis e multiníveis, conversores back-to-back e conversores matri-
ciais. Para que isso fosse possível, foram adicionados seis circuitos de
condicionamento para as correntes amostradas e seis circuitos de condi-
cionamento para as tensões amostradas, podendo essas serem trifásicas
contínuas, trifásicas comutadas, ou CC.
O DSC TMS320F28335, capaz de operar com ponto flutuante à
150 MHz, foi incorporado à placa para realizar o controle e a modulação
do conversor. Esse DSC possui no total 18 canais PWM, 16 canais para
a Conversão Analógico Digital (ADC), e canais de comunicação serial
(SCI,SPI,CAN), o que permite ao DSC realizar o controle, modulação
e monitoramento de conversores mais complexos.
O kit de FPGA (Field Programmable Gate Array) De0 Nano
contendo o dispositivo Altera Cyclone IV EP4CE22F17C6N foi inte-
grado na placa com o intuito de dar maior flexibilidade ao controle e
à modulação dos conversores de potência. Quando as leis de controle
e os protocolos de comunicação requerem muito esforço computacio-
nal, a modulação do conversor pode ser implementada no FPGA. Além
disso, as estratégias de modulação vetorial podem ser realizadas mais
rapidamente e de forma mais natural no FPGA, que é capaz de ge-
6.6 Protótipo Implementado 147
rar as máquinas de estado dos estados topológicos do conversor via

hardware. A comunicação entre o DSP e o FPGA pode ser realizada
através do canal de comunicação serial, ou através dos pinos de IO que
os conectam.
Para que essa placa também pudesse ser útil em aplicações que
operem com frequências de comutação acima dos 500 kHz, também fo-
ram incorporados em seu esquemático circuitos AD de alta velocidade
de conversão. A imagem tridimensional do circuito juntamente com as
dimensões da placa podem ser visualizadas na Figura 6.16. A fotogra-
fia da placa real com a discriminação de cada uma das suas partes é
mostrada na Figura 6.17.
6.6.2 Fontes Auxiliares

Para tornar o protótipo independente de fonte auxiliares externas
e tentar reduzir ao máximo possíveis interferências que a fonte auxiliar
possa causar na operação do conversor, uma solução de fonte auxiliar
de 30 W foi proposta. Ela consiste na associação série de um conversor
buck operando no Modo de Condução Descontínuo (MCD) com um
conversor LCC ressonante.
A fonte pode ser alimentada com tensões senoidais ou CC vari-
ando de 250 V a 800 V. Os dois conversores operam em malha fechada
para garantir que mudanças abruptas nas tensões de alimentação não
provoquem danos aos circuitos do conversor. A fonte auxiliar gera uma
saída de 5 V que pode ser utilizada para alimentar os circuitos analó-
gicos, digitais e microprocessados, e uma alimentação de 12 V para a
alimentação dos circuitos de gate-driver e ventiladores. Para que ela
pudesse ser adaptada para utilização em diferentes protótipos, foram
utilizados componentes e magnéticos de baixo perfil. Uma fotografia
da fonte auxiliar implementada, mostrando suas dimensões, é mostrada
na Figura 6.18.
6.6.3 Circuito de Gatilho dos Interruptores

No protótipo foram utilizados circuitos de gate-driver isolados
capazes de aplicar tensões positivas de 20 V e negativas de 2 V . Essas
tensões podem ser adaptadas dependendo das necessidades do proje-
tista e não devem ultrapassar a faixa de excursão de 25 V de tensão de
saída. Essa limitação deve ser respeitada para a correta operação do
FOD3180.
Figura 6.16: Imagem tridimensional da placa de de controle e modulação do

protótipo implementado mostrando suas dimensões: (a) vista superior; (b)
vista em perspectiva.
6.6 Protótipo Implementado 149
Figura 6.17: Fotografia da placa de de controle e modulação do protótipo

implementado mostrando indicando a localização de suas subdivisões: (a)
vista superior; (b) vista em perspectiva.
Figura 6.18: Fotografia das placas das fontes auxiliares desenvolvidas mos-
trando suas dimensões: (a) conversor LCC ressonante; (b) conversor buck
MCD.
Figura 6.19: Fotografia da placa de gate-driver mostrando suas dimensões.
6.6.4 Placa de Processamento de Energia e Protótipo Final

A placa de controle, as fontes auxiliares e os circuitos de gate-
driver são conectados na placa que realiza o processamento de energia
do conversor. Nesta placa, chamada aqui de placa de potência, são
6.7 Placa do Filtro de EMI 151
montados os capacitores do barramento CC, os sensores de corrente e

o conversor Buck utilizado para controle do ventilador.
Para o correto funcionamento do conversor, deve haver a correta
comunicação entre os circuitos do conversor. As grandezas físicas como
tensão e corrente são medidas através dos sensores de corrente e de
tensão e são transformados em sinais de de baixa tensão. Os sinais
medidos são lidos pelo DSC através de seu conversor analógico digital.
Todo o controle, a geração dos sinais de modulação e dos principais
pulsos de comando são gerados pelo DSC. Os pulsos de comando são
repassados para o FPGA que realiza uma lógica digital dependendo da
estratégia de modulação, implementa o tempo morto e gera os pulsos
que são enviados para os buffers de saída. Depois dos buffers, os sinais
são enviados para os circuitos de gate-driver que são capazes de acionar
os interruptores. O diagrama da Figura 6.20 mostra as conexões entre
os elementos que compõe o protótipo implementado.
A Figura 6.21 mostra o layout tridimensional da placa de po-
tência construída mostrando as suas dimensões. A Figura 6.22 mostra
a fotografia do protótipo montado com todos as placas já conectadas
na placa de processamento de energia. Os Esquemáticos de todas as
placas utilizadas no protótipo são mostrados no Apêndice C.
6.7 Placa do Filtro de EMI
A placa do filtro contém os indutores, capacitores e resistores

que compõe o filtro LCL de modo diferencial. Além disso, foram adi-
cionados sensores de corrente para a leitura das correntes injetadas na
rede, sensores resistivos para leitura da tensão nos capacitores, relés
para a realização do inrush dos capacitores do barramento, um filtro
para as correntes de modo comum e varistores para minimizar os da-
nos ao conversor devido a possíveis sobretensões que possam ocorrer na
rede. O projeto físico dos indutores do filtro é mostrado mais adiante
no apêndice B.
6.8 Resultados Experimentais do Protótipo Implementado
Nesta seção serão apresentados resultados experimentais que va-

lidam as teorias de modulação dos Capítulos 3 e 4 e dos cálculos de
perdas do Capítulo 5.
Figura 6.20: Diagrama funcional do protótipo construído.

6.8 Resultados Experimentais do Protótipo Implementado 153
Figura 6.21: Imagem tridimensional do protótipo implementado mostrando

suas dimensões: (a) vista superior; (b) vista em perspectiva.
Figura 6.22: Fotografia do protótipo implementado mostrando indicando a

localização de suas subdivisões: (a) vista superior; (b) vista em perspectiva.
6.8.1 Validação das Estratégias de Modulação

Para realizar os testes de modulação, o protótipo foi testado com
uma potência de 3 kW operando em malha aberta. Ao todo foram tes-
tadas doze estratégias de modulação sendo seis delas aplicando V ~0,RCL
e outras seis aplicando V ~0,RCMV . As Figuras 6.23 e 6.24 mostram o
resultado do conversor operando em malha aberta utilizando as estra-
tégias de modulação PWM contínuas e descontínuas da Figura 4.7 com
RL. Observa-se que a tensão de modo comum gerada para essas modu-
lações é similar a de um VSI operando com modulações equivalentes e
atingem picos de ±Vdc /2.
As Figuras 6.25 e 6.26 mostram o resultado do conversor ope-
rando em malha aberta utilizando as estratégias de modulação PWM
contínuas e descontínuas da Figura 4.7 com RCMV. Observa-se que a
tensão de modo comum, em todas as modulações que aplicam o ve-
tor nulo apenas com os interruptores em delta, apresentam um pico de
Vdc /6, conforme esperado nos resultados teóricos.
6.8.2 Curvas de Rendimento

As curvas de rendimento foram traçadas para o protótipo mon-
tado com interruptores MOSFETs SiC. O rendimento do inversor foi ob-
tido para a operação em malha aberta com uma carga RL. Nos ensaios,
o índice de modulação foi mantido constante M = 0,709 e Vdc = 400. O
analisador de espectro digital utilizado foi o WT1800 que possui uma
largura de banda que varia entre 0,1 a 1 MHz e apresenta precisão de
leitura de 0, 1% [83].
O rendimento apresentado não leva em conta as perdas das fontes
auxiliares e a energia utilizada para acionar os gate-drivers, o cooler,
e a placa de controle. A Figura 6.27 mostra as curvas de rendimento
obtidas para o ∆-VSI para a DPWM1 e a SVPWM. Observa-se que há
um aumento significativo no rendimento com a utilização da DPWM1.
O valor do máximo de rendimento obtido foi η = 0, 915.
O rendimento do ∆-VSI foi comparado como o do 2L-VSI com
seis interruptores na Figura 6.28 para as estratégias de modulação
SVPWM e DPWM1 com RL. Observa-se pelas curvas que a diferença
entre os rendimentos do ∆-VSI e do 2L-VSI aumenta com o elevação da
carga, uma vez que as perdas por condução passam a ser dominantes.
Para verificar a teoria descrita na Seção 5.3.1, as perdas do ∆-
VSI foram medidas para dois índices de modulação distintos mantendo
Figura 6.23: Correntes de fase (3,5 A/div), tensão de fase vbc (200 V/div) e
tensão de modo comum vcm (200 V/div) para as estratégias de modulação:
(a) SPWM com RL; (b) SVPWM com RL; (c) DPWM3 com RL. O conversor
opera com fs = 10 kHz, Vdc = 400 V e Po = 3 kW.
Figura 6.24: Correntes de fase (3,5 A/div), tensão de fase vbc (200 V/div)
e tensão de modo comum vcm (200 V/div) para as estratégias de modula-
ção: (a) DPWM1 com RL; (b) DPWM0 com RL; (c) DPWM2 com RL. O
conversor opera com fs = 10 kHz, Vdc = 400 V e Po = 3 kW.
Figura 6.25: Correntes de fase (3,5 A/div), tensão de fase vbc (200 V/div) e
tensão de modo comum vcm (200 V/div) para as estratégias de modulação:
(a) SPWM com RCMV; (b) SVPWM com RCMV; (c) DPWM3 com RCMV.
O conversor opera com fs = 10 kHz, Vdc = 400 V e Po = 3 kW.
Figura 6.26: Correntes de fase (3,5 A/div), tensão de fase vbc (200 V/div)
e tensão de modo comum vcm (200 V/div) para as estratégias de modula-
ção: (a) DPWM1 com RCMV; (b) DPWM0 com RCMV; (c) DPWM2 com
RCMV. O conversor opera com fs = 10 kHz, Vdc = 400 V e Po = 3 kW.
Figura 6.27: Curvas de rendimento do ∆-VSI para a DPWM1 e SVPWM

com Vdc = 400 V, M = 0, 709, fs = 20 kHz e carga indutiva L = 2,4 mH
Figura 6.28: Curva de rendimento do ∆-VSI e do 2L-VSI para a: (a)

DPWM1; (b) SVPWM. Resultados obtidos para Vdc = 400 V, M = 0, 709,
fs = 20 kHz e carga indutiva L = 2,4 mH
o valor das correntes de fase do lado CA. O resultado pode ser visto na
Tabela 6.2 onde observa-se uma redução nas perdas do conversor com
a diminuição do índice de modulação.
O rendimento obtido para o protótipo montado com RB-IGBTs
nos interruptores conectados em delta apresentou o valor de 94, 4%
operando com 2,6 kW, com uma tensão de entrada de 400 V e frequência
6.9 Conclusão 161
Tabela 6.2: Variação das perdas com o índice de modulação.
Modulação Vdc If ase,rms M Po Perdas

SVPWM 400 V 4,6 A 0, 709 1,58 kW 18,8
SVPWM 400 V 4,6 A 0,3 0,65 kW 17,4
de comutação de 10 kHz. O aumento da frequência de comutação

para 20 kHz aumentou demasiadamente as perdas, tornando inviável a
operação do conversor com esses interruptores.
6.9 Conclusão
Devido às características de baixa emissão de ruído de modo co-

mum e de redução nas perdas por condução, o conversor proposto é uma
boa opção para conectar fontes de geração de energia, principalmente
as renováveis, com a rede elétrica.
Um protótipo de 10 kW de caráter modular foi projetado e cons-
truído visando confirmar, na prática, os resultados de desempenho do
conversor obtidos na análise teórica. Para atender aos requisitos das
normas de conexão, um filtro LCL foi utilizado, pois apresentou-se
como uma boa opção para atenuar os harmônicos de alta frequência da
corrente injetada na rede. O projeto dos parâmetros do filtro LCL foi
realizado tomando como critério a atenuação da ondulação de corrente.
Para tornar o sistema a ser controlado mais amortecido, um ramo RC
foi adicionado ao filtro e o efeito do amortecimento estudado.
A modelagem do conversor associado ao filtro LCL foi realizada
em coordenadas estacionárias αβ e controladores ressonantes foram uti-
lizados para controlar as correntes no lado CA do conversor. O uso
de controladores ressonantes diminui o esforço computacional utilizado
para a realização de transformadas em relação ao uso de controladores
PI no eixo de coordenadas dq.
Foram realizados testes em malha aberta do conversor operando
com uma potência parcial. Os resultados experimentais obtidos servi-
ram para validar toda a teoria desenvolvida para a operação e modu-
lação do conversor e o efeito da redução das tensões de modo comum
nas estratégias com RCMV.
As curvas de rendimento obtidas mostram que a inserção dos in-
terruptores conectados em delta aumentam a eficiência do conversor em

comparação ao 2L-VSI com seis interruptores. Também foi detectado
uma redução das perdas do conversor com a redução do índice de modu-
lação. Foi verificado também que os RB-IGBTs da IXYS IXRH40N120
não são adequados para a formação dos interruptores conectados em
delta uma vez que apresentam um elevado valor de corrente de recupe-
ração reversa durante sua comutação.
163
7 CONCLUSÃO GERAL
É cada vez maior a demanda de inversores trifásicos de alto de-

sempenho em diversas aplicações que incluem o acionamento de mo-
tores elétricos, para os setores automotivo e industrial, a conexão de
sistemas à rede elétrica, como fontes geradoras de energia renovável ou
sistemas PFC, e aplicações críticas como alimentação de satélites ou
veículos navais. Neste contexto, buscou-se contribuir com o estudo de
uma nova topologia de inversor trifásico com modulação PWM fonte
de tensão dois níveis com potencial para ser otimizada em relação à
densidade de potência, ao rendimento e às emissões eletromagnéticas.
No Capítulo 3 foi observado que a adição de interruptores conec-
tados em delta acrescenta mais estados redundantes em relação a um
VSI convencional e, foi verificado que esses estados, se escolhidos de
maneira adequada em uma estratégia de modulação, podem otimizar
o desempenho do conversor. Dependendo da estratégia de modulação
utilizada, o conversor pode ser otimizado para a redução das perdas por
condução ou para a redução da geração das tensões de modo comum.
Interruptores conectados em delta podem ser também adicionados nas
topologias multiníveis para possivelmente se obter a redução das perdas
por condução. Um estudo mais detalhado se faz necessário.
No Capítulo 3 foram mostradas as restrições de operação e os
possíveis estados topológicos do conversor. Uma análise vetorial no
plano αβ foi realizada para relacionar os estados de comutação com os
vetores de tensão que o conversor é capaz de empregar. Foi verificado
que os estados mais interessantes para realizar a condução das correntes
de fase, durante a aplicação dos vetores ativos, são aqueles denominados
RCL, pois distribuem melhor as correntes nos interruptores.
Para realizar a transição entre os vetores, foi verificado que os
estados mais adequados são os que utilizam apenas os interruptores co-
nectados em estrela (VSI), ou os que utilizam apenas dois interruptores
conectados em estrela e um conectado em delta (SD). Estratégias de
modulação vetorial do conversor foram propostas visando a redução na
ondulação das correntes do lado CA, através das modulações contínuas,
e visando a redução das perdas por comutação, através das modulações
descontínuas. No Capítulo 3 também foi mostrado que para concentrar
as perdas por comutação em interruptores específicos é necessário que
se adicione seis estados, para uma modulação de cinco segmentos, e
oito estados topológicos, para uma modulação de sete segmentos, o que
164 7 Conclusão Geral
aumenta a complexidade do modulador.

No Capítulo 4, foram propostas modulações equivalentes base-
adas em portadoras para as modulações vetoriais contínuas e descon-
tínuas do Capítulo 3. Para isso, foi proposta uma metodologia que
parte do padrão de pulsos se deseja implementar nos interruptores até
a derivação dos sinais de razão cíclica em função das funções de razão
cíclica de referência. Esse procedimento pode ser estendido para outros
conversores trifásicos. As funções de razão cíclica dos interruptores co-
nectados em delta foram encontradas em função das funções de razão
cíclica dos interruptores conectados estrela. Desta forma, para qual-
quer estratégia de modulação que seja utilizada nos interruptores em
estrela, um padrão de pulsos adequado é obtido para os interruptores
em delta.
Ao longo do estudo da geração dos sinais dos interruptores em
estrela, foram implementadas estratégias hibridas de modulação que
apresentam características intermediárias no que diz respeito à TDH
e perdas por comutação em relação as modulações tradicionais. Foi
mostrado que as estratégias de modulação descontínuas baseadas em
portadoras não são equivalentes às descontínuas vetoriais no instante
da entrada e da saída da região de não modulação. Para reduzir esse
efeito, é possível realizar a inversão da portadora durante as transições
de descontinuidade.
Nas estratégias com RL são necessários dois sinais moduladores
por interruptor bidirecional conectado em delta e um para cada braço
de interruptor conectado em estrela. Já nas estratégias de modulação
com RCMV, os interruptores em estrela não operam de forma comple-
mentar e, portanto, também necessitariam de dois sinais moduladores
para serem comandados. Um circuito lógico adicional foi proposto para
reduzir a complexidade dos moduladores.
A concentração das perdas por comutação apenas nos interrup-
tores em estrela pode ser implementada realizando o deslocamento ver-
tical das funções de razão cíclica. O deslocamento deve ser proporcional
ao tempo de entrada em condução e de bloqueio dos interruptores em
estrela.
No Capítulo 5 buscou-se evidenciar as principais características
do conversor ∆-VSI proposto e verificar em quais condições de operação
o seu desempenho é superior ao de um 2L-VSI. Para isso, o estudo
de caso realizado considerou a comparação do ∆-VSI com o 2L-VSI
com apenas 6 interruptores e o 2L-VSI construído com 12 interruptores
7 Conclusão Geral 165
(mesmos interruptores da topologia proposta).

Na análise de esforços de corrente, verificou-se que o conversor
proposto divide os esforços de corrente em seus doze interruptores de
maneira diferente dependendo do ângulo de fator de potência. Essa
característica, não é verificada para o 2L-VSI e pode ser vantajosa, pois
permite a otimização dos semicondutores para determinados pontos de
operação.
Analisando as perdas por condução do conversor, se os vetores
ativos são realizados com RCL, pode se concluir que o ∆-VSI é sem-
pre mais eficiente que o 2L-VSI com seis interruptores independente do
estado utilizado para realizar o vetor nulo. Observou-se que a impedân-
cia equivalente do vetor nulo realizado com apenas os interruptores em
delta reduz em 30% as perdas por condução (durante o período em que
o vetor nulo é implementado) em relação ao vetor nulo de um 2L-VSI
utilizando seis interruptores. Entretanto, as perdas por condução são
sempre maiores que as de um 2L-VSI com área de silício aumentada.
O vetor nulo que se mostrou mais eficaz para a redução das perdas por
condução foi o que utiliza os interruptores em delta e em estrela simul-
taneamente. A redução verificada foi de 60% que chega a ser maior que
a redução de 50% obtidas com o 2L-VSI com interruptores em para-
lelo. Essa característica pode ser explorada operando o conversor com
baixos índices de modulação. A partir de certos valores de M o ∆-VSI
começa a ser mais eficiente que o 2L-VSI com 12 interruptores.
A estratégia de modulação do conversor deve ser escolhida de
acordo com a característica que se deseja otimizar do conversor. As
modulações descontínuas por um lado, podem reduzir em até 50% as
perdas por comutação quando comparadas com a modulação SVPWM,
mas, por outro, provocam ondulação de corrente sempre superiores.
Observando o espectro da tensão de modo comum do conversor,
verifica-se a grande vantagem de se utilizar apenas os interruptores em
delta para implementar o vetor nulo. A amplitude das harmônicas
e, consequentemente, do valor eficaz da tensão de modo comum do
conversor mostraram uma redução significativa quando o V ~0,RCMV foi
utilizado em relação aos V ~0,RCL e V
~0,VSI .
No Capítulo 6 foi mostrado que, devido às características de
baixa emissão de ruído de modo comum e de redução nas perdas por
condução, o conversor proposto é uma boa opção para conectar fontes
de geração de energia, principalmente as renováveis, com a rede elétrica.
Um protótipo de 10 kW de caráter modular foi projetado e cons-
truído visando confirmar, na prática, os resultados de desempenho do

conversor obtidos na análise teórica. Para atender os requisitos das
normas de conexão um filtro LCL foi utilizado, pois é uma boa opção
para atenuar os harmônicos de alta frequência da corrente injetada na
rede.
A modelagem do conversor associado ao filtro LCL foi realizada
em coordenadas estacionárias αβ e controladores ressonantes foram uti-
lizados para controlar as correntes no lado CA do conversor. O uso
de controladores ressonantes diminui o esforço computacional utilizado
para a realização de transformadas em relação ao uso de controladores
PI no eixo de coordenadas dq.
Foram realizados testes em malha aberta do conversor operando
com uma potência parcial. Os resultados experimentais serviram para
validar a teoria desenvolvida para a operação, modulação e perdas do
conversor.
7.1 Trabalhos Futuros
Para dar continuidade a este trabalho deseja-se:
• Realizar os ensaios de rendimento para as condições nominais;
• Construir o ∆-VSI com componentes de tecnologias distintas

como IGBTs e MOSFETs no mesmo protótipo;
• Implementar as estratégias de modulação híbridas propostas e

identificar suas vantagens e desvantagens;
• Construir o filtro LCL projetado e implementar a estratégia de

controle proposta como conversor conectado à rede;
• Verificar o espectro harmônico das correntes injetadas na rede e

verificar se atendem às normas;
• Implementar técnicas de amortecimento ativo para o filtro LCL;
• Incluir malhas de controle mais externas como malhas de potên-

cia;
• Realizar a comparação do ∆-VSI também com conversores mul-

tiníveis;
7.1 Trabalhos Futuros 167
• Analisar as vantagens das topologias multiníveis com a inserção

dos interruptores conectados em delta.
169
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[84] LANGE, A. B. Retificador PFC Monofásico PWM Bridgless
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178 Referências
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sues. IEEE Transactions on Industrial Electronics, p. 3264–3274,
2011.
179
APÊNDICE A – ALGORÍTMO PARA CÁLCULO DE

ESFORÇOS DO ∆-VSI
A.1 Introdução
A definição do caminho das correntes em conversores que

apresentam interruptores paralelos para a circulação das correntes, na
mesma etapa de operação, é um processo difícil. O percurso da corrente
depende, não apenas do estado de condução dos semicondutores, mas
também de suas características de condução. O grau de complexidade
desta tarefa passa a ser maior quando as características de condução
dos semicondutores são não lineares, como são os casos de IGBTs,
diodos e RB-IGBTs.
Neste apêndice, será apresentada uma metodologia para a deter-
minação da divisão de corrente nos componentes, dentro de um período
de comutação, e os resultados são utilizados para realizar os cálculos
de valor médio, valor eficaz e perdas por condução nos interruptores do
∆-VSI. Os esforços também foram determinados para um 2L-VSI ope-
rando com IGBTs, de modo a realizar uma comparação com o ∆-VSI.
A.2 Modelo Simplificado dos Interruptores
Os semicondutores escolhidos para validar a metodologia de cál-

culo dos esforços de corrente nesta seção são mostrados na Tabela A.1.
IGBTs foram utilizados para a implementação dos interruptores em
estrela e RB-IGBTs para a implementação dos interruptores em delta.
Para a obtenção dos parâmetros dos circuitos simplificados, dois
Tabela A.1: Interruptores utilizados para no ∆-VSI e no VSI para realizar o

cálculo dos esforços nos semicondutores.
Interruptores em estrela Interruptores Delta

IGBT DIODO RB-IGBT
∆-VSI
IKW25N120H3 IKW25N120H3 IXRH40N120
IGBT DIODO −
VSI
Qualquer Qualquer −
180 Apêndice A – Algorítmo para cálculo de Esforços do ∆-VSI
pontos foram escolhidos nas curvas de tensão de condução vs. corrente

dos semicondutores para as maiores temperaturas de junção presentes
nos datasheets. Um ponto é localizado no eixo horizontal das curvas
de condução dos semicondutores e representa a tensão de condução. O
outro ponto é retirado das curvas características. Os pontos escolhidos
para traçar as curvas são listados na Tabela A.2. A partir dos pon-
tos da Tabela A.2 é possível definir as funções lineares por partes que
representam os semicondutores para as condições especificadas.
Tabela A.2: Pontos escolhidos para obter as funções lineares por partes dos
circuitos equivalentes do ∆-VSI.
IGBT RB-IGBT Diodo MOSFET

Pt.1 (1; 0) (1; 0) (1,125; 0) (0; 0)
Pt.2 (2,15; 19,19) (1,95; 14,38) (2,26; 19,03) (2,2; 20)

0 se vce,Igbt ≤ VIgbt
ic,Igbt (vce,Igbt ) = vce,Igbt − VIgbt
 se vce,Igbt > VIgbt
RIgbt
(A.1)

0 se vce,Igbt ≤ 1
= vce,Igbt − 1 ,
 se vce,Igbt > 1
0.06

0 se vce,RB ≤ 1
ic,RB (vce,RB ) = vce,RB − 1 , (A.2)
 se vce,RB > 1
0, 066

0 se vce,D ≤ 1, 125
ic,D (vce,D ) = vce,D − 1, 125 , (A.3)
 se vce,D > 1, 125
0, 06
vds vds
ic,M (vce,M ) = = (A.4)
RM 0,110
As curvas simplificadas sobrepostas às curvas interpoladas dos
datasheets são mostradas na Figura A.1.
Figura A.1: Curvas características dos semicondutores analisados: (a) Diodo,

(b) IGBT, (c) RB-IGBT, (d) MOSFET-SiC.
A.3 Determinação dos Parâmetros dos Circuitos Equivalen-

tes
O ângulo δ de deslocamento entre tensão e corrente define a am-

plitude e o sentido que as correntes de fase terão em cada sextante que,
por sua vez, definem os valores das fontes de tensão e das resistências
dos circuitos equivalentes da Figura 5.2. Os valores dos parâmetros
podem mudar dentro de um sextante dependendo do sentido e da am-
plitude das correntes de fase. Os valores definidos são mostrados na
Tabela A.3 para o V ~1 . Para a determinação do sinal da tensão de
condução dos circuitos equivalentes, considera-se que:
• as correntes seguirão o mesmo sentido que seguiriam para o caso

em que os semicondutores são modelados apenas por uma resis-
tência;
• o sinal da tensão deve ser escolhido de tal modo que a potência nos
semicondutores seja positiva para a condição descrita no primeiro

item.
Tabela A.3: Parâmetros dos circuitos equivalentes da Figura 5.2 para dife-
rentes condições de corrente quando V
~1,RCL é implementado.
Os parâmetros foram definidos para os demais vetores e podem ser

encontrados realizando as equivalências contidas na Tabela A.4 Para o
vetor nulo com RCMV os parâmetros são definidos seguindo a Tabela
A.5.
Tabela A.4: Relação entre as correntes e as tensões de condução para os
outros vetores dos circuitos equivalentes da Figura 5.2.
Tabela A.5: Parâmetros dos circuitos equivalentes da Figura 5.2 para dife-
rentes condições de corrente quando V
~0,RCMV é implementado.
A.4 Definição das Envoltórias de Corrente
Uma vez definidos o valor das tensões e das resistências de con-

0 0
dução, as tensões V1 e V2 de cada circuito equivalente são calculadas
para todo o período da componente fundamental da corrente. Essas
tensões são utilizadas para determinar a divisão de corrente entre os
semicondutores em paralelo durante a aplicação dos vetores. As solu-
0 0
ções para V1 e V2 para o vetor V
~1,RCL são, respectivamente,
0 ic RSbn RScn + ib RSbn (RScn + RSbc )

V1 = − +
RSbn + RScn + RSbc
(A.5)
VSbn (RScn + RSbc ) + (VScn − VSbc ) RSbn
+
RSbn + RScn + RSbc
e
0 ib RSbn RScn + ic RScn (RSbn + RSbc )
V2 = − +
RSbn + RScn + RSbc
(A.6)
VScn (RScn + RSbc ) + (VSbn + VSbc ) RScn
+ .
RSbn + RScn + RSbc
0
A solução de V12 para o vetor nulo V
~0,RCMV é dada por
0 ia RSab RSca − ib RSab RSbc

V12 =
RSab + RSbc + RSca
(A.7)
(RSbc + RSca )VSab + RSab (VSbc − VSca )
+ .
RSab + RSbc + RSca
0 0 0
As soluções para V1 , V2 e V3 para o vetor nulo V
~0,RCL são respectiva-
mente
0 −RSab (ib RSbc RSbp − RSbp VSbc + RSbc VSbp ) + RSbc RSbp VSab
V1 = ,
RSbc RSbp + RSab (RSbc + RSbp )
(A.8)
0 −RSbc (ic RSca RScp + RScp VSca + RSca VScp ) − RSca RScp VSbc
V2 = ,
RSca RScp + RSbc (RSca + RScp )
(A.9)
A.4 Definição das Envoltórias de Corrente 185
e
0 −RSca (ia RSab RSap + RSap VSab + RSab VSap ) + RSab RSap VSca
V3 = .
RSap RSca + RSab (RSap + RSca )
(A.10)
Após o cálculo das tensões, as envoltórias de corrente podem ser
determinadas seguindo algumas considerações:
• Em situações em que a corrente encontra uma bifurcação e, pelo
menos uma das potências dos elementos do circuito é negativa,
ela seguirá o caminho com menor fonte de tensão até que todas
as potências nos elementos dos circuitos equivalentes passem a
ser positivas. Neste caso caso não há divisão de correntes nos
dispositivos em paralelo;
• Quando a potência em todos os elementos do circuito equivalente
passa a ser positiva, as envoltórias de corrente são determinadas
pelas equações dos nós. Neste caso, há uma divisão de corrente
entre semicondutores em paralelo.
Seguindo as regras definidas, chega-se nas funções utilizadas para o cál-
culo das envoltórias de corrente em cada uma das condições de corrente
de cada vetor. Considerou-se que o sentido positivo para as correntes
é o contrário ao apresentado pela Figura 5.2. Durante a aplicação de
V1,RCL , só há circulação da corrente ia pelo IGBT quando ia ≥ 0, caso
contrário ela circula pelo diodo
(
ia (δ) se ia (δ) ≥ 0,
iSap,V 1 (δ) = (A.11)
0 se ia (δ) < 0.
Para simplificação da notação foi omitida a variável ωt das correntes

de fase. Para o interruptor Sbc1 a corrente depende do sentido das
correntes e das tensões V1 e V2 calculadas conforme mostra os itens a
seguir:
• ia ≥ 0, ib < 0, ic > 0

0 < V1 − V2 < VSbc
 0 se


iSbc1,V 1 (δ) = ou VSbc < 0
 V1 − (VSbc − V2 )

se V1 − V2 > VSbc > 0

RSbc
(A.12)
• ia > 0, ib < 0, ic ≤ 0

0 < V1 − V2 < VSbc
 0 se


 V1 − (VSbc − V2 )

se V1 − V2 > VSbc > 0

RSbc
(A.13)
• ia > 0, ib ≥ 0, ic < 0
iSbc1,V 1 (δ) = 0 (A.14)
• ia ≤ 0, ib > 0, ic < 0
iSbc1,V 1 (δ) = 0 (A.15)
• ia < 0, ib > 0, ic ≥ 0

0 < V1 − V2 < VSbc
 0 se


 V1 − (VSbc − V2 )

se V1 − V2 > VSbc > 0

RSbc
(A.16)
• ia < 0, ib < 0, ic ≥ 0

0 < V1 − V2 < VSbc
 0 se


 V1 − (VSbc − V2 )

se V1 − V2 > VSbc > 0

RSbc
(A.17)
Durante a aplicação do V ~2 , só há circulação de corrente pelo
0
IGBT quando a tensão V2 é negativa, caso contrário, a corrente circula
pelo diodo. As equações que definem as envoltórias de corrente para o
interruptor Sap para o vetor V
~2,RCL são:
• ia ≥ 0, ib < 0, ic > 0

0 ≤ −V2 ≤ VSap
 0 se


iSap,V 2 (δ) = ou VSap < 0 (A.18)
 −V2 − VSap

 se −V2 > VSap > 0
RSap
• ia > 0, ib < 0, ic ≤ 0

 −ic (δ) se −V2 ≤ VSap
iSap,V 2 (δ) = −V2 − VSap (A.19)
 se −V2 > VSap
RSap
• ia > 0, ib ≥ 0, ic < 0

 ia (δ) se −V2 ≤ VSap
iSap,V 2 (δ) = −V2 − VSap (A.20)
 se −V2 > VSap
RSap
• ia ≤ 0, ib > 0, ic < 0

0 ≤ −V2 ≤ VSap
 0 se


iSap,V 2 (δ) = ou VSap < 0 (A.21)
 −V2 − VSap

 se −V2 > VSap > 0
RSap
• ia < 0, ib > 0, ic ≥ 0
iSap,V 2 (δ) = 0 (A.22)
• ia < 0, ib < 0, ic ≥ 0
iSap,V 2 (δ) = 0 (A.23)
Aplicando as mesmas regras para o vetor nulo V ~0,RCMV são ob-

tidas as seguintes expressões para a corrente no interruptor Sbc1 :
• ia ≥ 0, ib < 0, ic > 0

 ic (δ) se V1 − V2 < VSbc
iSbc1,V 0 (δ) = V − (VSbc − V2 )
 1 se V1 − V2 > VSbc
RSbc
(A.24)
• ia > 0, ib < 0, ic ≤ 0

0 < V1 − V2 < VSbc
 0 se


 V1 − (VSbc − V2 )

se V1 − V2 > VSbc > 0

RSbc
(A.25)
• ia > 0, ib ≥ 0, ic < 0
iSbc1,V 0 (δ) = 0 (A.26)
• ia ≤ 0, ib > 0, ic < 0
iSbc1,V 0 (δ) = 0 (A.27)
• ia < 0, ib > 0, ic ≥ 0

0 < V1 − V2 < VSbc
 0 se


 V1 − (VSbc − V2 )

se V1 − V2 > VSbc > 0

RSbc
(A.28)
• ia < 0, ib < 0, ic ≥ 0

 −ib (δ) se V1 − V2 < VSbc
iSbc1,V 0 (δ) = V − (VSbc − V2 )
 1 se V1 − V2 > VSbc
RSbc
(A.29)
O procedimento resumido para o cálculo das envoltórias de cor-

rente é mostrado na Figura A.2. As envoltórias de corrente calculadas
pelo algoritmo foram ilustradas juntamente com as correntes simuladas
na Figura A.3 para δ = π. Observa-se que os valores calculados defi-
nem com precisão as correntes simuladas. Os valores médios e eficazes
nos interruptores foram calculados, utilizando as correntes resultantes
da metodologia proposta, e simulados para um ponto de operação. O
Resultado pode ser visto na Figura A.4, onde as marcações nos grá-
ficos correspondem aos valores simulados. O resultado mostra que os
valores médios e eficazes obtidos analiticamente para as correntes nos
interruptores correspondem precisamente aos valores simulados.
Figura A.2: Procedimento para cálculo das envoltórias de corrente.
Figura A.3: Envoltórias de corrente nos interruptores do ∆-VSI.
Os valores médios e eficazes das correntes nos diodos do ∆-VSI

são obtidos de forma análoga aos valores obtidos para os interruptores
controlados em estrela. Para o ∆-VSI, operando com as modulações
com RCMV, os esforços de corrente e, consequentemente, as perdas por
condução são iguais para todas as estratégias de modulação contínuas
e descontínuas apresentadas neste trabalho.
Já o 2L-VSI apresenta pequenas diferenças nos esforços de cor-
rente e perdas por condução dependendo do ângulo de fator de potên-
cia δ que se deseja operar. A Figura A.5(a) mostra o valor médio das
correntes nos semicondutores do VSI variando o ângulo do fator de po-
Figura A.4: Valores médios e eficazes da corrente nos interruptores do ∆-VSI

empregando as modulações com RCMV: (a) valor médio das correntes nos
semicondutores variando M e δ; (b) valores médio e eficaz das correntes nos
interruptores variando δ com M = 0,71.O conversor opera com Ipk = 21,5 A.
tência e o índice de modulação. A Figura A.5(b) mostra o valor das

correntes médias e eficazes nos semicondutores do VSI para um índice
de modulação M = 0, 71. Os pontos nos gráficos indicam os valores
obtidos com as simulações, comprovando a análise realizada. É possí-

vel perceber pequenas diferenças em torno dos esforços de corrente da
SVPWM para as modulações descontínuas devido à diferença do sinal
de eixo zero injetado nas funções de modulação.
Figura A.5: Valores de corrente média e eficaz nos interruptores do 2L-VSI

empregando as estratégias de modulação DPWM1, SVPWM e DPWM3: (a)
valor médio de corrente nos semicondutores variando M e δ; (b) valores
médios e eficazes nos interruptores variando δ com M = 0,71. O conversor
opera com Ipk = 21,5 A.
193
APÊNDICE B – PROJETO FÍSICO DOS INDUTORES DO

FILTRO LCL
B.1 Introdução
O projeto físico do filtro LCL é uma etapa importante quando

se deseja projetar um conversor que, além de atender às normas de
emissões eletromagnéticas, devem também apresentar volume e perdas
reduzidos.
A metodologia seguida é baseada no trabalho desenvolvido em
[84]. O projeto realizado busca a minimização do volume de mate-
rial magnético e leva em conta as características de diferentes tipos de
núcleos. Os valores de indutância dos indutores do lado do conversor
e do lado da rede foram calculados no Capítulo 6. As especificações
utilizadas no projeto físico dos indutores são mostrados na Tabela B.1.
Tabela B.1: Tabela contendo os parâmetros utilizados para realizar o projeto

físico dos indutores do filtro LCL.
Parâmetro Valor
Indutância mínima (Lc,min ) 460 µH
Corrente de pico (Ipk ) 21,5 A
Temperatura ambiente (Tamb ) 45 ◦ C
Temperatura máxima de operação (Toper ) 120 ◦ C
Fator de utilização máximo (Ku,max ) 0,4
A seguir, será feita uma descrição geral do algoritmo desenvol-

vido. Para maiores detalhes sobre as expressões e a metodologia, con-
sultar [84].
B.2 Procedimento de Projeto
O algoritmo resumido é mostrado em forma de fluxograma na

Figura B.1 O procedimento é iniciado com a obtenção de dados de
simulação de um período da componente fundamental da corrente no-
194 Apêndice B – Projeto Físico dos Indutores do Filtro LCL
Figura B.1: Fluxograma utilizado para o cáclulo do indutor do lado do con-

versor.
B.2 Procedimento de Projeto 195
minal que atravessa o indutor a ser projetado. O espectro da corrente

é calculado para ser utilizado adiante no cálculo de perdas.
B.2.1 Determinação do Número de Espiras e do Número de

Núcleos em Paralelo
Como citado anteriormente, o projeto foi realizado considerando
núcleos de materiais magnéticos e de empresas diferentes. Os núcleos
avaliados são mostrados na Tabela B.2.
Tabela B.2: Núcleos considerados para realizar o projeto dos indutores do

filtro LCL.
Núcleo Utilizado Empresa Material

APH33P60 Amosense Pó de ferro
0078192A7 Magnetics X-Flux
0078439A7 Magnetics X-Flux
C055195A2 Magnetics MPP
O algoritmo da Figura B.1 é testado para cada um dos núcleos e,

ao final, é escolhido o projeto que atende as especificações com o menor
volume de material magnético.
O primeiro passo consiste em determinar a quantidade de espiras
necessárias para se conseguir a indutância especificada sem saturar o
núcleo. Considerou-se que o número de espiras deve ser tal que a den-
sidade de fluxo no pico da corrente no indutor seja 80% da densidade
de fluxo máxima para o material, ou seja
0, 8Bsat · lc
Nmax,B = , (B.1)
µ0 · µi · Ipk
onde Bsat é a densidade de fluxo de saturação do núcleo, lc é o com-

primento do caminho magnético em metros, µ0 é a permeabilidade
absoluta do vácuo (4π · 10−7 H/m) e µi é a permeabilidade inicial do
material.
O valor do número de espiras é variado de 1 até Nmax,B até que

se obtenha a indutância de projeto calculada por
Lob (N ) = AL · µpu (Hint , fint ) · N 2 , (B.2)

2
onde AL corresponde ao fator de indutância (nH/espira ), N ao número
de espiras e µpu à permeabilidade do material normalizada em relação
à permeabilidade inicial µi . Esta permeabilidade é calculada para o
ponto de interesse, ou seja, Hint = Hpk e fint = fs .
A permeabilidade normalizada (µpu ), que define o valor da in-
dutância, depende da intensidade de campo bem como da frequência
do fluxo que circula no núcleo conforme
µpu (Hint , fint ) = µpu,H (Hpk ) · µpu,f (fs ). (B.3)
Em (B.3), µpu,H corresponde à permeabilidade normalizada em função

da intensidade do campo aplicado, e µpu,f corresponde à permeabili-
dade normalizada em função da frequência.
Os valores das duas permeabilidades podem ser encontrados nas
folhas de dados dos elementos magnéticos. A permeabilidade µpu,f foi
considerada unitária por se estar trabalhando com frequências relativa-
mente baixas. A Figura B.2 mostra µpu,H variando com a intensidade
de campo para os materiais dos núcleos do banco de dados do algoritmo.
Quando não é possível possível se atingir a indutância especi-
Figura B.2: Permeabilidade normalizada em relação à intensidade de campo

para os materiais dos núcleos avaliados.
ficada com apenas um núcleo, um outro é adicionado e os cálculos

refeitos. Esse procedimento foi proposto para que se obter um projeto
válido em termos de indutância com cada um dos núcleos.
B.2.2 Escolha do Condutor
A escolha do condutor foi feita de modo a minimizar as perdas no

cobre e, consequentemente, a elevação de temperatura. Os condutores
AWG, variando da numeração 11 a 40, foram testados a começar com a
numeração maior. As perdas no cobre devido às correntes de baixa e de
alta frequência foram calculadas para cada bitola de fio, e foi escolhida a
numeração que dissipava menor potência e que era fisicamente possível
de se implementar.
A quantidade máxima de espiras que é fisicamente possível de
se enrolar em um núcleo toroidal, respeitando um fator de utilização
especificado, foi estimada pela expressão
ID2
Nmax,w = Ku,max · , (B.4)
d2iso
onde ID corresponde ao diâmetro interno do núcleo (m) e diso é o
diâmetro do condutor com isolação (m). A quantidade de espiras que
podem ser acomodadas por camada é calculada por

ID
n
Nmax,cam = π − (2n − 1) , Ncam ≥ 1, (B.5)
di
onde n é o número da camada. A quantidade de camadas de condutores

é definida pela relação
N
Ncam = n=nec , (B.6)
X
n
Nmax,cam
n=1
onde nec é a quantidade de camadas inteiras necessárias para acomodar

todos as espiras do indutor. O valor de Ncam não, necessariamente, é
um número inteiro. Este valor é importante para determinar as perdas
nos condutores principalmente devido às correntes de alta frequência.
B.2.3 Perdas nos Condutores
Para se calcular as perdas nos condutores de cobre do indutor, é

necessário determinar o valor das resistências para as correntes contínua
e alternada. O valor da resistência para a corrente contínua pode ser
calculado por
4lw · ρT
Rcc = , (B.7)
π · d2b
onde lω é o comprimento total calculado para o condutor [m], db é
o diâmetro de cobre do condutor e ρT é a resistividade do cobre na
temperatura máxima de operação (Tmax ) estipulada para o projeto
ρT = 17,8 · 10−9 · [1 + 0,0039 · (Tmax − 20)] [Ω · m]. (B.8)
A resistência para as correntes CA são dependentes da frequência

conforme mostrado em
Rca (f ) = Rcc · Fr (f ). (B.9)

Considerando-se a influência dos efeitos pelicular e de proximidade em
um enrolamento multi-camadas, o fator de resistência pode ser aproxi-
mado por [71], [84]
e2A − e−2A + 2 sen(2A)

Fr (f ) = A · + (B.10)
e2A + e−2A − 2 coss(2A)
eA − e−A − 2 sen(A)

2 2
Ncam − 1 · A ,
3 e + e−A + 2 coss(A)
onde π 34 db √
A= · · ηw . (B.11)
4 δw
Na Equação (B.11), ηw é o fator de porosidade, considerado ti-
picamente igual a 0, 8, e δw é a profundidade de penetração do cobre
na temperatura máxima de operação calculado por
r
ρT
δw = . (B.12)
π · µ0 · f
O fator de resistência é mostrado na Figura B.3 para condutores

AWG 12 agrupados em diferentes valores de camadas.
Figura B.3: Fator de resistência para o condutor AWG 12 agrupados em

diferentes quantidades de camadas.
O espectro harmônico das correntes simuladas é utilizado para

realizar o cálculo das perdas no cobre. A potência dissipada no cobre,
considerando-se a presença de todas as componentes harmônicas da
corrente e a resistência para corrente alternada para cada uma delas, é
determinada por
∞
X
2
(B.13)

Pw = In,ef · Rca (n · ff ) .
n=1
Para o cálculo da potência dissipada pela componente funda-

mental da corrente, considera-se que Rca (ff ) ≈ Rcc . Logo, a potência
dissipada pela componente fundamental é aproximadamente
2
Ipk
Pw,lf ≈ . (B.14)
2Rcc
A potência total dissipada no cobre é determinada pela soma das
potências dissipadas em alta e em baixa frequência conforme
Pw = Pw,lf + Pw,hf . (B.15)

B.2.4 Perdas no Magnético

As perdas no material magnético foram calculadas utilizando
um algoritmo proposto inicialmente para núcleos de ferrite [85], mas
que também apresentaram resultados satisfatórios para núcleos de pó
de ferro [84]. O método é denominado na literatura como Equação
de Steimetz Generalizada Melhorada (Improved Generalized Steimetz
Equation) (iGSE) e os parâmetros de Steimetz (k, α, β) são únicos pa-
râmetros necessário dos núcleos. Para maiores detalhes sobre o método,
é sugerida a leitura das referencias [84], [85].
B.2.5 Elevação de Temperatura

A elevação de temperatura no indutor é resultado da potência
total dissipada no núcleo e no cobre. A potência total dissipada pelo
indutor do lado do conversor é dada por
PLc = Pc + Pw . (B.16)
A elevação de temperatura pode ser estimada pela expressão [71],

[86]
∆TLc = PLc · 415,17(Np · Ae Aw )−0,3593 [◦ C], (B.17)
onde Np representa a quantidade de núcleos em paralelo, e Ae Aw [mm4 ]
representa o produto entre as áreas da seção transversal do núcleo com
a área da janela. A temperatura final de operação do núcleo é deter-
minada por
Toper = Tamb + ∆TLc . (B.18)
B.3 Resultados Obtidos
Ao final do algoritmo, dentre os projetos realizados, apenas os

que utilizaram núcleos X-flux da Magnetics não extrapolaram a tem-
peratura máxima de operação e o que apresentou menor volume foi o
realizado com o núcleo 0078192A7. Alguns dos resultados obtidos com
o algoritmo acerca do projeto realizado foram reunidos na Tabela B.3.
Para o indutor do lado da rede, foi utilizado o mesmo núcleo e a mesma
quantidade de espiras, com a diferença que foi utilizado apenas um nú-
cleo por indutor.
B.3 Resultados Obtidos 201
Tabela B.3: Resultados obtidos para o projeto do indutor do lado do conver-

sor.
Parâmetro Resultado
Núcleo Escolhido 0078192A7
Núcleos em paralelo 2
Número de Espiras 53
Indutância Inicial 775 µH
Indutância com Ipk 467 µH
Fator de ocupação obtido 0,362
Comprimento total do fio 4,85 m
Bitola AWG 12
Perdas no cobre 9,2 W
Perdas no núcleo 4,6 W
Perdas Totais 13,9 W
Elevação de Temperatura 67,5 ◦ C
Temperatura final 112,5 ◦ C
203
APÊNDICE C – DIAGRAMAS ESQUEMÁTICOS
OBS: Os valores de alguns dos capacitores e resistores dos es-

quemáticos devem ser recalculados dependendo da aplicação em que o
conversor é empregado.
204
1 2 3 4
To Voltage Measurements
+5VA Con_V +5VA
To DSP/FPGA
+3V3
1 12
X1
CANTX
UARTTX
uAxN 2 13 uAxM To DSP
+5V EN
uAxP 3 14 u1C GND 1 2 GND +5V
SPIBCLK SPIBSOMI
u1A 4 15 u1B SPIBCLK 3 4 SPIBSOMI 1 2 QEP1STR/GPIO
SPIBSIMO X2
9
7
5
3
1
A 5 16 SPIBSIMO 5 6 QEP1INDEX 3 4 QEP1B A
CSSPI4 CSSPI1
u2C 6 17 +3.3A CSSPI4 7 8 CSSPI1 5 6 QEP1A To DSP
u2A 7 18 +3.3A GND 9 10 +3V3
GND ENCODER
10
8
6
4
2
u2B 8 19
HWMon DSPLink
9 20 ADCAx-B6
uMID 10 21 ADCAx-A7 GND +5V
uPOS 11 22 ADCAx-B7 GND
To DSP
Analog JTAG
1 2 +5V +5VA
CANRX
UARTRX
TMS (49) TMS TRSTn TRSTn (99)

GND To Current Measurements GND +3V3 3 4
TDI(97) TDI GND
+5VA Con_I +5VA 5 6
PD NC La2
7 8
1 12 TDO (98) TDO GND
9 10 +3.3A +3V3
i1aRef 2 13 i1a TCK (48) TCK GND
11 12
i2aRef 3 14 i2a TCK_ GND
13 14
4 15 EMU0 (100) EMU0 EMU1 EMU1 (50) La1
i1bRef 5 16 i1b
JTAG DSP
i2bRef 6 17 i2b
7 18
GND
B iPosRef 8 19 iPos B
iNegRef 9 20 iNeg Boot Mode +5V Reg1 LM3940 +3V3
+3.3A 10 21 +3.3A SW1 To DSP
1 3
11 22 IN OUT
1 8
GPIO-84 (31) Cr1 GND Cr2
Analog 2 7
GPIO-85 (81) 470nF 33uF
GND GND 3 6
2
GPIO-86 (32)
4 5
GPIO-87 (42)
SW DIP-4 GND GND GND
Rsw1 Rsw2 Rsw3 Rsw4
2k2 2k2 2k2 2k2
To FPGA
Con_Out +5VA Cq1

GND
GPIO1 1 2 GPIO2 Serial Interface
GPIO3 3 4 GPIO4 Rq1
220 100nF
+3V3 5 6 +3V3 J1 To DSP
REF3.0
7 8 Rse11 Rq2 170R
+5V 9 10 +5V +5V REF1.5
0R 6
C 11 12 C
2 11 LM4040
OPWM29 13 14 RL-A1 RX-ISO GND-ISO (6,56) NC Cq2 Rq3
7
OPWM30 15 16 FANPWM 1uF Cq3
3 10 Reg2
OPWM27 17 18 OPWM14 TX-ISO GND-ISO (6,56) 100nF
8 170R
OPWM28 19 20 OPWM13
4
21 22
Rse2 0R 9
OPWM25 23 24 OPWM12 +5V
5 GND
OPWM26 25 26 OPWM11 GND-ISO (6,56)
OPWM23 27 28 OPWM10
OPWM24 29 30 OPWM9 DB9 Connector
J3 Fêmea
31 32
OPWM21 33 34 OPWM8 To DSP
OPWM22 35 36 OPWM7 GND-ISO (6,56)
OPWM19 37 38 OPWM6 3V3-ISO (1,51)
OPWM20 39 40 OPWM5 Con2 Molex
41 42
OPWM17 43 44 OPWM4
Entrada para fonte externa
OPWM18 45 46 OPWM3
Apêndice C – Diagramas Esquemáticos
isolada.
OPWM15 47 48 OPWM2 Para utilizar é necessário
D OPWM16 49 50 OPWM1 remover os resistores de 0 ohm D
Header 25X2 (jumpers) da controlcard
GND GND Power Electronics Institute

Title: Placa de Controle: Conectores e fontes
Size: A4 Sheet 1 of 6
Date: 02/07/2013 Time: 19:43:19
1 2 3 4
1 2 3 4
RCA7 RCB7
30k 30k
GND GND
RCA2 +5VA RCB2 +5VA
7
7
0R 1 UCA 0R 1 UCB
RCA1 RCA3 2 MAX4238 RCB1 RCB3 2 MAX4238
A i1aRef RCA8 RCA9 i2aRef RCB8 RCB9 A
0R 51k 6 AD3 0R 51k 6 AD2
RS1 ADCIN-A3 RS2 ADCIN-A2
RCA5 3 100R 0R RCB5 3 100R 0R
0R 51k +5VA CCA1 0R 51k +5VA CCB1
RCA4 RCA6 100nF RCB4 RCB6 10nF
4
4
i1a 60k 60k i2a 60k 60k
CCA2 CCB2
GND 100nF GND GND 100nF GND
REF3.0 REF3.0
GND GND
GND GND
RCD7
RCC7 30k
30k GND
GND
RCD2 +5VA
7
RCC2 +5VA 0R UCD
1
7
0R 1 UCC RCD1 RCD3 2 MAX4238
RCC1 MAX4238 i2bRef RCD8 RCD9
RCC3 2 0R 51k 6
B i1bRef RCC8 RCC9 RS4 ADCIN-B1 B
0R 51k 6 AD1 RCD5 3 100R 0R
RS3 ADCIN-A1 0R CCD1
RCC5 3 100R 0R 51k +5VA
0R 51k +5VA CCC1 RCD4 RCD6 10nF
RCC4 RCC6 10nF i2b 60k 60k 4
4
i1b 60k 60k CCD2
CCC2 RCE7 GND 100nF GND
100nF REF3.0
GND GND 30k
REF3.0
GND GND
GND GND
GND RCG1 RCG3
RCE2 +5VA ADCIN-B6 ADCAx-B6
7
0R 10R
AD1 0R 1 UCE RCG2
1 6 RCE1 RCE3 2 MAX4238 10k CCG1
+3.3A Vdd CS J_GPIO_11 iPosRef RCE8 RCE9 47nF
0R 51k 6 iPos_m
CAD1 ADCIN-B2
RS5 iPos RCE5 3 100R 0R
100nF 2 5 0R 51k +5VA CCE1
GND GND SDATA J_GPIO_12 RCE4 RCE6 10nF GND
4
GND iPos 60k 60k
AD1 RAD1 3 4 CCE2
C Vin SCLK J_GPIO_10 100nF RCH1 RCH3 C
0R GND GND
REF3.0 ADCIN-A7 ADCAx-A7
AD7276 0R 10R
AD2 GND RCH2
1 6 GND 10k CCH1
+3.3A Vdd CS J_GPIO_4 47nF
CAD2 RCF7
100nF 2 5 30k
GND GND SDATA J_GPIO_5
GND GND
GND
AD2 RAD2 3 4 RCI1 RCI3
Vin SCLK J_GPIO_6 RCF2 +5VA ADCIN-B7 ADCAx-B7
7
0R 0R 10R
AD7276 0R 1 UCF RCI2
AD3 RCF1 RCF3 2 MAX4238 10k CCI1
iNegRef RCF8 RCF9 47nF
1 6 0R 51k 6 iNeg_m
+3.3A Vdd CS J_GPIO_1 ADCIN-B3
iNeg RCF5 3 100R 0R
CAD3 RS6 0R 51k +5VA CCF1
100nF 2 5 RCF4 RCF6 10nF GND
4
GND GND SDATA J_GPIO_0 iNeg 60k 60k

GND CCF2
D D
205
AD3 RAD3 3 4 GND 100nF GND

Vin SCLK J_GPIO_2 REF3.0
0R
AD7276 GND
GND Power Electronics Institute
Title: Placa de Controle: Condicionamento dos sinais de corrente e ADCs
Date: 02/07/2013 Time: 19:53:21
1 2 3 4
206
1 2 3 4
+3.3A
DC01
uAxP RVA1 BAT 54S RVA5 uDCP_mRVA9
uAxP ADCIN-A5
10k 500R 0R +3.3A GND
CVD2
CVA1 100n
4
A RVA4 10nF DC07 RVD10 A
UCVD2 RVD9 uDC_m
BAT 54S RVD5 RVD6 ADCIN-A6
GND 3k3 uPOS RVD1 3 MAX4238 100R 0R
uPOS
+3.3A 10k 4k7 1k3 6
RVA6 GND CVD3 2 CVD4 +5VA
+5VA 3k3 +5VA RVD8 10nF
1
7
DC02 RVD3 GND 1k
1
7
uAxM RVA2 BAT 54S 2 GND 3k3 10n CVD5
uAxM CVA3 RVD7 +5VA 100nF
10k 6 +3.3A GND
3 100nF RVD4 100k
+5VA 3k3
UCVA1
7
REF1.5 MAX4238 DC08 1 Active Lowpass Filter
4
RVD2 +5VA
GND GND uMid BAT 54S 2 2nd Order GND
RVA7 uMID CVD1 AV=(1+RC430/RC43)
10k 6
+3.3A GND 3k3 3 100nF fc=sqrt(RC41xRC42xCC15xCC16)
UCVD1
REF1.5 MAX4238
4
DC06 GND GND
uAxN RVA3 BAT 54S RVA8 RVA10
uDCN_m
uAxN ADCIN-B5
10k 500R 0R GND
B B
CVA2
10nF +3.3A
GND
GND DC09
u1B RVB1 BAT 54S RVB9
RVB5 u1BA_m
u1B ADCIN-A4
10k 100R 0R
CVB1
CVC1 GND 10nF
100n GND RVB6
RVB4 3.3k
4
+3.3A UCVC2 +3.3A 3.3k GND
RVC9 3 MAX4238
RVC13 +5VA
6 RVC12 u2BA_m +5VA
7
1k3 ADCIN-A0
DC03 2 100R 0R DC10 1
u2B RVC1 BAT 54S RVC5 1 u1A RVB2 BAT 54S 2
u2B CVC2 CVC3 +5VA u1A CVB3
6
7
C 10k 4k7 10k C
RVC11 10nF 3 100nF
1k UCVB1
GND CVC4
10n +5VA REF1.5 MAX4238
4
GND RVC6 RVC10 GND 100nF GND

RVC4 3.3k GND
100k
+3.3A 3.3k +5VA Active Lowpass Filter GND
2nd Order +3.3A
+5VA RVB7
AV=(1+RC18/RC17) GND
7
DC04 1 CVC9 fc=sqrt(RC12xRC14xCC04xCC03) 3.3k
u2A RVC2 BAT 54S 2 100nF DC11
u2A CVC5 RVB3 BAT 54S RVB10
10k 6 u1C RVB8 u1CA_m
100n GND u1C ADCIN-B4
3
4
10k 100R 0R
UCVC1 UCVC3
REF1.5 MAX4238 GND RVC14 3 MAX4238 CVB2
4
GND 6 RVC17 u2CA_m RVC18 10nF
1k3 ADCIN-B0
2 100R 0R GND
+3.3A GND 1 +5VA
CVC7 GND
7
RVC7 10nF
D DC05 3.3k RVC16 CVC8 D
u2C RVC3 BAT 54S CVC6 +5VA 1k 100nF
u2C RVC8
10k GND
4k7 Power Electronics Institute
RVC15
10n Title: Placa de Controle: Condicionamento de Sinais de Tensão
GND
100k GND Size: A4 Sheet 3 of 6
GND Date: 02/07/2013 Time: 19:37:01
1 2 3 4
1 2 3 4
DSP1
1 51
3V3-ISO (1,51) 3.3V - ISO 3.3V - ISO 3V3-ISO (1,51)
2 52
RX-ISO ISO-RX-RS232 ISO-TX-RS232 TX-ISO
3 53
53
4 54
A 54 A
5 55
J4 55
6 TMS320F28335 56
GND-ISO (6,56) GND_ISO GND_ISO GND-ISO (6,56)
7 57
ADCIN-B0 ADC - B0 ADCIN-A0 ADCIN-A0
8 58
GND GND
Con2 Molex 9 59
+3.3A 10 60
RBot1 GND GND
11 61
330 12 62
GND GND
13 63
SW1 14 64
GND GND
+3.3A Sw3 15 65
RBot2 ADCIN-B4 ADC - B4 ADCIN-A4 ADCIN-A4
GND 16 66
330 17 67
SW1 18 68 SW2 GND
GPIO-58/MCLKR-A/XD21 GPIO-59/MFSR-A/XD20
SW2 19 69
Sw2 LED1 20 70 LED2
GPIO-60/MCLKR-B/XD19 GPIO-61/MFSR-B/XD18
GND 21 71
A1 ADCIN-B7 ADC - B7 ADCIN-A7 ADCIN-A7
LED3 22 72 LED4
GPIO-62/SCIRX-C/XD17 GPIO-63/SCITX-C/XD16
23 73
B RL1 EPWM-1A GPIO-00/EPWM-1A GPIO-01/EPWM-1B/MFSR-B EPWM-1B B
LED1 A K 24 74
EPWM-2A GPIO-02/EPWM-2A GPIO-03/EPWM-2B/MCLKR-B EPWM-2B
25 75
EPWM-3A GPIO-04/EPWM-3A GPIO-05/EPWM-3B/MFSR-A/ECAP-1 EPWM-3B
U18A 26 76
V1 EPWM-4A GPIO-06/EPWM-4A/SYNCI/SYNCO GPIO-07/EPWM-4B/MCLKR-A/ECAP-2 EPWM-4B
27 77
GND +5V +5V

28 78
RL2 EPWM-5A GPIO-08/EPWM-5A/CANTX-B/ADCSOC-A GPIO-09/EPWM-5B/SCITX-B/ECAP-3 EPWM-5B
LED2 A K 29 79
EPWM-6A GPIO-10/EPWM-6A/CANRX-B/ADCSOC-B GPIO-11/EPWM-6B/SCIRX-B/ECAP-4 EPWM-6B
FAN_PWM30 80 REL-D
GPIO-48/ECAP5/XD31 GPIO-49/ECAP6/XD30
U18B GND 31 81
A2 GPIO-84 (31) GPIO-84 GPIO-85 GPIO-85 (81)
32 82
GPIO-86 (32) GPIO-86 +5V
+3.3A SPIBSIMO 33 83 SPIBSOMI
RL3 SPIBSIMO GPIO-12/TZ-1/CANTX-B/MDX-B GPIO-13/TZ-2/CANRX-B/MDR-B SPIBSOMI
LED3 A K TRIP4/GPIO34 84 TRIP3/GPIO
TRIP4/GPIO GPIO-15/TZ-4/SCIRX-B/MFSX-B GPIO-14/TZ-3/SCITX-B/MCLKX-B TRIP3/GPIO
CAP1/GPIO35 85 CAP2/GPIO
CAP1/GPIO GPIO-24/ECAP-1/EQEPA-2/MDX-B GPIO-25/ECAP-2/EQEPB-2/MDR-B CAP2/GPIO
U20A SPIBCLK 36 86 SPIBTE
V2 Rd185 SPIBCLK GPIO-26/ECAP-3/EQEPI-2/MCLKX-B GPIO-27/ECAP-4/EQEPS-2/MFSX-B SPIBTE
37 87 +3.3A
GND +5V
100k SPIASIMO 38 88 SPIASOMI
RL4 SPIASIMO GPIO-16/SPISIMO-A/CANTX-B/TZ-5 GPIO-17/SPISOMI-A/CANRX-B/TZ-6 SPIASOMI
LED4 A K SPIACLK 39 89 SPIATE
SPIACLK GPIO-18/SPICLK-A/SCITX-B GPIO-19/SPISTE-A/SCIRX-B SPIATE
QEP1A 40 90 QEP1B
QEP1A GPIO-20/EQEPA-1/MDX-A/CANTX-B GPIO-21/EQEPB-1/MDR-A/CANRX-B QEP1B Rd85
U20B GND +3.3A QEP1STR/GPIO
41 91 QEP1INDEX
QEP1STR/GPIO GPIO-22/EQEPS-1/MCLKX-A/SCITX-B GPIO-23/EQEPI-1/MFSX-A/SCIRX-B QEP1INDEX
42 92 100k
C GPIO-87 (42) GPIO-87 +5V C
UARTRX 43 93 UARTTX
UARTRX GPIO-28/SCIRX-A/Resv/TZ5 GPIO-29/SCITX-A/Resv/TZ6 UARTTX
44 94
Rd86 CANRX GPIO-30/CANRX-A GPIO-31/CANTX-A CANTX
45 95
SYNC GPIO-32/I2CSDA/SYNCI/ADCSOCA GPIO-33/I2CSCL/SYNCO/ADCSOCB
4k7 46 96
/RUN GPIO-34/ECAP1/XREADY +5V
47 97
GND TDI TDI(97)
48 98
TCK (48) TCK TDO TDO (98)
U19B 49 99
RRL1 TMS (49) TMS TRSTn TRSTn (99)
REL-D 50 100
RL-A1 EMU1 (50) EMU1 EMU0 EMU0 (100)
GND
Conector DIMM 28335
FAN_PWM RF1
FANPWM
U19A
+5V
D D
207
VCC VCC VCC Cd18 Cd19

Cd20 U20C U19C U18C 100nF 100nF
100nF
GND GND GND
Power Electronics Institute
Title: DSC e Interface com o Usuário
GND Date: 02/07/2013 Time: 20:00:37
1 2 3 4
208 Apêndice C – Diagramas Esquemáticos
1 2 3 4
+3.3A +3.3A
+5VA +5VA
CTA CTE RTE1
3k9
GND RTA1 GND
Trim DAC block
3
3
Lim0+ 100nF 3k9 Lim2+ 100nF
A IC10A A
5 IC9A 5
CTA1 2 CTE1 2 DAA
/TRIP0 To FPGA /TRIP2 To FPGA
330pF 4 330pF 4
LMV339 LMV339 SPIBCLK 10 2 Lim0+
From DSP SPIBCLK CLK O1
7 3 Lim1+
From FPGA CSSPI2 /CS O2
12
12
6 4 Lim2+
ADCIN-A1 ADCIN-A2 +3.3A /SHDN O3
SPIBSIMO 11 5 Lim3+
From Measurement GND From Measurement GND From DSP SPIBSIMO SDI O4
1 12 Lim4+
IC9B IC10B RDAA1 REF3.0 VREFH O5
7 7 9 13 Lim5+
REF1.5 VREFL O6
CTA2 1 CTE2 1 0R 14 Lim6+
O7
330pF 6 330pF 6 15
O8
Lim0- +3.3A Lim2- +3.3A n.p RDAA2+3.3A
GND
16 8
VDD GND
RTF1 GND
3k9 10uF 100nF
RTB1 CDAA1 CDAA2 AD8803AR
Lim1+ 3k9 Lim3+
9 IC9C 9 IC10C GND GND
B B
CTB1 14 CTF1 14
/TRIP1 To FPGA /TRIP3 To FPGA
330pF 8 330pF 8
Trim DAC block
ADCIN-B1 ADCIN-B2
DAB
From Measurement IC9D From Measurement IC10D
11 11
CTB2 13 CTF2 13 SPIBCLK 10 2 Lim0-
From DSP CLK O1
330pF 10 330pF 10 7 3 Lim1-
From FPGA CSSPI3 /CS O2
Lim1- Lim3- 6 4 Lim2-
+3.3A +3.3A /SHDN O3
SPIBSIMO 11 5 Lim3-
+3.3A From DSP SDI O4
1 12 Lim4-
+5VA RDAB1 GND VREFH O5
CTC RTC1 9 13 Lim5-
+5VA REF1.5 VREFL O6
3k9 CTG RTG1 0R 14 Lim6-
O7
GND 3k9 15
REF3.0 O8
3
GND n.p RDAB2 +3.3A
Lim4+ 100nF
3
IC11A 16 8
5 Lim6+ 100nF VDD GND
CTC1 2 5 IC12A
/TRIP4 To FPGA CDAB1 100nF GND
330pF 4 CTG1 2
/TRIP6 To FPGA 10uF CDAB2
C LMV339 330pF 4 C
AD8803AR
LMV339
12
ADCIN-B0 GND GND
12
From Measurement GND ADCIN-A7
IC11B From Measurement GND
7
CTC2 1 7 IC12B
330pF 6 CTG2 1
Lim4- 330pF 6
+3.3A
Lim6-
RTD1
3k9
Lim5+
9 IC11C
CTD1 14
/TRIP5 To FPGA
330pF 8
D D
209
ADCIN-A0
From Measurement IC11D
11
CTD2 13 Power Electronics Institute
330pF 10 Title: Placa de Controle: Circuito de Proteção
Lim5- Size: A4 Sheet 6 of 6
Date: 02/07/2013 Time: 20:49:48
1 2 3 4
210
1 2 3 4
Con_VBus+ VBus+
1
1
G_Sap Sap G_Sbp Sbp G_Scp Scp
Con_Ros
IGBT IGBT IGBT
RB1
22k
A E_Sap E_Sbp E_Scp A
RB2
22k
G_Sab1
Sab1
RB3
22k E_Sab1 Va_Grid Con_Va
RB-IGBT
1
1
RB4 RB-IGBT
E_Sab2 Con_Ros
22k
C20 C18 C15 Sab2

G_Sab2
100nF 470uF 470uF RB5
22k G_Sbc1
Sbc1
CASR25 NP_Sb
RB6 E_Sbc1 Vb_Grid Con_Vb
C19 C16 C17 RB-IGBT 4 3
B 22k 1 B
100nF 470uF 470uF 5 2 1
RB-IGBT 6 1
E_Sbc2 Con_Ros
RB7
R
M
V0
V+
22k
Sbc2
G_Sbc2 R_ib
RB8 G_Sca1 M_ib +5V
22k Sca1
GND
CASR25 NP_Sc
E_Sca1 Vc_Grid Con_Vc
RB9 RB-IGBT 4 3
1
22k 5 2 1
RB-IGBT 6 1
E_Sca2 Con_Ros
R
M
V0
V+
RB10
22k Sca2
G_Sca2 R_ic
M_ic +5V
C DELTA GND C
G_San San G_Sbn Sbn G_Scn Scn HS1

IGBT IGBT IGBT GND
Con_VBus- +12V
LAM 3 - 75mm - 12V
1 LAM 4 - 100mm - 12V
1
LAM 4 - 125mm - 12V
Con_Ros VBus- E_Sxn Fischer Elektronik
Ventilador 12V
GND DOUBLE STAR Dissipador LAM_6_12V

Montar próximo dos sensores de corrente
+5V +5V
Fu2 Fu3 Fu4 Fu5

Cfs1 Cfs2 Fu1

100nF 100nF 0 0 0 0
0 0 0 0 0
D 0 D
Furo_IGBT Furo_IGBT Furo_IGBT Furo_IGBT
Furo_IGBT
Fu6 Fu7 Fu8 Fu9
GND GND 0 0 0 0 Power Electronics Institute
0 0 0 0
Title: Placa de Potência: Interruptores e Sensores
Furo_IGBT Furo_IGBT Furo_IGBT Furo_IGBT Size: A4 Sheet 1 of 4
Date: 02/07/2013 Time: 20:57:08
1 2 3 4
1 2 3 4
A
DELTA DOUBLE A
GND GND GND GND
DSab1 DSbc2 DSap STAR DSbn
G_Sab1 G_Sbc2 G_Sap G_Sbn
4 GND 4 GND 4 GND 4 GND
+12V 5 +Vcc V_Gate 1 +12V 5 +Vcc V_Gate 1 +12V 5 +Vcc V_Gate 1 +12V 5 +Vcc V_Gate 1
3 NC 3 NC 3 NC 3 NC
GSab1_gd 6 V_in V_Emmiter 2 GSbc2_gd 6 V_in V_Emmiter 2 GSap_gd 6 V_in V_Emmiter 2 GSbn_gd 6 V_in V_Emmiter 2
7 GND_in 7 GND_in 7 GND_in 7 GND_in
E_Sab1 E_Sbc2 E_Sap E_Sxn
Driver Soeiro Driver Soeiro Driver Soeiro Driver Soeiro
GND GND GND GND
GND GND GND GND

DSab2 DSca1 DSan DScp
G_Sab2 G_Sca1 G_San G_Scp
3 NC 3 NC 3 NC 3 NC
GSab2_gd 6 V_in V_Emmiter 2 GSca1_gd 6 V_in V_Emmiter 2 GSan_gd 6 V_in V_Emmiter 2 GScp_gd 6 V_in V_Emmiter 2
B 7 GND_in 7 GND_in 7 GND_in 7 GND_in B
E_Sab2 E_Sca1 E_Sxn E_Scp
GND GND GND GND
GND GND GND GND

DSbc1 DSca2 DSbp DScn
G_Sbc1 G_Sca2 G_Sbp G_Scn
3 NC 3 NC 3 NC 3 NC
GSbc1_gd 6 V_in V_Emmiter 2 GSca2_gd 6 V_in V_Emmiter 2 GSbp_gd 6 V_in V_Emmiter 2 GScn_gd 6 V_in V_Emmiter 2
7 GND_in 7 GND_in 7 GND_in 7 GND_in
E_Sbc1 E_Sca2 E_Sbp E_Sxn
GND GND GND GND
C C
D D
211

Title: Placa de Potência: Gate Drivers
Date: 02/07/2013 Time: 21:02:49
1 2 3 4
1 2 3 4
CTRL_1
1 45
+5V +5VA GPIO1
2 46
+5V +5VA GPIO2
3 47
i1aRef GPIO3
A 4 48 A
i1a GPIO4
5 49
i2aRef +3V3
6 CTRL BOARD 50
i2a +3V3
7 51
GND GND GND GND
8 52
GND GND GND GND
9 53
R_ib i1bRef +5V
10 54
M_ib i1b +5V
11 55
R_ic i2bRef GND
12 56
M_ic i2b GND
13 57
GND OPWM29 GSca2_gd
14 58 FANPWM
GND FANPWM
15 59
iPosRef OPWM30 GSca1_gd
16 60
iPos RL-A1
17 61
iNegRef OPWM27 GScn_gd
18 62
iNeg OPWM14 GSbc1_gd
19 63
3.3A OPWM28 GScp_gd
20 64
3.3A OPWM13 GSbp_gd
21 65
GND GND GND
22 66
GND GND GND
B 67 B
OPWM25 GSbc2_gd
68
OPWM12 GSab1_gd
69
OPWM26 GSbn_gd
70
OPWM11 GSap_gd
71
OPWM23 GSab2_gd
72
OPWM10
23 73
+5V +5VA OPWM24 GSan_gd
24 74
+5V +5VA OPWM9
25 75
uAxN GND GND
Vbus-_Sig
26 76
uAxM GND GND
Vbus+_Sig
27 77
uAxP OPWM21
Vc_Sig 28 78
u1C OPWM8
Va_Sig 29 79
u1A OPWM22
Vb_Sig 30 80
u1B OPWM7
31 81
GND OPWM19
32 82
GND OPWM6
33 83
u2C OPWM20
34 84
+3.3A OPWM5
35 85
u2A GND GND
C 36 86 C
+3.3A GND GND
37 87
u2B OPWM17
38 88
GND GND OPWM4
39 89
GND GND OPWM18
40 90
ADCAx-B6 OPWM3
41 91
uMID OPWM15
42 92
ADCAx-A7 OPWM2
43 93
ADC - B7 OPWM16
44 94
uPOS OPWM1
Ctrl_Board
D D
213

Title: Placa de Potência: Placa de Controle
Date: 02/07/2013 Time: 21:19:50
1 2 3 4
214
1 2 3 4
VCC2
VCC2
RD VCC2
680
A C40 A
RE C29 C30 R34 100nF
100nF 100nF 3.3k
2.7k P2
VCC2 U1 Q1 GND_in
VCC2 2
4 7 GND_in GND_in 33nF 3
RST DIS C31 GND_in 1
4
C25 6 3 R80 HBout_1
THR OUT 5, 6
100nF 6R P3
2 5 1 SA
TRIG CVOLT C32 1
2
C26 SGND 2
GND_in 8 1 33nF
+VCC GND 7, 8
10nF
LM555CMX R35 Si4532 P4
GND_in 3.3k GAg
C28 1
GND_in GAe
2
150pF
3
B B
GND_in GND_in GND_in
D300
+15V
T01
2 FDLL4148 Gate Signal apa
S1a C300 D301
HBout_1 1 3 R300
Pa S1b 1u/25V R301 U300 GAg
Sapa Gate
C302 DZ01 130R 8 22R
Vcc
6 4 24V SA 2 7 FDLL4148 DZ301
GND_in Pb S2a C301 A Vo R302
5 3 6 18V
100n S2b 1u/25V K Vo
RS01 5 39R R303
D302 Vee
Power Supply Transfomer SGND 130R 4k7
-5V FOD-3180 DZ302
18V
FDLL4148 0V GAe
Sapa Emitter
C42 C36 C38 C37 C39 C43
1u/25V 100nF 1u/25V 100nF 1u/25V 1u/25V
C C
Observation:
T03-T04: Prim. (pin 3-1) 6 turns,
Upper Sec. (pin 5-6) 16 turns,
Bottom Sec (pin 4-5) 5 turns.
Llkg=1uH and Lm=40uH
VCC1: 5 Vdc / VCC2: 12 Vdc.
D D

Title: Placa de Gate Driver
Date: 02/07/2013 Time: 21:29:27
1 2 3 4
Apêndice C – Diagramas Esquemáticos 215
Apêndice C – Diagramas Esquemáticos 217

Pedro André Martins Bezerra: Universidade Federal de Santa Catarina Departamento de Engenharia Elétrica

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UNIVERSIDADE FEDERAL DE SANTA CATARINA

DEPARTAMENTO DE ENGENHARIA ELÉTRICA

Pedro André Martins Bezerra

INVERSOR TRIFÁSICO PWM FONTE DE

INVERSOR TRIFÁSICO PWM FONTE DE

Dissertação submetida ao Programa de Pós-

Florianópolis, Julho de 2013

Bezerra, Pedro André

Dissertação (mestrado) - Universidade Federal de Santa

1. Engenharia Elétrica. 2. Inversor de Tensão PWM. 3.

Marthin Luther King

Gostaria de expressar toda minha gratidão a todos que me apoia-

Obrigado a todos e a deus pela vida!

Este trabalho apresenta o estudo de uma nova topologia de um

This work analyzes a novel three-phase two-level delta-switch active

Símb. Descrição Unid.

Grampeamento Ativo no Ponto Central

2 INVERSORES TRIFÁSICOS DE ALTO DESEMPENHO

3 OPERAÇÃO E PRINCíPIOS DE MODULAÇÃO VETORIAL

4 MODULAÇÃO PWM BASEADA EM PORTADORAS . . . . . . . 47

5 ANÁLISE DO DESEMPENHO DO ∆-VSI . . . . . . . . . . . . . . . . . . . 89

7 CONCLUSÃO GERAL . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 163

Apêndice A – Algorítmo para cálculo de Esforços do ∆-VSI . . . . . . 179

Referências Bibliográficas . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 179

Apêndice B – Projeto Físico dos Indutores do Filtro LCL. . . . . . . . . 193

Apêndice C – Diagramas Esquemáticos . . . . . . . . . . . . . . . . . . . . . . . . . . . 203

1.1 Contextualização do Trabalho

O século XXI trouxe consigo diversas propostas de mudanças na

Por Uso Primário Por Fonte Primária

Bilhão de *TEP Bilhão de *TEP

*Tonelada Equivalente de Petróleo

O aumento do consumo energético presenciado nos últimos anos,

envolvendo emissão de gases causadores do efeito estufa, radiação e

Figura 1.2: Diagrama unifilar simplificado de uma rede inteligente.

Nesse novo sistema, os consumidores de energia passam também

Figura 1.3: Esquemático de blocos de um veículo elétrico.

Entretanto, para que seja feito o controle da energia gerada e

ções, em satélites e em aplicações aeroespaciais e navais. Outro aspecto

1.2 Principais Contribuições do Trabalho

O trabalho em questão contribuiu no estudo de uma nova topo-

1.2.1 Artigos Publicados

No decorrer do ano destinado ao desenvolvimento do trabalho de

1.3 Estrutura da Dissertação

Esta dissertação está dividida em seis capítulos destinados ao es-

para a circulação das correntes nos interruptores em um estado de co-

2 INVERSORES TRIFÁSICOS DE ALTO DESEMPENHO

Neste capítulo, será feita uma revisão bibliográfica sobre inver-

2.2 Inversor Trifásico de Tensão Dois Níveis Convencional

O 2L-VSI operando com Modulação por Largura de Pulso

Figura 2.1: Inversor trifásico fonte de tensão dois níveis convencional.

Figura 2.2: Tensão entre os terminais CA de um inversor trifásico dois níveis.

[9]–[11] e produz elevados níveis de emissões de modo comum 1 .

2.3 Inversores Dois Níveis com Comutação Suave

Na década de 1990, para reduzir os esforços nos semicondutores

2.4 Inversores Dois Níveis Operando em Máquinas com Bo-

Para tentar reduzir a tensão de modo comum e a ondulação de

Figura 2.4: Inversor trifásico de tensão dual.

a máquina é submetida [18], [19]. As desvantagens desse conversor são

2.5 Inversores Três Níveis

Bilhão de TEP Bilhão de TEP