Circuits Integrés

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II Les circuits combinatoires:

1. MULTIPLEXEUR
MUX 4 à 1

MUX 8 à 1
 Réalisation d’un multiplexeur à une entrée d’adresse et deux entrées
d’information (MUX 2 à 1)

 Etablir la table de vérité.

Y= S0 A + S1 A
 Multiplexeur (MUX 2 à 1) avec entrée d’activation (ENABLE)

Y= S0 A E + S1 A E
 Schéma
 Réalisation d’un multiplexeur à 2 entrées d’adresse et 4
entrées d’information (MUX 4 à 1)
Exercice1
 Soit la table de vérité suivante:

 Réaliser la fonction logique F en utilisant un multiplexeur à 3


entrées de sélection
Exercice2
 Soit la table de vérité suivante:

 Réaliser la fonction logique F en utilisant un multiplexeur à 2


entrées de sélection
Exercice3 :

 La fonction « Majorité » M est une fonction dont la valeur est


1 chaque fois qu’il y a une majorité de 1 parmi les variables
d’entrée.

A- Donner la table de vérité de ce système.


B- Réaliser ce système en utilisant un multiplexeur à 2 entrées
d’adresse.
Exercice4
4 interrupteurs A,B,C et D commandent 2 moteurs M1 et M2 de la
façon suivante:

 Si les 4 interrupteurs sont ouverts alors M1 et M2 sont repos.


 Le moteur M1 fonctionne si le nombre des interrupteurs fermés
est impair.
 Le moteur M2 fonctionne si le nombre des interrupteurs fermés
est pair.

# Réaliser ce système à l’aide d’un multiplexeur de votre choix.


Exercice5

 Réaliser un multiplexeur (MUX 4 à 1) en utilisant (MUX 2 à 1).

 Réaliser un multiplexeur (MUX 8 à 1) en utilisant (MUX 2 à 1).


A

B
Exercice6

 Réaliser un multiplexeur (MUX 16 à 1) en utilisant 2 multiplexeurs


(MUX 8 à 1).
2. DÉMULTIPLEXEUR 1 à 4
S0

4 -1 S1
B A S0 S1 S2 S3
E1 MUX
S2
0 0 E1 0 0 0
0 1 0 E1 0 0
S3 1 0 0 0 E1 0
1 1 0 0 0 E1

Écrivez les équations des sorties

A B
3. DÉCODEUR

S0
B A S0 S1 S2 S3

0 0 1 0 0 0
A S1
Décodeur
0 1 0 1 0 0
2 - 4

B S2 1 0 0 0 1 0

1 1 0 0 0 1
S3

Écrivez les équations de sorties


Exercice1 :
 Soit la fonction logique de 3 variables définie par la table de vérité
suivante:

 Réaliser la fonction logique f à l’aide d’un décodeur à 3 entrées


d’adresse A,B et C et huit sorties active à l’état haut.
Exercice2 :
 Réaliser, sans simplifier la fonction H, à l’aide de deux décodeurs à
3 entrées de sélection et 8 sorties et quelques portes logiques.
4. ENCODEUR 4 à 2
I0 I0 I1 I2 I3 O1 O0

1 0 0 0 0 0
I1 O0
Encodeur
4 - 2
0 1 0 0 0 1
I2 O1

0 0 1 0 1 0

I3
0 0 0 1 1 1

Écrivez l’équation de sortie


5. ENCODEUR DE PRIORITÉ 4 à 2

I0
I0 I1 I2 I3 O1 O0

I1 O0
1 X X X 0 0
Encodeur de
Priorité 0 1 X X 0 1
4 - 2

I2 O1 0 0 1 X 1 0
0 0 0 1 1 1
I3

Écrivez l’équation de sortie


6. Décodeur BCD – 7 segments
6. LE DEMI ADDITIONNEUR :

  A. B  A.B  A  B C  A.B
Le Demi-Additionneur

B A

C
L'ADDITIONNEUR COMPLET
L'ADDITIONNEUR COMPLET

 Trouver les équations logiques


 En déduire le logigramme de circuit
L'ADDITIONNEUR COMPLET
en utilisant des demi-additionneurs
L'ADDITIONNEUR 4 bits en utilisant
un additionneur-complet
7. LE COMPARATEUR

S1  A. B S 3  A. B S 2  S1  S 3
1) Circuit séquentiel :
Notion d'horloge 9) Codage et conversion
5) Le microprocesseur
(système synchrone / des signaux
asynchrone)

2) Les bascules
10) Transmission en
(T; RS; RST; D et D latch; 6) Les mémoires
bande de base
JK)

3) Les registres 7) La carte mère 11) Médias Réseau

8) Principe de la 12) Transmission en


4) Les bus
transmission d'un signal modulation numérique

13) Modem (caractéristiques et normes)

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