Examen Final de Arquitectura Del Computador A

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EXAMEN FINAL DE ARQUITECTURA DEL COMPUTADORA 2020

1.- Por que se dice interconexiones CPU


SON LOS MECANISMOS QUE VAN A PROPORCIONAR COMUNICACIÓN ENTRE LA UNIDAD DE
CONTROL, LOS REGISTROS Y LA ALU.
2.- El rendimiento de un Procesador puede medirse Utilizando:
❖ CICLOS DE RELOJ
❖ OPERACIÓN DE RELOJ
3.- Una CPU contendrá generalmente:
1.- Dispositivos de Almacenamiento……… REGISTROS
…………………
ALU
2.- Circuitería de cómputo llamado …. ……………………
INSTRUCCIÓN
3. Circuitería de decodificación llamado……………………..
4.- Una sección de ……CONTROL TIEMPO
y de ………
5.- Cual será la Frecuencia de los siguientes Periodos:
1s, 0,1s, 1ms, 1µs , 0,1 µs, 0,01 µs , 1ns , 0,3ns
6.- En qué tipo de Tiempo actúa el reloj de sistema como referencia:
a) Tiempo de Interrupción b) Asíncrona c) Tiempo de Sincronización d) Secuencial
CICLO DE EJECUCIÓN
7.- En un CPU el proceso de realización que especifica una función se denomina…………………..
8.- Las Memorias cuentan con 2 operaciones diga cuales son:
❖ ESCRITURA (WRITE) PERMITE ALMACENAR UNA PALABRA EN UNA DETERMINADA
DIRECCIÓN DE LA MEMORIA.
❖ LECTURA (READ) PERMITE RECUPERAR LO ALMACENADO EN UNA DETERMINADA
DIRECCIÓN DE LA MEMORIA
9.- Indique las formas en que una computadora se comunica con el entorno exterior:
❖ PERIFÉRICOS
❖ LAS LÍNEAS DE COMUNICACIÓN
10.-Indique las partes de un µP
GENERADOR DE RELOJ, ULA, DECODIFICADOR DE INSTRUCCIÓN, UNIDAD DE CONTROL, CICLO
DE INSTRUCCIÓN.
11. Mencione los parámetros significativos de un procesador:
❖ ANCHO DE BUS (MEDIDO EN BITS
❖ FRECUENCIA DE RELOJ
❖ TAMAÑO DE MEMORIA CACHE
12.- Que criterios debes tener en cuenta para la adquisición de un Disco Duro
❖ CAPACIDAD DE ALMACENAMIENTO
❖ VELOCIDAD DE ROTACIÓN
❖ TIEMPO DE ACCESO
❖ MEMORIA CACHE,
❖ TASA DE TRANSFERENCIA
❖ INTERFAZ USB,
13.- Una memoria que está estructurada en palabras de 16 bits tiene una capacidad de 64 kbit.
¿Cuántas líneas de dirección tiene? a) 4 b) 12 e) 16 d) 64

14.-Se dispone de una maquina con dos clases de instrucciones, la instrucción 1, tendrá un CPI
de 3 y La instrucción 2 un CPI de 2. Al medir el código para el código para el mismo programa
para compiladores diferentes se obtienen los siguientes datos. Se supone que la frecuencia de
reloj de la maquina es de 200MHZ. ¿Qué secuencia de código se ejecuta con más rapidez de
acuerdo las MIPS?
Código Instrucción 1 Instrucción 2

Compilador A 6 4

Compilador B 4 2

∑𝑵
𝒊=𝟏(𝑪𝑷𝑰 ∗ 𝑰)
𝑪𝑷𝑰 =
# 𝑰𝒏𝒔𝒕𝒓𝒖. 𝑻𝑶𝑻𝑨𝑳

(𝟔. 𝟑 + 𝟐. 𝟐) 𝟐𝟐
𝑪𝑷𝑰𝑨 = = = 𝟐. 𝟕𝟓
(𝟔 + 𝟐) 𝟖
(𝟒. 𝟑 + 𝟐. 𝟐) 𝟏𝟔
𝑪𝑷𝑰𝑩 = = = 𝟐. 𝟔𝟔
(𝟒 + 𝟐) 𝟔

(𝟐𝟎𝟎. 𝟏𝟎𝟔 )
𝑴𝑰𝑷𝑺𝑨 = = 𝟕𝟐. 𝟕𝟐
(𝟐. 𝟕𝟓. 𝟏𝟎𝟔 )

(𝟐𝟎𝟎. 𝟏𝟎𝟔 )
𝑴𝑰𝑷𝑺𝑩 = = 𝟕𝟓. 𝟏𝟖
(𝟐. 𝟔𝟔. 𝟏𝟎𝟔 )

𝑪𝑷𝑰. #𝑰𝑵𝑺𝑻𝑹𝑼𝑪
𝑻𝑷𝑹𝑶𝑮 =
𝒇𝑪𝑷𝑼
𝟐. 𝟕𝟓(𝟔 + 𝟐) 𝟐𝟐
𝑻𝑷𝑹𝑶𝑮 𝑨 = = = 𝟏. 𝟏−𝟕 𝑺−𝟏
𝟐𝟎𝟎. 𝟏𝟎𝟔 𝟖
𝟐. 𝟔𝟔(𝟒 + 𝟐) 𝟐𝟐
𝑻𝑷𝑹𝑶𝑮 𝑩 = = = 𝟕𝟗. 𝟖−𝟕 𝑺−𝟏
𝟐𝟎𝟎. 𝟏𝟎𝟔 𝟖
LOS RESULTADOS DE TIEMPO DE EJECUCION CONTRADICEN LOS MIPS

15.- Si tenemos un computador que puede ejecutar 1000000 de instrucciones, en el tiempo que se
tarda en leer un bloque de 2048bytes , indicar cuantas de esas instrucciones quedaría
disponibles para otros procesos si la conectamos un sistema de E/S mediante interrupciones ,
al que se conecta únicamente el periférico anterior y cuya rutina de tratamiento de
interrupción consta de 20 instrucciones

AL SER UN SISTEMA DE E/S MEDIANTE INTERRUPCIONES, LA RUTINA DE TRATAMIENTO SE


EJECUTARÁ UNA VEZ POR BYTE CON LO QUE 2,048BYTES/BLOQUE 20 INSTRUCCIONES/BYTE = 40
960INSTRUCCIONES /BLOQUE.

QUEDARAN LIBRES PARA OTROS PROCESOS:

1,000000 – 40,960 = 959,040 INSTRUCCIONES

Mg. Julio Azaña

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