Universidad Privada del Valle

PRACTICA Nº 8

DISEÑO DE CONTADORES ASINCRONOS

1. OBJETIVOS.-

Manejar los Flip – Flops JK para implementar semáforo, a través de la

resolución de problemas

2. FUNDAMENTO TEORICO.-

Conocer el funcionamiento de los flip - flop JK para el diseño de contadores

asíncronos

3. MATERIALES.-

Circuito integrado 74LS112

Circuito integrado 7408
Circuito integrado 7432
Circuito integrado 7411
6 Resistencias de 220 Ω
6 LED (Rojo, amarillo, verde)
Generador de señal
Fuente de alimentación
Protoboard

4. PROCEDIMIENTO.-

Parte 1

Diseñe un semáforo que cambien su secuencia de la siguiente forma:

Rojo a Verde en 3.5 seg.

Verde a amarillo en 3 seg.
Amarillo a Rojo en 1 seg.

Figura 1: Esquema lógico de un contador binario asíncrono ascendente de 4 bits.

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5. DATOS Y CALCULOS REALIZADOS.-

SALIDA SEMAFORO 1 SALIDA SEMAFORO 2

QA QB QC VERD AMARILL ROJ VERD AMARILL
ROJO
E O O E O
0 0 0 1 0 0 0 0 1
0 0 1 1 0 0 0 0 1
0 1 0 1 0 0 0 0 1
0 1 1 0 1 0 0 0 1
1 0 0 0 0 1 1 0 0
1 0 1 0 0 1 1 0 0
1 1 0 0 0 1 1 0 0
1 1 1 0 0 1 0 1 0
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6. CONCLUSIONES.-

Al implementar el manejo del Flip Flop se pudo determinar una secuencia de

tiempos procedidos según el circuito

La secuencia generada por estos circuitos pudo ser obtenida por: generador de
señal que nos dio diferentes señales que programaron este circuito según los
rangos que necesitábamos.

7. CUESTIONARIO.-

7.1 Que valores iniciales tendría que tener un contador ascendente en Q3,
Q2,Q1 y Qo para que en el primer clock genere a la salida el valore de Q3=0,
Q2=0, Q1=0 y Qo=0.
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7.2. Que valores iniciales tendría que tener un contador descendente en Q3,
Q2, Q1 y Qo para que en el primer clock genere a la salida el valor de Q3=1,
Q2=1, Q1=1 y Qo=1
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8. TRABAJO PRÁCTICO.-

CONTADORES ASÍNCRONOS

Un contador es un circuito secuencial el cual cambia de estado de acuerdo una

secuencia establecida por el diseño. Un contador, está construido con base de
Flip-Flops. El número de Flip-Flops utilizados indica el número de bits del
contador, es decir, cada Flip-Flop representa un bit dentro de la secuencia de
conteo.

El termino asíncrono indica que los eventos no poseen una relación temporal fija
entre ellos y que no necesariamente ocurren en el mismo instante de tiempo. Esto
indica que en un contador asíncrono los Flip-Flops no comparten la misma señal
de reloj.

Contador Asíncrono Binario de 2 bits

Para obtener un contador asíncrono, se debe usar 2 Flip-Flops J-K flanco de

bajada. Se debe conectar de la misma forma que un divisor de frecuencia.
Entonces se debe conectar la señal de reloj a la entrada de reloj del primer Flip-
Flop cuya salida se considera Q0. Esta salida entonces será el reloj del siguiente
Flip-Flop cuya salida se denominara Q 1. Las entradas J y K deben estar en 1
lógico. La siguiente figura muestra la implementación del contador y los
oscilogramas que dan como resultado de su funcionamiento.

En los oscilogramas, se puede apreciar que en cada flanco de bajada del reloj,
bascula Q0 y en cada flanco de bajada de Q0bascula Q1. Analizando los valores de
Q0 y Q1 en cada periodo de reloj, se nota que las salidas Q 0 y Q1 forman estados
que se pueden representar en una tabla denominada tabla de secuencia. El la
figura anterior, se muestra que en cada basculación existe un tiempo de retardo de
propagación que equivale a 30 nseg que es el tiempo de retardo de un Flip-Flop J-
K.
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CLK Q1 Q0
↓ 0 0
↓ 0 1
↓ 1 0
↓ 1 1

Contador Asíncrono Binario de 4 bits

Para obtener un contador asíncrono de 4 bits, se debe usar 4 Flip-Flops J-K flanco
de bajada. La implementación es igual que la anterior. La siguiente figura muestra
la implementación del contador y los oscilogramas que dan como resultado de su
funcionamiento.

En los oscilogramas, se puede apreciar que en cada flanco de bajada del reloj,
bascula Q0 y encada flanco de bajada de Q 0bascula Q1 y sucesivamente.
Analizando los valores de Q 0, Q1, Q2 y Q3 en cada periodo de reloj, se nota que las
salidas Q0, Q1, Q2 y Q3 forman estados que se pueden representar en una tabla de
secuencia.

CLK Q3 Q2 Q1 Q0
↓ 0 0 0 0
↓ 0 0 0 1
↓ 0 0 1 0
↓ 0 0 1 1
↓ 0 1 0 0
↓ 0 1 0 1
↓ 0 1 1 0
↓ 0 1 1 1
↓ 1 0 0 0
↓ 1 0 0 1
↓ 1 0 1 0
↓ 1 0 1 1
↓ 1 1 0 0
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↓ 1 1 0 1
↓ 1 1 1 0
↓ 1 1 1 1

Contador Asíncrono BCD

Para obtener un contador asíncrono BCD, se debe usar 4 Flip-Flops J-K flanco de
bajada. La implementación es igual que la anterior. Sin embargo requiere un
elemento adicional. La cuenta debe hacerse hasta el estado 1001 2 lo cual indica
que no se desea la presencia del estado 1010 2. La solución es enviar una
activación del Clear cuando se presente este estado, de esta forma el estado
siguiente del 10012 seria el 00002.

Para obtener estos resultados es necesario encontrar una expresión Booleana que
permita obtener los resultados deseados. Para el diseño se debe partir de la tabla
de secuencia del contador considerando el valor del CLR.

Q3 Q2 Q1 Q0 CLR
0 0 0 0 1
0 0 0 1 1
0 0 1 0 1
0 0 1 1 1
0 1 0 0 1
0 1 0 1 1
0 1 1 0 1
0 1 1 1 1
1 0 0 0 1
1 0 0 1 1
1 0 1 0 0

Para obtener la expresión del CLR se puede hacer un mapa de Karnaugh.

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La siguiente figura muestra la implementación del contador y los oscilogramas que

dan como resultado de su funcionamiento.

En los oscilogramas, se puede apreciar que en cada flanco de bajada del reloj,
bascula Q0 y en cada flanco de bajada de Q 0bascula Q1 y sucesivamente. Sin
embargo, en el momento es que la combinación de las salidas dan el estado
10102 hay un clear asíncrono a todos los Flip-Flops regresando rápidamente la
señal de clear a nivel alto. Este pequeño impulso que se presenta en la línea de
clear se denomina glitch, ya que se considera un impulso no deseado. Sin
embargo, esta es la única forma de implementar contadores de modulo diferente
de 2n con un contador asíncrono. En la salida Q1 también se presenta un glitch, en
el instante en que el contador tiene el valor 1010 2.

Contador Asíncrono Binario de 4 bits descendente

Para obtener un contador asíncrono de 4 bits descendente, se debe usar 4 Flip-

Flops J-K flanco de subida. En este caso, la salida Q de un Flip-Flop, se convierte
en el reloj del siguiente Flip-Flop. La implementación es exactamente igual al
contador asíncrono binario de 4 bits, cambiando el flanco del reloj.

Otra forma de hacer la implementación, es usar Flip-Flops flanco de bajada, pero

conectando la salida Q negado de un Flip-Flop al reloj del siguiente Flip-Flop. Esta
segunda opción, suele ser mas conveniente debido a que en el mercado se
encuentra con mayor frecuencia Flip-Flops flanco de bajada.

La siguiente figura muestra la implementación del contador y los oscilogramas que

dan como resultado de su funcionamiento.
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En los oscilogramas, se puede apreciar que en cada flanco de bajada del reloj,
bascula Q0 y encada flanco de subida de Q0bascula Q1 y sucesivamente.
Analizando los valores de Q0, Q1, Q2 y Q3 en cada periodo de reloj, se nota que las
salidas Q0, Q1, Q2 y Q3 forman estados que se pueden representar en una tabla de
secuencia.

CLK Q3 Q2 Q1 Q0
↓ 0 0 0 0
↓ 1 1 1 1
↓ 1 1 1 0
↓ 1 1 0 1
↓ 1 1 0 0
↓ 1 0 1 1
↓ 1 0 1 0
↓ 1 0 0 1
↓ 1 0 0 0
↓ 0 1 1 1
↓ 0 1 1 0
↓ 0 1 0 1
↓ 0 1 0 0
↓ 0 0 1 1
↓ 0 0 1 0
↓ 0 0 0 1

Contador Asíncrono Binario de 4 bits ascendente / descendente

Para obtener un contador asíncrono de 4 bits ascendente descendente, se debe

usar 4 Flip-Flops J-K flanco de bajada. Para este contador, es necesario tener una
entrada adicional que permita seleccionar la cuenta ascendente o descendente.
Por medio de esta entrada, se desea seleccionar Q o Q negado para que se
aplique al reloj del siguiente Flip-Flop. Entonces, considerando que cuando esta
entrada se encuentre en 0 lógico, el contador cuente ascendente y cuando se
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encuentre en 1 lógico el contador cuenta descendente, se plantea el siguiente

diseño.

AD Qn CLK
0 0 0
0 1 1
1 0 1
1 1 0

La tabla anterior plantea que cuando la entrada AD sea 0, el contador cuenta

ascendente y para ello se debe aplicar al reloj del siguiente Flip-Flop la línea Q.
Pero cuando la entrada AD sea 1, el contador cuenta descendente y para ello se
debe aplicar al reloj del siguiente Flip-Flop la línea Q negado.

Entonces se obtiene la siguiente expresión Booleana.

Con base en el resultado anterior, se puede concluir que al reloj del siguiente Flip-
Flop, se debe aplicar una XOR entre la entrada AD y la salida Q. Esto se debe
aplicar para los Flip-Flops 1, 2 y 3, debido a que el reloj del Flip-Flop 0 se
encuentra conectado a la salida del temporizador.

9. BIBLIOGRAFIA.-

 http://hflorezf-es.blogspot.com/2011/09/contadores-asincronos.html
 http://www.kumbaya.name/ci1210/leccion10%20registros%20y
%20contadores/Contadores%20Asincronos.htm
 http://meteo.ieec.uned.es/www_Usumeteog/comp_sec_contadores_asin.ht
ml
 http://www.profesores.frc.utn.edu.ar/electronica/tecnicasdigitalesi/pub/file/cu
rsoCavallero/J_002-CONTADORES.pdf
 http://www.ehowenespanol.com/contadores-sincronos-asincronos-
info_472637/