Microprocesador 8080
Microprocesador 8080
Microprocesador 8080
Microprocesador 8080
Pr F V A N M M Breve
ocesador echa de elocidad ncho mero emoria emoria descripc
pr d d de di v in
esentaci e reloj e bus tr reccionarl irtual
n ansistor e
es
Primer
2
80 15 1 4 64 chip con
.300 (10
08 /11/71 08 KHz. bits 0 byte manipulacin
micras)
aritmtica
80 1/ 1 8 3 16 Manipula
80 4/72 08 KHz. bits .500 KBytes cin Datos/texto
10 veces
las (6
micras) prestacion
es
[http://www.monogra
80 1/ 2 8 6 64
fias.com/trabajos15/
86 4/74 MHz. bits .000 KBytes
cumplimiento-
defectuoso/cumplimi
ento-
defectuoso.shtml#IN
CUMPL] del 8008
5
MHz. 2
10 veces
80 8/ 8 1 9.000 1
las prestaciones
88 6/78 MHz. 6 bits ( MegaByte
del 8080
1 3 micras)
0 MHz.
80 1/ 5 8 2 Idntico
286 6/79 MHz. bits 9.000
Tema Vistas dinmicas. Con la tecnologa de Blogger. al 8086 excepto
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11/7/2017 Microprocesador 8080
8 en su bus externo
MHz. de 8 bits
8
1
MHz. De 3 a 6
34.000
1/ 1 1 16 1 veces las
(
2/82 0 MHz. 6 Bits Megabytes Gigabyte prestaciones del
1.5
1 8086
micras)
2 MHz.
Modelo de programacin
El Intel 8080 fue el sucesor del Intel 8008, esto se deba a que
era compatible a nivel fuente en el lenguaje ensamblador porque usaban el
mismo conjunto de instrucciones desarrollado por Computer Terminal
Corporation. Con un empaquetado ms grande, DIP de 40 pines, se permiti
al 8080 proporcionar un bus de direccin de 16 bits y un bus de datos de 8
bits, permitiendo el fcil acceso a 64 KB de memoria. Tena siete registros de
8 bits, seis de los cuales se podan combinar en tres registros de 16 bits,
un puntero de pila en memoria de 16 bits que reemplazaba la pila interna del
8008, y un contador de programa de 16 bits.
Esquema de entrada/salida
El 8080 tena 256 puertos de I/O (entrada/salida) que podan ser
usados por los programas mediante instrucciones dedicadas de I/O, cada una
de esas instrucciones tomando una direccin de puerto de I/O como su
operando. Este esquema, que usaba un espacio de direcciones separado
para las entradas/salidas, es ahora usado menos comnmente que el
de mapeo de memoria para dispositivos o puertos de I/O. En el tiempo del
lanzamiento 8080, el esquema de mapeo de I/O era visto como una ventaja,
pues liberaba el nmero limitado de pines de direccin del procesador para
usarlo en el espacio de direccin de la memoria. Sin embargo, en la mayora
de las otras arquitecturas de CPU, el mapeo de los puertos de I/O en un
espacio de direcciones comn para la memoria y el I/O, daba un conjunto de
instrucciones ms simple, con ninguna necesidad de instrucciones separadas
de I/O.
P No Descripcin
a mb Tema Vistas dinmicas. Con la tecnologa de Blogger.
re
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t re
a
A1
1 Bus de direcciones
0
GN Referencia de tierra. Todas las tensiones se miden con
2
D respecto a este punto.
Si SYNC = 0: Bus de datos.
3 D4
Si SYNC = 1: Seal de control que indica salida a perifrico.
Si SYNC = 0: Bus de datos.
4 D5 Si SYNC = 1: Seal que indica si el uP est en ciclo de
bsqueda de instruccin.
Si SYNC = 0: Bus de datos.
5 D6 Si SYNC = 1: Seal de control que indica entrada de
perifrico.
Si SYNC = 0: Bus de datos.
6 D7 Si SYNC = 1: Seal de control que indica lectura de
memoria.
Si SYNC = 0: Bus de datos.
7 D3
Si SYNC = 1: Seal que indica que el uP se ha detenido.
Si SYNC = 0: Bus de datos.
8 D2 Si SYNC = 1: Seal que indica que se realiza una operacin
con el stack.
Si SYNC = 0: Bus de datos.
9 D1
Si SYNC = 1: Modo lectura/escritura.
1 Si SYNC = 0: Bus de datos.
D0
0 Si SYNC = 1: Seal de reconocimiento de interrupcin.
1
-5V Una de las tres patas de alimentacin del 8080.
1
RE Seal de borrado de todos los registros internos del 8080.
1
SE Para ello, ponerlo a uno durante tres ciclos de reloj como
2
T mnimo.
1 HO Sirve para poner los buses en alta impedancia para el
3 LD manejo de DMA (acceso directo a memoria).
1
INT Seal de pedido de interrupcin.
4
1 CL
Seal de reloj (debe venir del generador de reloj 8224).
5 K2
1 INT
Seal de aceptacin de interrupcin.
6 E
1 DB
Indica que el bus de datos est en modo lectura.
7 IN
1 /W
Indica que el bus de datos est en modo escritura.
8 R
1 SY Este pin se pone a uno cuando comienza una nueva
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9
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9 NC instruccin.
2 +5
Una de las tres patas de alimentacin del 8080.
0 V
2 HL
Reconocimiento de HOLD.
1 DA
2 CL
Seal de reloj (debe venir del generador de reloj 8224).
2 K1
RE
2 Sirve para sincronizar memorias o perifricos lentos
AD
3 (detiene al 8080 mientras se lee o escribe el dispositivo).
Y
2 WA
Cuando vale "1", el 8080 est esperando al perifrico lento.
4 IT
2
A0
5
2
A1 Bus de direcciones.
6
2
A2
7
2 +1
Una de las tres patas de alimentacin del 8080.
8 2V
2 Bus de direcciones.
A3
9
3
A4
0
3
A5
1
3
A6
2
3
A7
3
3
A8
4
3
A9
5
3 A1
6 5
3 A1
7 2
3 A1
8 3
3 A1
9 4
4 A1
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0 1
Cuando la pata SYNC est a "1" lgico, las patas D0-D7 pasan a ser seales de control,
por lo que no se puede conectar directamente D0-D7 al bus de datos. Se debe intercalar
un controlador y amplificador de bus 8228.
De esta manera se puede observar que el 8080 no funciona si no se agregan los
circuitos integrados de soporte 8224 y 8228.
El conjunto de instrucciones del 8085 contiene dos instrucciones extra, adems de las
utilizadas por el microprocesador 8080.
1. De transferencia de datos
2. Aritmtico
3. Lgico
4. De bifurcacin
5. De fila, E/S y control de mquina
El grupo lgico de instrucciones realiza los AND, OR, XOR, comparaciones, rotaciones o
complementos en los datos de los registros o entre las memorias y un registro.
Programacin
El campo del operando proporciona los datos que van a operarse en el cdigo de
operacin especificado. El campo de operacin tambin se conoce a veces como el
argumento.
Una lnea de programa en lenguaje ensamblador para la 8080/8085 podra verse como
sigue:
Cada uno de los cuatro campos tiene una entrada en este ejemplo. Estos se explican a
continuacin:
Es una ampliacin del conjunto del 8008, como puede observarse a continuacin:
Acumulador A 8 bits
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Registros de uso
http://micro8080.blogspot.com/ BC 16 bits 7/9
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Hay cinco indicadores (Sign, Zero, Alternate Carry, Parity, Carry) ubicado en un
registro de ocho bits llamado F (de Flags):
Bit 7 6 5 4 3 2 1 0
Flag S Z 0 AC 0 P 1 C
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